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패킷링 구성을 이용한 중앙 제어기간 통신 메시지 교환장치 및 방법

  • 기술번호 : KST2015078972
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 예를 들어 10기가비트 이더넷 포트를 가지는 대용량 라우터 시스템 또는 스위치 시스템과 같은 분산형 시스템내에서 중앙 제어기간의 통신(IPC: Inter Processor Communication) 구성을 패킷링(Packet Ring)의 형태로 구성함으로써 이더넷 스위치 없이도 IPC 전송이 가능하도록 한 패킷링 구성을 이용한 IPC 메시지 교환 장치 및 방법에 관한 것이다. 이를 위한 본 발명은 신뢰성 있는 시스템 동작을 위하여 IPC 구성을 패킷링의 형태로 구성하여 스케이러블(scalable) 라우터에 적용 가능하고, 시스템 내의 장애 발생시 IPC 경로를 바꿀 수 있으며, 라우팅 기능과 패킷처리 기능을 분리하는 분산형 시스템으로의 개발이 가능토록 한다. 본 발명을 이용하면, 시스템의 안정성을 높이며, 시스템 구성을 더욱 간소화 할 수 있어 전체 비용을 줄일 수 있는 이점을 제공한다.
Int. CL H04L 12/771 (2014.01) H04L 12/24 (2014.01) G06F 15/163 (2014.01) H04L 12/42 (2014.01)
CPC H04L 45/60(2013.01) H04L 45/60(2013.01) H04L 45/60(2013.01) H04L 45/60(2013.01) H04L 45/60(2013.01) H04L 45/60(2013.01)
출원번호/일자 1020020075405 (2002.11.29)
출원인 한국전자통신연구원
등록번호/일자 10-0462474-0000 (2004.12.09)
공개번호/일자 10-2004-0047259 (2004.06.05) 문서열기
공고번호/일자 (20041217) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.11.29)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김유진 대한민국 대전광역시서구
2 정해원 대한민국 대전광역시대덕구
3 강성수 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 이영필 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)
2 이해영 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2002.11.29 수리 (Accepted) 1-1-2002-0397386-68
2 등록결정서
Decision to grant		 2004.12.01 발송처리완료 (Completion of Transmission) 9-5-2004-0515096-84
3 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
4 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

분산형 시스템내에서의 제어기간 통신(IPC; Inter Processor Communication)을 위한 장치에 있어서,

이중화를 위한 2개의 메인 프로세서;

제어기간 통신(IPC) 전달을 위한 2개의 패킷링;

상기 2개의 패킷링과 각각 연결되어 IPC 메시지 교환을 할 수 있는 2개의 라인카드를 포함하며,

상기 패킷링을 통하여 라우팅 정보와 같은 소정의 정보를 IPC 메시지에 넣어 메시지 교환을 하도록 된 것을 특징으로 하는 패킷링 구성을 이용한 IPC 메시지 교환장치

2 2

제1항에 있어서, 상기 교환장치에서의 데이터 포워딩은 상기 시스템내의 네트워크 프로세서와 스위치 패브릭간의 인터페이스를 통하여 이루어지도록 된 것을 특징으로 하는 패킷링 구성을 이용한 IPC 메시지 교환장치

3 3

제1항에 있어서, 상기 각각의 메인 프로세서는 상기 패킷링과 정합을 위한 IPC 패킷링 MAC(Media Access Control) 장치를 구비하고;

상기 각각의 라인카드는 상기 시스템 초기화를 수행하고, 소정의 포워딩 테이블에 엔트리를 더하고, 멀티캐스트 그룹들을 관리하고, 버퍼관리에서 임계값을 바꾸는 관리 및 제어 기능을 수행하는 호스트 프로세서를 구비하고;

상기 호스트 프로세서는 상기 패킷링과 정합을 위한 IPC 패킷링 MAC 장치를 구비하고;

상기 IPC 패킷링 MAC 장치는 유입되는 상기 IPC 메시지에 대하여 이 메시지를 자신이 사용할 것인지 아니면 인접한 메인 프로세서 또는 호스트 프로세서가 사용하도록 전달할 것인지를 결정하여 해당하는 데이터 흐름을 제어하기 위하여 3개 버퍼로서 수신 버퍼와 송신 버퍼 및 트랜지트 버퍼를 포함하여 이루어지는 것을 특징으로 하는 패킷링 구성을 이용한 IPC 메시지 교환장치

4 4

제3항에 있어서, 상기 3개의 버퍼를 제어하기 위하여 송신 아비터(Tx Arbiter)와 수신 아비터(Rx Arbiter)가 각각 패킷의 방향과 흐름을 제어하고;

상기 각 IPC 패킷링 MAC장치를 위한 버퍼와 상기 각 아비터를 소정의 패킷링 MAC 제어기가 제어하고;

상기 패킷링 MAC 제어기는 소정의 프로세서 인터페이스 제어기를 통하여 상기 메인 프로세서 또는 호스트 프로세서에 정합되고;

상기 수신 버퍼 및 송신 버퍼에 저장된 데이터를 상기 메인 프로세서와 호스트 프로세서의 메모리에 소정의 DMA(Direct Memory Access) 제어기를 통하여 데이터가 송, 수신시 이동을 하도록 된 것을 특징으로 하는 패킷링 구성을 이용한 IPC 메시지 교환장치

5 5

분산형 시스템내에서의 제어기간 통신(IPC; Inter Processor Communication)을 위한 방법에 있어서,

소정의 IPC 메시지가 IPC 패킷링 MAC 장치에 유입되면, 자신에게 온 메시지 인지 아닌지를 상기 IPC 메시지의 고유 어드레스를 보고 수신 아비터가 판단하는 단계;

상기 IPC 메시지가 상기 MAC 장치에 온 것이면 수신 버퍼에 들어가는 단계;

상기 IPC 메시지의 목적지가 상기 MAC 장치가 아니거나 패스-스루우(path-through)해야 하는 메세지인 경우에는 트랜지트 버퍼로 이동하는 단계;

상기 수신된 IPC 메시지가 패킷링 MAC 제어기의 제어에 의하여 DMA 제어기를 통하여 상기 메시지가 메인 프로세서나 호스트 프로세서에 있는 메모리로 이동하고 이동된 상기 메시지는 상기 메인 프로세서나 호스트 프로세서의 각각의 메시지 처리 프로세싱을 수행하는 단계;

IPC 메시지 송신시에는 상기 메인 프로세서나 호스트 프로세서에서 만들어진 상기 IPC 메시지는 각각의 메모리 영역에서 DMA 제어기를 경유하여 송신버퍼에 입력하는 단계;

송신하려는 상기 IPC메시지는 상기 메인 프로세서나 호스트 프로세서의 제어를 프로세서 인터페이스 제어기를 통하여 상기 패킷링 MAC 제어기를 제어하며 이는 송신버퍼를 다시 제어하고 이 경우 송신 아비터는 송신 메시지의 고유 어드레스를 보고 목적방향을 선택 후 IPC 패킷링에 IPC 메시지를 보내는 단계를 포함하여 된 것을 특징으로 하는 패킷링 구성을 이용한 IPC 메시지 교환방법

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.