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스퓨리어스 특성의 개선을 위한 직접디지털주파수합성기구동 위상잠금루프 주파수합성 장치 및 그 방법

  • 기술번호 : KST2015079659
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 1. 청구범위에 기재된 발명이 속하는 기술분야 본 발명은 스퓨리어스 특성의 개선을 위한 직접디지털주파수합성기 구동 위상잠금루프 주파수합성 장치 및 그 방법에 관한 것임. 2. 발명이 해결하려고 하는 기술적 과제 본 발명은 직접디지털주파수합성기(DDS: Direct Digital Synthesizer)에서 발생하는 스퓨리어스 신호를, 위상잠금루프(PLL: Phase Locked Loop) 주파수합성기의 출력신호를 이용하여 제거함으로써, 위상잡음 특성, 스퓨리어스 특성, 정착시간 (settling time) 및 주파수분해능 등을 향상시킬 수 있는, 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 장치 및 그 방법을 제공하는데 그 목적이 있음. 3. 발명의 해결 방법의 요지 본 발명은, 직접디지털주파수합성기(DDS) 구동 위상잠금루프(PLL) 주파수합성 장치에 있어서, 외부로부터 입력되는 기준신호를 구동신호로 하여 소정의 주파수를 갖는 신호를 생성하기 위한 직접 디지털 주파수합성 수단; 상기 직접 디지털 주파수합성 수단의 출력신호를 입력신호로 하여 소정의 고주파신호를 생성하기 위한 PLL 주파수 합성 수단; 상기 PLL 주파수 합성 수단의 고주파 출력신호를 동위상의 두 개의 신호로 전력분배하기 위한 제 1 전력분배 수단; 상기 제 1 전력분배 수단에 의하여 분배된 신호 중 어느 하나의 신호를 다시 동위상의 두 개의 신호로 전력분배하기 위한 제 2 전력분배 수단; 상기 제 2 전력분배 수단의 출력신호 중 어느 하나의 신호를 시간지연시키기 위한 시간지연 수단; 상기 제 2 전력분배 수단의 출력신호 중 다른 하나의 신호의 위상을 반전시키고, 신호 크기를 조절하기 위한 위상변환 및 가변감쇠 수단; 상기 시간지연 수단의 출력신호와 상기 위상변환 및 가변감쇠 수단의 출력신호를 합성하여, 상기 PLL 주파수 합성 수단의 출력신호에 포함되어 있는 스퓨리어스신호와 위상잡음신호를 추출하기 위한 신호 결합 수단; 및 상기 신호 결합 수단에 의하여 추출된 스퓨리어스신호와 위상잡음신호를 상기 PLL 주파수 합성 수단으로 부궤환(negative feedback)시키기 위한 부궤환 수단을 포함함. 4. 발명의 중요한 용도 본 발명은 DDS 구동 PLL주파수합성 장치 등에 이용됨. 스퓨리어스신호, 위상잡음신호, 스펙트럼, 주파수합성기, DDS, PLL.
Int. CL H03L 7/16 (2006.01)
CPC H03L 7/16(2013.01) H03L 7/16(2013.01) H03L 7/16(2013.01)
출원번호/일자 1020030092044 (2003.12.16)
출원인 한국전자통신연구원
등록번호/일자 10-0550630-0000 (2006.02.02)
공개번호/일자 10-2005-0060424 (2005.06.22) 문서열기
공고번호/일자 (20060208) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2003.12.16)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 강상기 대한민국 대전광역시유성구
2 김혁제 대한민국 충청남도연기군
3 이일규 대한민국 대전광역시유성구
4 홍헌진 대한민국 대전광역시유성구
5 송명선 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2003.12.16 수리 (Accepted) 1-1-2003-0480368-17
2 선행기술조사의뢰서
Request for Prior Art Search
2005.06.15 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2005.07.15 수리 (Accepted) 9-1-2005-0040359-20
4 의견제출통지서
Notification of reason for refusal
2005.07.20 발송처리완료 (Completion of Transmission) 9-5-2005-0343184-04
5 명세서등보정서
Amendment to Description, etc.
2005.09.20 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2005-0523904-02
6 의견서
Written Opinion
2005.09.20 수리 (Accepted) 1-1-2005-0523905-47
7 등록결정서
Decision to grant
2006.01.25 발송처리완료 (Completion of Transmission) 9-5-2006-0044336-02
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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직접디지털주파수합성기(DDS: Direct Digital Synthesizer) 구동 위상잠금루프(PLL: Phase Locked Loop) 주파수합성 장치에 있어서, 외부로부터 입력되는 기준신호를 구동신호로 하여 소정의 주파수를 갖는 신호를 생성하기 위한 직접 디지털 주파수합성 수단; 상기 직접 디지털 주파수합성 수단의 출력신호를 입력신호로 하여 소정의 고주파신호를 생성하기 위한 PLL 주파수 합성 수단; 상기 PLL 주파수 합성 수단의 고주파 출력신호를 동위상의 두 개의 신호로 전력분배하기 위한 제 1 전력분배 수단; 상기 제 1 전력분배 수단에 의하여 분배된 신호 중 어느 하나의 신호를 다시 동위상의 두 개의 신호로 전력분배하기 위한 제 2 전력분배 수단; 상기 제 2 전력분배 수단의 출력신호 중 어느 하나의 신호를 시간지연시키기 위한 시간지연 수단; 상기 제 2 전력분배 수단의 출력신호 중 다른 하나의 신호의 위상을 반전시키고, 신호 크기를 조절하기 위한 위상변환 및 가변감쇠 수단; 상기 시간지연 수단의 출력신호와 상기 위상변환 및 가변감쇠 수단의 출력신호를 합성하여, 상기 PLL 주파수 합성 수단의 출력신호에 포함되어 있는 스퓨리어스신호와 위상잡음신호를 추출하기 위한 신호 결합 수단; 및 상기 신호 결합 수단에 의하여 추출된 스퓨리어스신호와 위상잡음신호를 상기 PLL 주파수 합성 수단으로 부궤환(negative feedback)시키기 위한 부궤환 수단 을 포함하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 장치
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제 1 항에 있어서,상기 시간지연 수단의 시간지연은, 상기 신호 결합 수단에 도달되었을 때, 상기 위상변환 및 가변감쇠 수단의 출력신호와 시간차이가 나지 않도록 시간지연시키는 것을 특징으로 하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 장치
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제 1 항에 있어서, 상기 위상변환 및 가변감쇠 수단의 신호 크기 조절은, 상기 신호 결합 수단에 도달되었을 때, 상기 시간지연 수단의 출력신호와 신호크기가 같게 되도록 조절하는 것을 특징으로 하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 장치
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직접디지털주파수합성기(DDS: Direct Digital Synthesizer) 구동 위상잠금루프(PLL: Phase Locked Loop)주파수합성장치에 적용되는 주파수합성 방법에 있어서, 외부의 기준신호에 따라 직접 디지털 주파수합성 방식을 이용하여 소정의 주파수를 갖는 신호(이하, DDS출력신호라 함)를 생성하는 DDS출력신호 생성 단계; 상기 생성된 DDS출력신호를 기준신호로 PLL 주파수합성 방식을 이용하여 소정의 고주파신호(이하, PLL출력신호라 함)를 생성하는 PLL출력신호 생성 단계; 상기 생성된 PLL출력신호를 동위상의 두 개의 신호로 전력분배하는 전력 분배 단계; 상기 전력분배된 신호 중 어느 하나의 신호를 다시 동위상의 두 개의 신호로 전력분배하는 전력 재(再)분배 단계; 상기 전력 재(再)분배된 신호 중 어느 하나의 신호를 시간지연시키는 시간지연 단계; 상기 전력 재(再)분배된 신호 중 다른 하나의 신호의 위상을 반전시키고, 신호 크기를 조절하는 위상/크기 조절 단계; 상기 시간지연된 신호와 상기 위상 반전 및 크기 조절된 신호를 합성하여 상기 PLL출력신호에 포함된 스퓨리어스신호와 위상잡음신호를 추출하는 스퓨리어스신호/위상잡음신호 추출 단계; 및 상기 추출된 스퓨리어스신호와 위상잡음신호를 부궤환(negative feedback)시켜 상기 PLL출력신호 단계에서의 PLL출력신호 생성 과정에서 스퓨리어스신호와 위상잡음신호를 제거하는 스퓨리어스신호/위상잡음신호 제거 단계 를 포함하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 방법
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제 4 항에 있어서,상기 시간지연 단계에서의 시간지연 과정은,상기 위상/크기 조절 단계에서 위상 반전 및 크기 조절된 신호와 시간차이가 나지 않도록 시간지연시키는 것을 특징으로 하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 방법
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제 4 항 또는 제 5 항에 있어서, 상기 위상/크기 조절 단계에서의 신호 크기 조절 과정은, 상기 시간지연 단계에서 시간지연된 신호와 크기가 같게 되도록 조절하는 것을 특징으로 하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 방법
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제 4 항 또는 제 5 항에 있어서, 상기 위상/크기 조절 단계에서의 신호 크기 조절 과정은, 상기 시간지연 단계에서 시간지연된 신호와 크기가 같게 되도록 조절하는 것을 특징으로 하는 스퓨리어스 특성의 개선을 위한 DDS 구동 PLL주파수합성 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.