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재구성 가능한 모뎀 플랫폼 장치

  • 기술번호 : KST2015079734
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 재구성 가능한 모뎀 플랫폼 장치에 관한 것이다. 이 모뎀 플랫폼 장치는 RF 인터페이스 장치와 신호를 주고 받는 적어도 하나 이상의 FPGA 처리부; FPGA 처리부와 신호를 주고받는 적어도 하나 이상의 DSP 처리부; FPGA 처리부와 DSP 처리부 사이 및 DSP 처리부들 사이에서 데이터 버퍼링 역할을 수행하는 적어도 하나 이상의 고속 FIFO 메모리; FPGA 처리부와 DSP 처리부간의 각종 데이터 교환 및 동작 프로그램 다운로드를 제어하는 호스트 CPU 장치; FPGA 처리부, DSP 처리부 및 호스트 CPU 사이를 공통으로 연결하여 확장성을 제공하는 공용 버스 인터페이스; 및 FPGA 처리부와 DSP 처리부 사이에 데이터를 주고받을 수 있는 직렬 인터페이스를 포함한다. 본 발명에 따르면 디지털 통신 시스템에서 하나의 공통된 모뎀 하드웨어 플랫폼을 가지고 소프트웨어적인 다운로드를 통하여 다양한 통신 시스템을 쉽게 구현할 수 있고, 호스트 CPU를 통한 각 모뎀 서브 모듈에 대한 실시간 제어 및 데이터 교환이 용이해지므로 개발 기간이 단축되고, 최적의 성능을 얻을 수 있다. 플랫폼, 모뎀, DSP, FPGA, 재구성, SDR
Int. CL H04L 29/00 (2006.01)
CPC H04L 12/2898(2013.01) H04L 12/2898(2013.01) H04L 12/2898(2013.01)
출원번호/일자 1020030088539 (2003.12.08)
출원인 한국전자통신연구원
등록번호/일자 10-0558659-0000 (2006.03.02)
공개번호/일자 10-2005-0055341 (2005.06.13) 문서열기
공고번호/일자 (20060314) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2003.12.08)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이승환 대한민국 대전광역시유성구
2 이규대 대한민국 대전광역시서구
3 김진업 대한민국 대전광역시서구

대리인

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번호 이름 국적 주소
1 유미특허법인 대한민국 서울특별시 강남구 테헤란로 ***, 서림빌딩 **층 (역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2003.12.08 수리 (Accepted) 1-1-2003-0467570-73
2 선행기술조사의뢰서
Request for Prior Art Search
2005.06.15 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2005.07.15 수리 (Accepted) 9-1-2005-0040423-55
4 의견제출통지서
Notification of reason for refusal
2005.08.23 발송처리완료 (Completion of Transmission) 9-5-2005-0402537-35
5 의견서
Written Opinion
2005.10.18 수리 (Accepted) 1-1-2005-0587954-52
6 명세서등보정서
Amendment to Description, etc.
2005.10.18 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2005-0587955-08
7 등록결정서
Decision to grant
2006.02.23 발송처리완료 (Completion of Transmission) 9-5-2006-0105482-13
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
다양한 아날로그 고주파(RF) 회로와 접속되는 RF 인터페이스 장치로부터 신호를 입력받거나, 상기 RF 인터페이스 장치로 신호를 출력하는 적어도 하나 이상의 FPGA(Field Programmable Gate Array) 처리부;상기 FPGA 처리부와 신호를 주고받는 적어도 하나 이상의 DSP(Digital Signal Processor) 처리부;상기 FPGA 처리부와 상기 DSP 처리부간의 각종 데이터 교환 및 동작 프로그램 다운로드를 제어하는 호스트 CPU 장치; 및상기 FPGA 처리부, 상기 DSP 처리부 및 상기 호스트 CPU 사이를 공통으로 연결하여 확장성을 제공하는 공용 버스 인터페이스를 포함하며,상기 호스트 CPU 장치는 모뎀 하드웨어 초기화 상태 뿐만 아니라 하드웨어 동작 중에도 상기 FPGA 처리부 및 상기 DSP 처리부가 통신 프로토콜 및 통신 알고리즘을 변경할 수 있도록 상기 FPGA 처리부 및 상기 DSP 처리부로 프로그램을 다운로드 하는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
2 2
다양한 아날로그 고주파(RF) 회로와 접속되는 RF 인터페이스 장치; 상기 RF 인터페이스 장치에 접속되는 제1 보드-여기서 제1 보드는, 상기 RF 인터페이스 장치와 신호를 주고 받는 FPGA(Field Programmable Gate Array) 처리부, 상기 FPGA 처리부와 신호를 주고받는 DSP(Digital Signal Processor) 처리부, 및 상기 FPGA 처리부 및 DSP 처리부에 각각 입출력되는 데이터의 버퍼 역할을 수행하는 FIFO 메모리 를 포함함-; 상기 제1 보드에 공용 버스 인터페이스를 통해 각각 접속되는 복수 개의 제2 보드-여기서 복수 개의 제2 보드 각각은, 상기 제1 보드의 FPGA 및 DPS와 각각 상기 공용 버스 인터페이스를 통해 접속되어 신호를 주고받는 적어도 하나 이상의 DSP(Digital Signal Processor) 처리부 및 상기 적어도 하나 이상의 DSP 처리부에 각각 입출력되는 데이터의 버퍼 역할을 수행하는 적어도 하나 이상의 FIFO 메모리 를 포함함-; 및 상기 제1 보드와 상기 복수 개의 제2 보드와 각각 상기 공용 버스 인터페이스를 통해 접속되여, 상기 제1 보드와 상기 복수 개의 제2 보드간의 각종 데이터 교환 및 동작 프로그램 다운로드를 제어하는 호스트 CPU 장치 를 포함하며, 상기 제1 보드에 포함된 FPGA 처리부 및 DSP 처리부와 상기 복수 개의 제2 처리부 각각에 포함된 적어도 하나 이상의 DSP 처리부들 간에는 직렬 인터페이스로 연결되어 있는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
3 3
제1항 또는 제2항에 있어서, 상기 RF 인터페이스 장치, 상기 FPGA 처리부 및 상기 DSP 처리부에 여러 속도의 클럭을 공급하는 디지털 클럭 소스를 더 포함하는 재구성 가능한 모뎀 플랫폼 장치
4 4
제1항 또는 제2항에 있어서, 상기 DSP 처리부 및 상기 FPGA 처리부와 연결되어 데이터 교환이 가능하도록 하는 JTAG(Joint Test Action Group) 인터페이스를 더 포함하는 재구성 가능한 모뎀 플랫폼 장치
5 5
제1항 또는 제2항에 있어서, 상기 호스트 CPU 장치와 사용자 컴퓨터 및 기타 허브를 연결시키는 이더넷 인터페이스를 더 포함하는 재구성 가능한 모뎀 플랫폼 장치
6 6
제1항 또는 제2항에 있어서, 상기 공용 버스 인터페이스 장치로 PCI(Peripheral Component Interconnect) 버스 구조가 사용되는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
7 7
제2항에 있어서, 상기 호스트 CPU 장치는 모뎀 하드웨어 초기화 상태뿐만 아니라 하드웨어 동작 중에도 상기 FPGA 처리부 및 상기 DSP 처리부가 통신 프로토콜 및 통신 알고리즘을 변경하여 수행할 수 있도록 상기 FPGA 처리부 및 상기 DSP 처리부로 프로그램을 다운로드하는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
8 8
제1항에 있어서, 상기 FPGA 처리부 및 상기 DSP 처리부는 보드(board) 형태로 장착되며, 추가 FPGA 및 DSP를 포함하는 보드를 추가로 접속하여 상기 모뎀 플랫폼을 확장시키는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
9 8
제1항에 있어서, 상기 FPGA 처리부 및 상기 DSP 처리부는 보드(board) 형태로 장착되며, 추가 FPGA 및 DSP를 포함하는 보드를 추가로 접속하여 상기 모뎀 플랫폼을 확장시키는 것을 특징으로 하는 재구성 가능한 모뎀 플랫폼 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.