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고속 하다마드 변환 및 고속 푸리에 변환의 선택적 수행장치 및 방법

  • 기술번호 : KST2015079847
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 FHT(fast hadamard transform)와 FFT(fast fourier transform)를 모두 수행할 수 있는 장치가 제공된다. 이 장치에서 FHT가 수행되는 경우에 위상 계수가 항상 1로 설정되며, FFT가 수행되는 경우에 입력 데이터는 입력 순서의 비트가 역순으로 변환되어 입력된다. 또한, 이 장치는 복수 개의 입력 데이터 세트를 동시에 수행할 수 있으며, 이에 따라 다중경로 신호가 분리되어 처리되거나 다중 안테나 신호가 직접 처리될 수 있다. FHT, FFT, 수신, 메모리, 지연, 다중 경로, 다중 안테나
Int. CL H04L 27/38 (2006.01)
CPC
출원번호/일자 1020030098222 (2003.12.27)
출원인 한국전자통신연구원
등록번호/일자 10-0577005-0000 (2006.04.28)
공개번호/일자 10-2005-0067341 (2005.07.01) 문서열기
공고번호/일자 (20060510) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2003.12.27)
심사청구항수 24

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 어익수 대한민국 대전광역시유성구
2 백영석 대한민국 대전광역시유성구
3 김정범 대한민국 대전광역시유성구
4 정희범 대한민국 대전광역시유성구
5 김경수 대한민국 대전광역시서구

대리인

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번호 이름 국적 주소
1 유미특허법인 대한민국 서울특별시 강남구 테헤란로 ***, 서림빌딩 **층 (역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2003.12.27 수리 (Accepted) 1-1-2003-0500524-03
2 의견제출통지서
Notification of reason for refusal		 2005.11.08 발송처리완료 (Completion of Transmission) 9-5-2005-0569008-10
3 명세서등보정서
Amendment to Description, etc.		 2005.12.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2005-0770938-70
4 의견서
Written Opinion		 2005.12.28 수리 (Accepted) 1-1-2005-0770937-24
5 등록결정서
Decision to grant		 2006.04.26 발송처리완료 (Completion of Transmission) 9-5-2006-0237901-60
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
FHT(fast hadamard transform) 및 FFT(fast fourier transform)를 선택적으로 수행하며 적어도 하나의 메모리를 포함하는 장치에 있어서, 상기 메모리의 최종 출력과 입력 데이터를 감산하는 감산기, 상기 감산기의 출력에 위상 계수를 곱하는 곱셈기, 상기 곱셈기의 출력과 상기 입력 데이터를 선택적으로 출력하여 상기 메모리에 저장하는 제1 다중화기, 상기 메모리의 최종 출력과 상기 입력 데이터를 가산하는 가산기, 그리고 상기 가산기의 출력과 상기 메모리의 최종 출력을 선택적으로 출력하는 제2 다중화기를 포함하며, 상기 FHT를 수행하는 경우에 상기 위상 계수는 1로 설정되는 FHT 및 FFT의 선택적 수행 장치
2 2
제1항에 있어서, 상기 FFT를 수행하는 경우에, 원 입력 데이터의 입력 순서에서 입력 순서를 비트의 역순으로 변환하여 상기 입력 데이터를 출력하는 입력 버퍼를 더 포함하는 FHT 및 FFT의 선택적 수행 장치
3 3
제2항에 있어서, 상기 FFT를 수행하는 경우에, 상기 출력 데이터에서 출력 순서를 비트의 역순으로 변환하여 출력하는 출력 버퍼를 더 포함하는 FHT 및 FFT의 선택적 수행 장치
4 4
제2항 또는 제3항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되는 경우에, 상기 적어도 하나의 메모리는 2n-1개의 상기 제1 다중화기의 출력을 순차적으로 저장하며 저장된 데이터를 순차적으로 출력하는 FHT 및 FFT의 선택적 수행 장치
5 5
제2항 또는 제3항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되며 k(k는 1이상의 정수)개 세트의 입력 데이터가 동시에 처리되는 경우에, 상기 적어도 하나의 메모리는 2n-1·k개의 상기 제1 다중화기의 출력을 순차적으로 저장하며 저장된 데이터를 순차적으로 출력하는 FHT 및 FFT의 선택적 수행 장치
6 6
제5항에 있어서, 상기 동시에 처리될 입력 데이터 세트 내에서 각 입력 데이터는 순차적으로 입력되어 상기 메모리에 순차적으로 저장되는 FHT 및 FFT의 선택적 수행 장치
7 7
제5항에 있어서, 제1 선택 신호에 응답하여 상기 제1 다중화기는 상기 입력 데이터를 출력하고 상기 제2 다중화기는 상기 메모리의 최종 출력을 출력하며, 제2 선택 신호에 응답하여 상기 제1 다중화기는 상기 곱셈기의 출력을 출력하고 상기 제2 다중화기는 상기 가산기의 출력을 출력하며, 상기 제1 선택 신호와 상기 제2 선택 신호는 상기 2n-1개의 입력 데이터의 k개 세트 입력에 동기하여 전환되는 FHT 및 FFT의 선택적 수행 장치
8 8
제1항에 있어서, 상기 FFT를 수행하는 경우에 상기 입력 데이터는 원 입력 데이터와 입력 순서가 동일한 FHT 및 FFT의 선택적 수행 장치
9 9
제8항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되는 경우에, 상기 적어도 하나의 메모리는 2N-n개의 상기 제1 다중화기의 출력을 순차적으로 저장하며 저장된 데이터를 순차적으로 출력하는 FHT 및 FFT의 선택적 수행 장치
10 10
제8항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되며 k(k는 1이상의 정수)개 세트의 입력 데이터가 동시에 처리되는 경우에, 상기 적어도 하나의 메모리는 2N-n·k개의 상기 제1 다중화기의 출력을 순차적으로 저장하며 저장된 데이터를 순차적으로 출력하는 FHT 및 FFT의 선택적 수행 장치
11 11
제10항에 있어서, 상기 동시에 처리될 입력 데이터 세트 내에서 각 입력 데이터는 순차적으로 입력되어 상기 메모리에 순차적으로 저장되는 FHT 및 FFT의 선택적 수행 장치
12 12
제10항에 있어서, 제1 선택 신호에 응답하여 상기 제1 다중화기는 상기 입력 데이터를 출력하고 상기 제2 다중화기는 상기 메모리의 최종 출력을 출력하며, 제2 선택 신호에 응답하여 상기 제1 다중화기는 상기 곱셈기의 출력을 출력하고 상기 제2 다중화기는 상기 가산기의 출력을 출력하며, 상기 제1 선택 신호와 상기 제2 선택 신호는 상기 2n-1개의 입력 데이터의 k개 세트 입력에 동기하여 전환되는 FHT 및 FFT의 선택적 수행 장치
13 13
제8항 내지 제12항 중 어느 한 항에 있어서, 상기 출력 데이터에서 출력 순서를 비트의 역순으로 변환하여 출력하는 출력 버퍼를 더 포함하는 FHT 및 FFT의 선택적 수행 장치
14 14
입력 데이터를 수신하여 FHT(fast hadamard transform) 및 FFT(fast fourier transform)를 선택적으로 수행한 출력 데이터를 출력하는 장치에 있어서, 입력 데이터와 상기 입력 데이터가 제1 기간만큼 지연된 데이터를 제1 위상 계수에 따라 FHT(fast hadamard transform) 및 FFT(fast fourier transform) 중 어느 하나의 처리를 하는 제1 변환 처리부, 상기 제1 변환 처리부의 출력과 상기 제1 변환 처리부의 출력이 제2 기간만큼 지연된 데이터를 제2 위상 계수에 따라 FHT 및 FFT 중 어느 하나의 처리를 하여 출력하는 제2 변환 처리부, 그리고 상기 입력 데이터를 수신하여 출력하는 버퍼를 포함하며, 상기 제1 및 제2 위상 계수가 항상 1인 경우에 상기 제1 및 제2 변환 처리부는 상기 FHT 변환 처리를 하며, 상기 제1 및 제2 변환 처리부가 상기 FFT 변환 처리를 하는 경우에, 상기 버퍼는 상기 입력 데이터의 입력 순서에서 입력 순서를 비트의 역순으로 변환하여 상기 제1 변환 처리부로 출력하는 FHT 및 FFT의 선택적 수행 장치
15 15
제14항에 있어서, 상기 제2 기간은 상기 제1 기간의 2배인 FHT 및 FFT의 선택적 수행 장치
16 16
입력 데이터를 수신하여 FHT(fast hadamard transform) 및 FFT(fast fourier transform)를 선택적으로 수행한 출력 데이터를 출력하는 장치에 있어서, 입력 데이터와 상기 입력 데이터가 제1 기간만큼 지연된 데이터를 제1 위상 계수에 따라 FHT(fast hadamard transform) 및 FFT(fast fourier transform) 중 어느 하나의 처리를 하는 제1 변환 처리부, 그리고 상기 제1 변환 처리부의 출력과 상기 제1 변환 처리부의 출력이 제2 기간만큼 지연된 데이터를 제2 위상 계수에 따라 FHT 및 FFT 중 어느 하나의 처리를 하여 출력하는 제2 변환 처리부를 포함하며, 상기 제1 및 제2 위상 계수가 항상 1인 경우에 상기 제1 및 제2 변환 처리부는 상기 FHT 처리를 하며, 상기 FFT 및 FHT 처리에 의해 상기 출력 데이터는 출력 순서가 비트의 역순으로 변환되어 출력되는 FHT 및 FFT의 선택적 수행 장치
17 17
제16항에 있어서, 상기 제1 기간은 상기 제2 기간의 2배인 FHT 및 FFT의 선택적 수행 장치
18 18
제14항 내지 제17항 중 어느 한 항에 있어서, 상기 제1 변환 처리부는 입력되는 데이터를 상기 제1 기간만큼 지연하여 출력하는 제1 지연기, 상기 입력 데이터와 상기 제1 지연기에서 지연된 데이터를 처리하여 상기 제1 지연기로 출력하는 제1 처리기, 그리고 상기 입력 데이터와 상기 제1 지연기에서 지연된 데이터를 처리하여 상기 제2 변환 처리부로 출력하는 제2 처리기를 포함하며, 상기 제2 변환 처리부는 입력되는 데이터를 상기 제2 기간만큼 지연하여 출력하는 제2 지연기, 상기 제1 변환 처리부의 출력 데이터와 상기 제2 지연기에서 지연된 데이터를 처리하여 상기 제2 지연기로 출력하는 제3 처리기, 그리고 상기 제1 변환 처리부의 출력 데이터와 상기 제2 지연기에서 지연된 데이터를 처리하여 출력하는 제4 처리기를 포함하는 FHT 및 FFT의 선택적 수행 장치
19 19
제18항에 있어서, 상기 제1 처리기는 상기 제1 지연기의 출력과 상기 입력 데이터를 감산하는 제1 감산기, 상기 제1 감산기의 출력에 상기 제1 위상 계수를 곱하는 제1 곱셈기, 그리고 상기 제1 곱셈기의 출력과 상기 입력 데이터를 선택적으로 출력하여 상기 제1 지연기로 전달하는 제1 다중화기를 포함하며, 상기 제2 처리기는 상기 제1 지연기의 출력과 상기 입력 데이터를 가산하는 제1 가산기, 그리고 상기 제1 가산기의 출력과 상기 제1 지연기의 출력을 선택적으로 출력하는 제2 다중화기를 포함하며, 상기 제3 처리기는 상기 제2 지연기의 출력과 상기 제1 변환 처리부의 출력 데이터를 감산하는 제2 감산기, 상기 제2 감산기의 출력에 상기 제2 위상 계수를 곱하는 제2 곱셈기, 그리고 상기 제2 곱셈기의 출력과 상기 제1 변환 처리부의 출력 데이터를 선택적으로 출력하여 상기 제2 지연기로 전달하는 제2 다중화기를 포함하며, 상기 제4 처리기는 상기 제2 지연기의 출력과 상기 제1 변환 처리부의 출력 데이터를 가산하는 제2 가산기, 그리고 상기 제2 가산기의 출력과 상기 제2 지연기의 출력을 선택적으로 출력하는 제4 다중화기를 포함하는 FHT 및 FFT의 선택적 수행 장치
20 20
제14항 내지 제17항 중 어느 한 항에 있어서, 상기 제2 변환 처리부의 출력과 상기 제2 변환 처리부의 출력이 제3 기간만큼 지연된 데이터를 제3 위상 계수에 따라 FHT 및 FFT 중 어느 하나의 처리를 하여 출력하는 제3 변환 처리부를 더 포함하며, 상기 제3 위상 계수가 항상 1인 경우에 상기 제3 변환 처리부는 상기 FHT 변환 처리를 하는 FHT 및 FFT의 선택적 수행 장치
21 21
입력 데이터를 수신하는 단계, 지연 처리된 데이터로부터 상기 입력 데이터를 감산하는 단계, 상기 감산된 데이터에 위상 계수를 곱하는 단계, 상기 입력 데이터와 상기 곱셈된 데이터 중 하나를 선택하는 단계, 미리 결정된 기간 동안 상기 선택된 데이터를 일정 기간만큼 지연하여 상기 지연 처리된 데이터를 제공하는 단계, 상기 지연 처리된 데이터와 상기 입력 데이터를 가산하는 단계, 그리고 상기 지연 처리된 데이터와 상기 가산된 데이터 중 하나를 선택하여 출력 데이터로서 출력하는 단계를 포함하며, FHT(fast hadamard transform)가 수행되는 경우에는 상기 위상 계수가 항상 1로 설정되며, FFT(fast fourier transform)이 수행되는 경우에는 상기 위상 계수는 FFT의 변환 차수에 따른 계수로 설정되는 FHT 및 FFT의 선택적 수행 방법
22 22
제21항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되며 k(k는 1이상의 정수)개 세트의 입력 데이터가 동시에 처리되는 경우에, 상기 지연되는 길이는 상기 2n-1개의 입력 데이터의 k개 세트에 대응하는 길인 FHT 및 FFT의 선택적 수행 방법
23 23
제22항에 있어서, 상기 FFT가 수행되는 경우에, 상기 입력 데이터의 순서를 비트의 역순으로 변환하는 단계를 더 포함하는 FHT 및 FFT의 선택적 수행 방법
24 24
제21항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되며 k(k는 1이상의 정수)개 세트의 입력 데이터가 동시에 처리되는 경우에, 상기 지연되는 길이는 상기 2N-n개의 입력 데이터의 k개 세트에 대응하는 길인 FHT 및 FFT의 선택적 수행 방법
25 24
제21항에 있어서, 2N차 변환 중 2n(n은 1이상 N이하의 정수)차 변환이 수행되며 k(k는 1이상의 정수)개 세트의 입력 데이터가 동시에 처리되는 경우에, 상기 지연되는 길이는 상기 2N-n개의 입력 데이터의 k개 세트에 대응하는 길인 FHT 및 FFT의 선택적 수행 방법
지정국 정보가 없습니다
순번, 패밀리번호, 국가코드, 국가명, 종류의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 패밀리정보 - 패밀리정보 표입니다.
순번 패밀리번호 국가코드 국가명 종류
1 US07428563 US 미국 FAMILY
2 US20050144209 US 미국 FAMILY

DOCDB 패밀리 정보

순번, 패밀리번호, 국가코드, 국가명, 종류의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 패밀리정보 - DOCDB 패밀리 정보 표입니다.
순번 패밀리번호 국가코드 국가명 종류
1 US2005144209 US 미국 DOCDBFAMILY
2 US7428563 US 미국 DOCDBFAMILY
국가 R&D 정보가 없습니다.