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통신 시스템의 신호 처리 장치 및 그의 신호 처리 방법

  • 기술번호 : KST2015083492
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 통신 시스템의 신호 처리 장치에서는 인코딩될 입력 신호를 인코딩하여 정보 비트와 제1 및 제2 패리티 비트로 분리한 후에 정보 비트와 제1 및 제2 패리티 비트를 각각 레이트 매칭하고 레이트 매칭 결과 비트를 순차적으로 출력한다. 그런 후에, 신호 처리 장치는 레이트 매칭이 수행되는 동안 순차적으로 출력되는 레이트 매칭 결과 비트를 비트 스트림으로 취합한다. 이와 같이, 레이트 매칭을 수행하는 기간과 비트 스트림을 취합하는 기간을 중첩시킴으로써, 처리 지연 시간을 줄일 수 있다. 터보 인코더, 레이트 매칭, 비트 취합, 블록 인터리빙
Int. CL H04L 29/02 (2006.01) H03M 13/27 (2006.01)
CPC H04L 1/0013(2013.01) H04L 1/0013(2013.01) H04L 1/0013(2013.01)
출원번호/일자 1020070126290 (2007.12.06)
출원인 한국전자통신연구원, 삼성전자주식회사
등록번호/일자
공개번호/일자 10-2009-0059430 (2009.06.11) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항 심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.12.06)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 삼성전자주식회사 대한민국 경기도 수원시 영통구

발명자

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번호 이름 국적 주소
1 김 찬 대한민국 대전광역시 유성구
2 김영섭 대한민국 대전광역시 유성구
3 정희상 대한민국 대전광역시 유성구
4 박형준 대한민국 대전광역시 유성구
5 방승찬 대한민국 대전광역시 서구

대리인

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번호 이름 국적 주소
1 유미특허법인 대한민국 서울특별시 강남구 테헤란로 ***, 서림빌딩 **층 (역삼동)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2007.12.06 수리 (Accepted) 1-1-2007-0879473-98
2 선행기술조사의뢰서
Request for Prior Art Search		 2008.11.06 수리 (Accepted) 9-1-9999-9999999-89
3 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status		 2009.02.03 수리 (Accepted) 1-1-2009-0065501-33
4 선행기술조사보고서
Report of Prior Art Search		 2009.02.06 수리 (Accepted) 9-1-2009-0006733-55
5 의견제출통지서
Notification of reason for refusal		 2009.03.31 발송처리완료 (Completion of Transmission) 9-5-2009-0139357-69
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.06.01 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0330857-10
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.06.01 수리 (Accepted) 1-1-2009-0330856-75
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 거절결정서
Decision to Refuse a Patent		 2009.10.07 발송처리완료 (Completion of Transmission) 9-5-2009-0416071-82
10 명세서 등 보정서(심사전치)
Amendment to Description, etc(Reexamination)		 2009.12.09 보정승인 (Acceptance of amendment) 7-1-2009-0062472-77
11 심사전치출원의 심사결과통지서
Notice of Result of Reexamination		 2010.01.13 발송처리완료 (Completion of Transmission) 9-5-2010-0016622-82
12 보정각하결정서
Decision of Rejection for Amendment		 2010.01.13 발송처리완료 (Completion of Transmission) 9-5-2010-0016621-36
13 심사관의견요청서
Request for Opinion of Examiner		 2010.02.22 수리 (Accepted) 7-8-2010-0005172-36
14 의견제출통지서
Notification of reason for refusal		 2010.11.22 발송처리완료 (Completion of Transmission) 9-5-2010-0527743-49
15 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2011.01.24 수리 (Accepted) 1-1-2011-0057276-70
16 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2011.02.22 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2011-0128094-11
17 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2011.02.22 수리 (Accepted) 1-1-2011-0128093-65
18 의견제출통지서
Notification of reason for refusal		 2011.08.10 발송처리완료 (Completion of Transmission) 9-5-2011-0448865-69
19 거절결정서
Decision to Refuse a Patent		 2012.01.31 발송처리완료 (Completion of Transmission) 9-5-2012-0061468-60
20 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.21 수리 (Accepted) 4-1-2012-5132663-40
21 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
입력 신호를 처리하는 방법에 있어서, 상기 입력 신호를 인코딩하여 정보 비트와 제1 및 제2 패리티 비트로 분리하는 단계, 상기 정보 비트와 상기 제1 및 제2 패리티 비트를 각각 레이트 매칭하는 단계, 상기 레이트 매칭에 따라 레이트 매칭 결과 비트를 순차적으로 출력하는 단계, 그리고 상기 레이트 매칭이 수행되는 동안 상기 순차적으로 출력되는 레이트 매칭 결과 비트를 비트 스트림으로 취합하는 단계 를 포함하는 신호 처리 방법
2 2
제1항에 있어서, 상기 비트 스트림을 블록 인터리빙하는 단계 를 더 포함하며, 상기 레이트 매칭 결과 비트가 모두 취합되기 전에 상기 블록 인터리빙을 시작하는 신호 처리 방법
3 3
제2항에 있어서, 상기 레이트 매칭 결과 비트는, 상기 정보 비트가 상기 레이트 매칭된 제1 결과 비트, 상기 제1 및 제2 패리티 비트가 각각 상기 레이트 매칭된 제2 및 제3 결과 비트를 포함하며, 상기 출력하는 단계는, 상기 제1 내지 제3 결과 비트를 각각 한 비트씩 순차적으로 출력하는 단계를 포함하는 신호 처리 방법
4 4
제3항에 있어서, 상기 레이트 매칭하는 단계는, 상기 정보 비트와 상기 제1 및 제2 패리티 비트의 각 비트의 총합에 따라 비트 천공하는 단계를 포함하며, 상기 블록 인터리빙하는 단계는, 하나의 물리 채널에서 전송할 수 있는 비트 수, 상기 제1 내지 제3 결과 비트의 수 중 가장 적은 비트 수에 기초하여 설정된 시점에서 상기 블록 인터리빙을 시작하는 단계를 포함하는 신호 처리 방법
5 5
제4항에 있어서, 상기 비트 스트림에 상기 블록 인터리빙의 크기에 해당하는 비트가 취합된 시점을 추가로 고려하여 상기 블록 인터리빙을 시작하는 신호 처리 방법
6 6
제2항 또는 제3항에 있어서, 상기 레이트 매칭하는 단계는, 상기 정보 비트와 상기 제1 및 제2 패리티 비트의 각 비트의 총 합에 따라 비트 반복하는 단계를 포함하며, 상기 블록 인터리빙하는 단계는, 상기 비트 스트림에 상기 블록 인터리빙의 크기에 해당하는 비트가 취합된 시점에서 상기 블록 인터리빙을 시작하는 단계를 포함하는 신호 처리 방법
7 7
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 분리하는 단계는, 상기 입력 신호를 복수의 코드 블록으로 나누는 단계, 상기 복수의 코드 블록의 비트를 순차적으로 제1 및 제2 코드 블록 버퍼에 교대로 저장하는 단계, 그리고 상기 제1 및 제2 코드 블록 버퍼에 저장된 비트를 교대로 인코딩하여 상기 정보 비트, 상기 제1 및 제2 패리티 비트를 출력하는 단계를 포함하며, 상기 제1 및 제2 코드 블록 버퍼 중 하나의 코드 블록 버퍼에 비트를 인코딩하는 동안 다른 하나의 코드 블록 버퍼에 다음 코드 블록의 비트를 저장하는 신호 처리 방법
8 8
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 레이트 매칭 결과 비트가 모두 출력되는 시점과 상기 레이트 매칭 결과 비트가 모두 취합되는 시점이 동일한 신호 처리 방법
9 9
입력 신호를 처리하는 장치에 있어서, 상기 입력 신호를 인코딩하여 정보 비트, 제1 및 제2 패리티 비트를 출력하는 인코더, 그리고 상기 정보 비트, 제1 및 제2 패리티 비트를 각각 레이트 매칭하면서 상기 정보 비트, 제1 및 제2 패리티 비트의 레이트 매칭 결과 비트를 비트 스트림으로 취합하는 레이트 매칭기 를 포함하는 신호 처리 장치
10 10
제9항에 있어서, 상기 비트 스트림을 블록 인터리빙하는 블록 인터리버 를 더 포함하며, 상기 취합하는 기간과 상기 블록 인터리빙하는 기간이 중첩되는 신호 처리 장치
11 11
제9항에 있어서, 상기 레이트 매칭 결과 비트는, 상기 정보 비트가 상기 레이트 매칭된 제1 결과 비트, 상기 제1 및 제2 패리티 비트가 각각 상기 레이트 매칭된 제2 및 제3 결과 비트를 포함하며, 상기 레이트 매칭기는, 상기 제1 내지 제3 결과 비트의 주소를 각각 기록하는 제1 내지 제3 메모리를 포함하며, 상기 제1 내지 제3 결과 비트가 발생되는 순서에 따라 대응하는 상기 제1 내지 제3 메모리에 기록하는 신호 처리 장치
12 12
제11항에 있어서, 상기 레이트 매칭기는 상기 레이트 매칭으로 비트 반복을 수행하며, 상기 블록 인터리버는 상기 비트 스트림에 상기 블록 인터리버의 블록 크기에 해당하는 비트가 모인 시점에서 상기 블록 인터리빙을 시작하는 신호 처리 장치
13 13
제11항에 있어서, 상기 레이트 매칭기는 상기 레이트 매칭으로 비트 천공을 수행하며, 상기 블록 인터리버는 상기 비트 스트림에 상기 블록 인터리버의 크기에 해당하는 비트가 모이고, 상기 취합된 비트의 양이 소정의 설정 값이 되는 조건을 동시에 만족하는 시점에서 상기 블록 인터리빙을 시작하며, 상기 설정 값은 하나의 물리 채널에서 전송할 수 있는 비트 수, 상기 제1 내지 제3 결과 비트의 수 중 가장 적은 비트 수에 기초하여 설정된 값인 신호 처리 장치
14 14
제9항 내지 제13항 중 어느 한 항에 있어서, 홀수 코드 블록 버퍼와 짝수 코드 블록 버퍼를 포함하며, 인코딩될 복수의 코드 블록의 비트를 순차적으로 상기 홀수 코드 블록 버퍼와 상기 짝수 코드 블록 버퍼에 교대로 저장하는 코드 블록 제어부 를 더 포함하며, 상기 인코더에서 상기 홀수 코드 블록 버퍼 및 상기 홀수 코드 블록 버퍼 중 하나의 코드 블록 버퍼에 저장된 비트를 인코딩하는 동안, 상기 코드 블록 제어부는 나머지 코드 블록 버퍼에 상기 비트를 저장하는 신호 처리 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 정보통신부 및 정보통신연구진흥원 한국전자통신연구원 IT성장동력기술개발 3G Evolution 무선 전송 기술개발