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순차 접근 아날로그-디지털 변환기

  • 기술번호 : KST2015084514
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 순차 접근 아날로그 디지털 변환기는 비트 수효에 대응하는 비트 커패시터열 및 보정 커패시터열을 포함하는 제1 변환부, 상기 변환부의 출력 전압에 따라 각 커패시터에 대응하는 하이 또는 로우 전압을 출력하는 비교기, 상기 비교기의 하이 또는 로우 출력 중 상기 보정 커패시터의 출력에 따라 상기 비트 커패시터의 출력을 보정하는 보정부를 포함한다. 따라서, LSB와 동일한 크기의 커패시턴스를 가지는 두 개의 비트를 두어 디지털 출력 에러가 발생하였을 경우 이를 보정할 수 있도록 하여 신호 변환기의 동적 동작 영역을 증가시키고, 출력된 신호의 잡음비를 개선된다. 순차 접근 아날로그-디지털 변환, 에러 보정
Int. CL H03M 1/12 (2006.01) H03M 1/66 (2006.01)
CPC
출원번호/일자 1020080115053 (2008.11.19)
출원인 한국전자통신연구원
등록번호/일자 10-1182402-0000 (2012.09.06)
공개번호/일자 10-2010-0056076 (2010.05.27) 문서열기
공고번호/일자 (20120913) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.11.19)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 조영균 대한민국 대전광역시 서구
2 전영득 대한민국 대전광역시 중구
3 남재원 대한민국 대전광역시 유성구
4 권종기 대한민국 대전광역시 서구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 (주)엘센 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2008.11.19 수리 (Accepted) 1-1-2008-0796861-65
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
3 의견제출통지서
Notification of reason for refusal		 2012.01.06 발송처리완료 (Completion of Transmission) 9-5-2012-0011729-76
4 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2012.03.06 수리 (Accepted) 1-1-2012-0180964-61
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2012.03.06 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-0180983-28
6 등록결정서
Decision to grant		 2012.08.25 발송처리완료 (Completion of Transmission) 9-5-2012-0496324-85
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
아날로그 전압을 순차 접근 동작에 따라 소정 수효의 비트를 가지는 디지털 신호로 변환하는 순차 접근 아날로그 디지털 변환기에 있어서,비트 수효에 대응하는 비트 커패시터열 및 보정 커패시터열을 포함하는 변환부, 상기 변환부의 출력 전압에 따라 각 커패시터에 대응하는 하이 또는 로우 전압을 출력하는 비교기, 그리고 상기 비교기의 하이 또는 로우 전압에 대응하는 디지털 신호 중 상기 보정 커패시터열에 대한 상기 디지털 신호에 따라 상기 비트 커패시터열에 대한 상기 디지털 신호을 보정하는 보정부를 포함하고,보정 커패시터열은 상기 비교기의 입력단과 제1 또는 제2 기준 전압 사이에 형성되는 제1 보정 커패시터 및 제2 보정 커패시터를 포함하는, 순차 접근 아날로그 디지털 변환기
2 2
삭제
3 3
제1항에 있어서,상기 보정 커패시터열은 상기 비트 커패시터열의 순차 접근 동작이 종료 후 순차 접근 동작을 수행하는순차 접근 아날로그 디지털 변환기
4 4
제3항에 있어서,상기 제1 보정 커패시터는 상기 비트 커패시터열의 LSB에 대응하는 커패시터와 같은 값을 연산하는 순차 접근 아날로그 디지털 변환기
5 5
제4항에 있어서,상기 제1 및 제2 보정 커패시터는 LSB에 대응하는 상기 비트 커패시터열의 상기 커패시터와 동일한 커패시턴스를 가지는순차 접근 아날로그 디지털 변환기
6 6
제5항에 있어서,상기 순차 접근 아날로그 디지털 변환기는상기 비교기의 오프셋을 보상하는 오프셋 보상 커패시터를 더 포함하는 순차 접근 아날로그 디지털 변환기
7 7
제5항에 있어서,상기 보정부는 상기 제1 및 제2 보정 커패시터의 디지털 신호가 11인 경우, 상기 비트 커패시터열의 디지털 신호에 1을 더하고, 상기 제1 및 제2 보정 커패시터의 디지털 신호가 10 또는 01인 경우 상기 비트 커패시터열의 디지털 신호를 그대로 출력하고, 상기 제1 및 제2 보성 커패시터의 디지털 신호가 00인 경우 상기 비트 커패시터열의 디지털 신호에서 1을 빼는순차 접근 아날로그 디지털 변환기
8 8
각 비트에 대응하는 비트 커패시터열과 제1 및 제2 보정 커패시터를 포함하는 순차 접근 아날로그 디지털 변환기의 구동 방법에 있어서,상기 비트 커패시터열에 입력 아날로그 전압을 샘플링하는 단계,MSB에 대응하는 비트 커패시터부터 LSB에 대응하는 비트 커패시터까지 순차 접근 동작을 수행하여 1 또는 0의 디지털 값을 결정하는 단계,순차 접근 동작으로 상기 제1 및 제2 보정 커패시터의 1 또는 0의 디지털 값을 결정하는 단계, 그리고상기 제1 및 제2 보정 커패시터의 디지털 값에 따라 상기 비트 커패시터의 디지털 값을 보정하는 단계를 포함하고,상기 샘플링하는 단계에서 제1 및 제2 보정 커패시터의 타단을 제1 및 제2 기준 전압에 각각 연결하는 순차 접근 아날로그 디지털 변환기의 구동 방법
9 9
삭제
10 10
제8항에 있어서,순차 접근 동작은 해당 커패시터의 타단을 제1 기준 전압에 연결하고 나머지 커패시터를 제2 기준 전압에 연결하는순차 접근 아날로그 디지털 변환기의 구동 방법
11 11
제10항에 있어서,상기 비트 커패시터의 디지털 값을 보정하는 단계는,상기 제1 및 제2 보정 커패시터의 디지털 값이 11인 경우, 상기 비트 커패시터의 디지털 값에 1을 더하고, 상기 제1 및 제2 보정 커패시터의 디지털 값이 10 또는 01인 경우 상기 비트 커패시터의 디지털 값을 그대로 출력하고, 상기 제1 및 제2 보성 커패시터의 디지털 값이 00인 경우 상기 비트 커패시터의 디지털 값에서 1을 빼는순차 접근 아날로그 디지털 변환기의 구동 방법
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순번 패밀리번호 국가코드 국가명 종류
1 US07893860 US 미국 FAMILY
2 US20100123611 US 미국 FAMILY

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순번 패밀리번호 국가코드 국가명 종류
1 US2010123611 US 미국 DOCDBFAMILY
2 US7893860 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 및 정보통신연구진흥원 한국전자통신연구원 IT성장동력기술개발 45nm급 혼성 SoC용 아날로그 회로