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레벨 시프트 회로

  • 기술번호 : KST2015086869
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 레벨 시프트 회로에 관한 것으로서, 특히 게이트 전압을 제어하여 단락 회로 전류를 감소시키는 레벨 시프트 회로에 관한 것이다. 본 발명에 따른 레벨 시프트 회로는 소스 및 드레인이 각각 출력단 및 전원단과 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단과 연결되고, 게이트가 입력단과 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부로 구성된다. 본 발명은 트랜지스터 크기를 증가시킬 필요없이 게이트 전압 제어부를 통해 단락 회로 전류를 감소시킴으로써, 저전력 동작이 가능하고 작은 면적을 차지하는 레벨 시프트 회로를 제공할 수 있다. 레벨 시프트, 단일형 트랜지스터, 부트스트랩, 디스플레이 장치 구동 회로
Int. CL H03K 19/0185 (2006.01.01) H03K 3/356 (2006.01.01) H03K 19/00 (2006.01.01)
CPC H03K 19/018521(2013.01) H03K 19/018521(2013.01) H03K 19/018521(2013.01)
출원번호/일자 1020080015768 (2008.02.21)
출원인 한국전자통신연구원, 한양대학교 산학협력단
등록번호/일자 10-0943708-0000 (2010.02.16)
공개번호/일자 10-2009-0090512 (2009.08.26) 문서열기
공고번호/일자 (20100223) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.02.21)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 변춘원 대한민국 대전 유성구
2 황치선 대한민국 대전 유성구
3 박상희 대한민국 대전 유성구
4 권오경 대한민국 서울 성동구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2008.02.21 수리 (Accepted) 1-1-2008-0129642-17
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2008.03.11 수리 (Accepted) 4-1-2008-5037763-28
3 선행기술조사의뢰서
Request for Prior Art Search		 2008.11.06 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2008.12.08 수리 (Accepted) 9-1-2008-0081338-81
5 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
6 의견제출통지서
Notification of reason for refusal		 2009.10.29 발송처리완료 (Completion of Transmission) 9-5-2009-0446116-96
7 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2009.12.29 수리 (Accepted) 1-1-2009-0810709-08
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2010.01.25 수리 (Accepted) 1-1-2010-0049011-11
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2010.01.25 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2010-0049845-72
10 등록결정서
Decision to grant		 2010.02.12 발송처리완료 (Completion of Transmission) 9-5-2010-0061574-22
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.06.05 수리 (Accepted) 4-1-2014-5068294-39
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.16 수리 (Accepted) 4-1-2015-5022074-70
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.05 수리 (Accepted) 4-1-2019-5155816-75
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.06 수리 (Accepted) 4-1-2019-5156285-09
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번호 청구항
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2 2
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삭제
4 4
소스 및 드레인이 각각 출력단 및 전원단에 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단에 연결되고, 게이트가 입력단에 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부를 포함하고, 상기 게이트 전압 제어부는, 드레인 및 게이트가 상기 입력단에 연결되고, 소스가 상기 제 1 트랜지스터의 게이트에 연결되는 제 3 트랜지스터; 및 드레인 및 게이트가 상기 제 1 트랜지스터의 게이트에 연결되고, 소스가 상기 출력단에 연결되는 제 4 트랜지스터 를 포함하는 레벨 시프트 회로
5 5
소스 및 드레인이 각각 출력단 및 전원단에 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단에 연결되고, 게이트가 입력단에 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부를 포함하고, 상기 게이트 전압 제어부는, 드레인 및 게이트가 상기 입력단에 연결되고, 소스가 상기 제 1 트랜지스터의 게이트에 연결되는 제 3 트랜지스터; 드레인 및 게이트가 상기 제 1 트랜지스터의 게이트에 연결되는 제 4 트랜지스터; 및 드레인이 상기 제 4 트랜지스터의 소스에 연결되고, 소스가 상기 접지단에 연결되고, 게이트가 상기 입력단과 연결되는 제 5 트랜지스터 를 포함하는 레벨 시프트 회로
6 6
소스 및 드레인이 각각 출력단 및 전원단에 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단에 연결되고, 게이트가 입력단에 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부를 포함하고, 상기 게이트 전압 제어부는, 드레인 및 게이트가 상기 입력단에 연결되는 제 3 트랜지스터; 드레인 및 게이트가 상기 제 3 트랜지스터의 소스에 연결되고, 소스가 상기 제 1 트랜지스터의 게이트에 연결되는 제 4 트랜지스터; 및 드레인 및 게이트가 상기 제 1 트랜지스터의 게이트에 연결되고, 소스가 상기 출력단에 연결되는 제 5 트랜지스터 를 포함하는 레벨 시프트 회로
7 7
소스 및 드레인이 각각 출력단 및 전원단에 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단에 연결되고, 게이트가 입력단에 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부를 포함하고, 상기 게이트 전압 제어부는, 드레인 및 게이트가 상기 입력단에 연결되고, 소스가 상기 제 1 트랜지스터의 게이트에 연결되는 제 3 트랜지스터; 드레인 및 게이트가 상기 제 1 트랜지스터의 게이트에 연결되는 제 4 트랜지스터; 및 드레인 및 게이트가 상기 제 4 트랜지스터의 소스에 연결되고, 소스가 상기 출력단에 연결되는 제 5 트랜지스터 를 포함하는 레벨 시프트 회로
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소스 및 드레인이 각각 출력단 및 전원단에 연결되는 제 1 트랜지스터; 상기 제 1 트랜지스터의 게이트 및 상기 출력단 사이에 위치하는 커패시터; 소스 및 드레인이 각각 접지단 및 상기 출력단에 연결되고, 게이트가 입력단에 연결되는 제 2 트랜지스터; 및 상기 입력단 및 상기 제 1 트랜지스터의 게이트와 연결되고, 상기 제 1 트랜지스터의 게이트에 인가되는 전압을 제어하는 게이트 전압 제어부를 포함하고, 상기 출력단으로 출력되는 출력신호는 상기 입력단으로 입력되는 입력신호와 반대의 위상을 갖는 레벨 시프트 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
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1 정보통신부 및 정보통신연구진흥원 한국전자통신연구원 IT원천기술개발 투명전자 소자를 이용한 스마트 창