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이중 명령어 페치 장치 및 방법

  • 기술번호 : KST2015087109
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 프로세서 코어에서 명령어를 메모리로부터 읽어올 때 이중(dual)의 가변적인 명령어 페치 구조를 프로세서 코어내에 구현하여 어플리케이션 특성에 따라 파이프라인 심도(depth)를 조절할 수 있는 이중 명령어 페치 장치 및 방법을 제시한다. 제시된 본 발명은 일반 모드에서는 PC(프로그램 카운터), BTB(분기 타겟 버퍼), BP(분기 예측기), IQ(명령어 큐)(Instruction Queue)의 4단계의 파이프라인을 통하여 명령어를 페치하고, 라인 모드에서는 PC(프로그램 카운터) 및 라인(Line)의 2단계의 파이프라인을 통하여 명령어를 페치한다.
Int. CL G06F 9/30 (2018.01.01) G06F 9/38 (2006.01.01)
CPC
출원번호/일자 1020130054239 (2013.05.14)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2014-0134421 (2014.11.24) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.09.05)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 권영수 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 한양특허법인 대한민국 서울특별시 강남구 논현로**길 **, 한양빌딩 (도곡동)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.05.14 수리 (Accepted) 1-1-2013-0423910-29
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2017.09.05 수리 (Accepted) 1-1-2017-0860858-74
4 선행기술조사의뢰서
Request for Prior Art Search
2017.11.13 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2018.01.09 수리 (Accepted) 9-1-2018-0000918-76
6 의견제출통지서
Notification of reason for refusal
2018.08.20 발송처리완료 (Completion of Transmission) 9-5-2018-0562952-37
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.09.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0953512-86
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.09.27 수리 (Accepted) 1-1-2018-0953511-30
9 거절결정서
Decision to Refuse a Patent
2019.01.31 발송처리완료 (Completion of Transmission) 9-5-2019-0077759-12
10 [법정기간연장]기간연장(단축, 경과구제)신청서
2019.03.04 무효 (Invalidation) 1-1-2019-0221665-73
11 보정요구서
Request for Amendment
2019.03.12 발송처리완료 (Completion of Transmission) 1-5-2019-0041391-84
12 무효처분통지서
Notice for Disposition of Invalidation
2019.04.04 발송처리완료 (Completion of Transmission) 1-5-2019-0057827-18
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번호 청구항
1 1
일반 모드 또는 라인 모드로 설정되는 모드 레지스터;분기 예측 유닛;상기 모드 레지스터에 설정된 모드의 종류를 근거로, 상기 분기 예측 유닛의 출력을 바탕으로 명령어의 어드레스 인덱스를 저장하고 있는 태그 및 상기 명령어가 그룹핑된 라인을 억세스하여 명령어를 출력시키거나, 상기 라인만을 억세스하여 명령어를 출력시키는 프로그램 카운터 연산기;상기 라인에 그룹핑된 명령어에서 명령어 선택기에 의해 선택된 명령어를 저장하는 명령어 큐; 및상기 일반 모드가 설정되면 상기 명령어 큐에 저장된 명령어를 페치하고, 상기 라인 모드가 설정되면 상기 명령어 캐시의 라인에서 읽은 명령어를 페치하는 페치 선택기;를 포함하는 것을 특징으로 하는 이중 명령어 페치 장치
2 2
청구항 1에 있어서,상기 모드 레지스터가 상기 일반 모드로 설정되면,상기 프로그램 카운터 연산기는 상기 분기 예측 유닛의 출력을 근거로 상기 명령어 캐시의 태그 및 라인을 억세스하여 명령어를 출력시키는 것을 특징으로 하는 이중 명령어 페치 장치
3 3
청구항 1에 있어서,상기 모드 레지스터가 상기 라인 모드로 설정되면,상기 프로그램 카운터 연산기는 상기 분기 예측 유닛 및 상기 명령어 캐시의 태그를 제외하고 상기 명령어 캐시의 라인을 바로 억세스하여 명령어를 출력시키는 것을 특징으로 하는 이중 명령어 페치 장치
4 4
청구항 1에 있어서,상기 페치 선택기는 상기 일반 모드가 설정됨에 따라 상기 명령어 큐에 저장된 명령어중에서 가장 먼저 저장된 명령어를 페치하는 것을 특징으로 하는 이중 명령어 페치 장치
5 5
청구항 1에 있어서,상기 페치 선택기는 상기 라인 모드가 설정됨에 따라 상기 명령어 캐시의 라인에서 읽은 명령어중에서 첫번째 명령어를 페치하는 것을 특징으로 하는 이중 명령어 페치 장치
6 6
청구항 1에 있어서,상기 일반 모드에서는, 첫번째 클럭 사이클에서 상기 분기 예측 유닛의 분기 타겟 버퍼 및 상기 명령어 캐시의 태그가 억세스되고, 두번째 클럭 사이클에서 상기 분기 예측 유닛의 분기 예측기 및 상기 명령어 캐시의 라인이 억세스되고, 세번째 클럭 사이클에서 상기 분기 예측 유닛이 분기 발생 여부를 결정하고 상기 명령어 선택기에 의해 선택된 명령어가 상기 명령어 큐에 저장되고, 네번째 클럭 사이클에서 상기 명령어 큐에 저장된 명령어가 상기 페치 선택기를 통해 출력되는 것을 특징으로 하는 이중 명령어 페치 장치
7 7
청구항 1에 있어서,상기 라인 모드에서는, 첫번째 클럭 사이클에서 상기 프로그램 카운터 연산기의 출력을 근거로 상기 명령어 캐시의 라인이 억세스되고, 두번째 클럭 사이클에서 상기 명령어 캐시의 라인이 출력한 명령어중에서 첫번째 명령어가 상기 페치 선택기를 통해 출력되는 것을 특징으로 하는 이중 명령어 페치 장치
8 8
청구항 1에 있어서,상기 라인 모드는 프로세서 코어가 실행하는 어플리케이션 명령어의 용량이 작거나 분기 명령어의 빈도가 적은 어플리케이션일 때 설정되는 것을 특징으로 하는 이중 명령어 페치 장치
9 9
청구항 1에 있어서,상기 명령어 선택기는 상기 명령어 캐시의 라인에 그룹핑된 명령어를 각각 디코딩하여 첫번째 명령어부터 분기 명령어 이전까지의 명령어를 선택하고,상기 명령어 큐는 상기 명령어 선택기에 의해 선택된 명령어를 저장하는 것을 특징으로 하는 이중 명령어 페치 장치
10 10
청구항 1에 있어서,상기 이중 명령어 페치 장치는 파이프라인 구조를 갖는 프로세서 코어에 내장되는 것을 특징으로 하는 이중 명령어 페치 장치
11 11
프로세서 코어에서, 일반 모드 및 라인 모드중에서 어느 한 모드로의 설정이 행해지고, 상기 일반 모드에서는 프로그램 카운터 연산기, 분기 예측 유닛, 및 명령어 큐를 통하여 명령어를 페치하고, 상기 라인 모드에서는 상기 프로그램 카운터 연산기 및 명령어 캐시의 라인을 통하여 명령어를 페치하는 것을 특징으로 하는 이중 명령어 페치 방법
지정국 정보가 없습니다
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순번 패밀리번호 국가코드 국가명 종류
1 US20140344551 US 미국 FAMILY

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순번 패밀리번호 국가코드 국가명 종류
1 US2014344551 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 전자부품연구원 산업융합원천기술개발사업(정보통신) 멀티 Shader GPU 통합형 멀티 코어 퓨전(Fusion) 프로세서 기술 개발