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칩선택단자쌍을구비한반도체장치

  • 기술번호 : KST2015088605
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 반도체장치에 있어서 칩선택단자에 관한 것이다. 칩선택회로를 구비하고 각각의 소정의 확장어드레스가 할당된 복수의 반도체소자칩들로 구성되는 다중칩모듈 반도체 장치에 있어서, 상기 반도체소자칩들의 외부에 별도로 부가적인 칩선택제어회로를 구성하지 않으면서 상기 확장 어드레스의 논리조합에 대응하는 단일 반도체 소자칩이 선택되도록 하기 위해 복수의 칩선택단자쌍들을 구비한 디코딩 로직회로(40)를 상기 반도체소자칩들의 내부에 구성한다.디코딩로직회로(40)는 선택되는 상기 반도체소자칩들의 수화 동일한 내부논리회로(30)들을 포함한다.또한, 디코딩로직회로(40)는 모듈전체를 선택할 수 있는 모듈선택단자(CS)를 포함한다.상기 내부논리회로(30)는 소정의 논리상태를 유지하는 제1 논리지정회로(10a)와 상기 제1 논리지정회로(10a)와 반대의 논리상태를 유지하는 제2 논리지정회로 (10b)를 포함한다.
Int. CL H03K 19/00 (2006.01)
CPC G11C 8/12(2013.01)
출원번호/일자 1019910015639 (1991.09.07)
출원인 한국전자통신연구원
등록번호/일자 10-0070050-0000 (1994.01.17)
공개번호/일자 10-1993-0006904 (1993.04.22) 문서열기
공고번호/일자 1019930009704 (19931008) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1991.09.07)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김기홍 대한민국 대전직할시서구
2 이창석 대한민국 대전직할시서구
3 박형무 대한민국 대전직할시서구
4 윤형진 대한민국 대전직할시중구
5 박신종 대한민국 대전직할시중구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전직할시유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent		 1991.09.07 수리 (Accepted) 1-1-1991-0087888-34
2 특허출원서
Patent Application		 1991.09.07 수리 (Accepted) 1-1-1991-0087886-43
3 대리인선임신고서
Notification of assignment of agent		 1991.09.07 수리 (Accepted) 1-1-1991-0087887-99
4 출원심사청구서
Request for Examination		 1991.09.07 수리 (Accepted) 1-1-1991-0087889-80
5 출원공고결정서
Written decision on publication of examined application		 1993.09.15 발송처리완료 (Completion of Transmission) 1-5-1991-0039600-37
6 등록사정서
Decision to grant		 1994.01.06 발송처리완료 (Completion of Transmission) 1-5-1991-0039601-83
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

칩선택 회로를 구비하고 각각에 소정의 확장 어드레스가 할당된 복수의 반도체소자 칩들을 포함하는 다중 칩모듈 반도체장치에 있어서, 상기 반도체소자 칩들의 외부에 별도의 부가적인 칩선택 제어수단을 구성하지 않고 상기 확장 어드레스의 논리 조합에 대응하는 단일 반도체소자 칩이 선택되도록 하기 위하여 상기 반도체소자 칩들의 내부에 외부입력단과 선택적으로 연결되는 복수의 칩선택단자쌍들(CS1, 2

제 1 항에 있어서, 상기 디코딩로직 수단(40)은 선택되는 상기 반도체소자 칩들의 수(N)와 동일한 수의 내부 논리수단들(30-1, 30-2,‥‥30-N)과, 상기 내부논리 수단들의 출력들을 논리곱하는 앤드회로 수단으로 구성되는 것을 특징으로 하는 반도체장치

3 3

제 2 항에 있어서, 상기 내부논리 수단(30)은 칩선택 단자쌍(CS, 4

제 1 항에 있어서, 상기 디코딩로직 수단(40)은 모듈선택단자(ms)를 부가적으로 포함하는 것을 특징으로 하는 반도체장치

5 5

제 3 항에 있어서, 제 1 및 제 2 논리지정수단(10a, 10b)은 고저항 혹은 임의의 논리유지 수단으로 구성되는 것을 특징으로 하는 반도체장치

6 6

제 3 항에 있어서, 제 1 및 제 2 준삼상입력단(20a, 20b)은 외부 입력단과 접속될 때 상기 외부입력단의 입력신호에 의해 논리상태가 결정되고, 상기 외부 입력단과 접속되지 않을 때 상기 제 1 및 제 2 논리지정 수단(10a, 10b)에 의해 논리 상태가 결정되는 것을 특징으로 하는 반도체장치

7 7

제 1 항 또는 제 2 항에 있어서, 상기 디코딩로직 수단(40)의 출력단을 상기 칩선택 회로의 입력단에 연결하는 것을 특징으로 하는 반도체장치

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1 JP05210577 JP 일본 FAMILY
2 JP07034184 JP 일본 FAMILY
3 US05338981 US 미국 FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 JP2001386 JP 일본 DOCDBFAMILY
2 JP5210577 JP 일본 DOCDBFAMILY
3 JP7034184 JP 일본 DOCDBFAMILY
4 JPH05210577 JP 일본 DOCDBFAMILY
5 JPH0734184 JP 일본 DOCDBFAMILY
6 US5338981 US 미국 DOCDBFAMILY
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