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인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 및 그 방법
- 기술번호 : KST2015091518
- 담당센터 : 대전기술혁신센터
- 전화번호 : 042-610-2279
| 요약 | 본 발명은 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 및 그 방법에 관한 것으로, 제1 디코더에서 복호화된 데이터를 제1 인터리버 또는 제2 인터리버에 의해 인터리빙된 데이터와 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙된 데이터를 저장하는 다수개의 메모리들을 구비하는 메모리 모듈부;상기 인터리빙 또는 디인터리빙된 데이터를 상기 메모리 모듈부에 저장하기 위한 출력 신호가 전송되면 상기 다수개의 메모리들 중 어느 하나의 메모리에 포함되는 다수개의 메모리 블록 중 어느 하나의 메모리 블록을 선택하는 블록 선택부; 및 상기 출력 신호에 어드레스를 부여하는 어드레스 부여부;를 포함한다. |
|---|---|
| Int. CL | H03M 13/27 (2006.01) |
| CPC | |
| 출원번호/일자 | 1020130060812 (2013.05.29) |
| 출원인 | 한국전자통신연구원 |
| 등록번호/일자 | |
| 공개번호/일자 | 10-2014-0140252 (2014.12.09) 문서열기 |
| 공고번호/일자 | |
| 국제출원번호/일자 | |
| 국제공개번호/일자 | |
| 우선권정보 | |
| 법적상태 | 공개 |
| 심사진행상태 | 수리 |
| 심판사항 | |
| 구분 | 신규 |
| 원출원번호/일자 | |
| 관련 출원번호 | |
| 심사청구여부/일자 | N |
| 심사청구항수 | 15 |
출원인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 한국전자통신연구원 | 대한민국 | 대전광역시 유성구 |
발명자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 김덕환 | 대한민국 | 대전 서구 |
대리인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 한양특허법인 | 대한민국 | 서울특별시 강남구 논현로**길 **, 한양빌딩 (도곡동) |
최종권리자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 최종권리자 정보가 없습니다 | |||
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 [Patent Application] Patent Application |
2013.05.29 | 수리 (Accepted) | 1-1-2013-0476064-38 |
| 2 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2015.02.02 | 수리 (Accepted) | 4-1-2015-0006137-44 |
| 번호 | 청구항 |
|---|---|
| 1 |
1 제1 디코더에서 복호화된 데이터를 제1 인터리버 또는 제2 인터리버에 의해 인터리빙된 데이터와 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙된 데이터를 저장하는 다수개의 메모리들을 구비하는 메모리 모듈부;상기 인터리빙 또는 디인터리빙된 데이터를 상기 메모리 모듈부에 저장하기 위한 출력 신호가 전송되면 상기 다수개의 메모리들 중 어느 하나의 메모리에 포함되는 다수개의 메모리 블록 중 어느 하나의 메모리 블록을 선택하는 블록 선택부; 및상기 출력 신호에 어드레스를 부여하는 어드레스 부여부;를 포함하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 2 |
2 제 1항에 있어서,상기 제2 디코더는 상기 제1 디코더에서 복호화된 데이터를 제1 인터리버 및 제2 인터리버에 의해 인터리빙한 데이터를 입력받아 복호화하고, 상기 제1 디코더는 상기 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙한 데이터를 입력받아 복호화하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 3 |
3 제 1항에 있어서,상기 다수개의 메모리는 제1 인터리버, 제2 인터리버 및 디인터리버의 행렬 크기와 대응되는 크기로 할당되는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 4 |
4 제 1항에 있어서,상기 다수개의 메모리들은 상기 제1 디코더에서 복호화된 데이터를 상기 제1 인터리버가 인터리빙한 데이터를 저장하는 제1 메모리 블록, 시스테매틱 심볼의 입력 데이터를 토대로 상기 제2 인터리버가 인터리빙한 데이터를 저장하는 제2 메모리 블록, 상기 제2 디코더에서 복호화된 데이터를 상기 디인터리버가 디인터리빙한 데이터를 저장하는 제3 메모리 블록, 상기 제1 디코더에서 복호화된 데이터를 상기 제1 인터리버가 인터리빙한 데이터를 저장하는 제4 메모리 블록, 상기 시스테매틱 심볼의 입력 데이터를 토대로 상기 제2 인터리버가 인터리빙한 데이터를 저장하는 제5 메모리 블록 및 상기 제2 디코더에서 복호화된 데이터를 상기 디인터리버가 디인터리빙한 데이터를 저장하는 제6 메모리 블록을 포함하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 5 |
5 제 1항에 있어서,상기 메모리 모듈부는 상기 블록 선택부로부터 출력되는 선택 신호(CS) 및 상기 어드레스 부여부로부터 출력되는 어드레스 신호(ADDR)와 매칭되는 해당 메모리의 메모리 블록에 상기 출력 신호에 대응되는 상기 인터리빙 또는 디인터리빙된 데이터를 저장하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 6 |
6 제 1항에 있어서,상기 어드레스 부여부는 상기 출력 신호의 출력 순서에 따라 할당되는 다수개의 메모리들 중 어느 하나의 메모리 번호 정보를 포함하는 어드레스 신호(ADDR)를 출력하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 7 |
7 제 1항에 있어서,상기 블록 선택부는 상기 다수개의 메모리 블록들 중 어느 하나의 메모리 블록 정보를 포함하고 있는 선택 신호(CS)를 출력하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 8 |
8 제 1항에 있어서,상기 인터리빙 또는 디인터리빙된 데이터를 상기 메모리 모듈부에 전송하고, 상기 메모리 모듈부에 저장된 상기 인터리빙 또는 디인터리빙된 데이터를 상기 제1 인터리버, 제2 인터리버 및 디인터리버 중 어느 하나에 전송하는 데이터 전송부;를 포함하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 장치 |
| 9 |
9 메모리 모듈부에 의해, 제1 디코더에서 복호화된 데이터를 제1 인터리버 또는 제2 인터리버에 의해 인터리빙된 데이터와 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙된 데이터를 저장하는 다수개의 메모리들을 구비하는 단계;블록 선택부에 의해, 상기 인터리빙 또는 디인터리빙된 데이터를 상기 메모리 모듈부에 저장하기 위한 출력 신호가 전송되면 상기 다수개의 메모리들 중 어느 하나의 메모리에 포함되는 다수개의 메모리 블록 중 어느 하나의 메모리 블록을 선택하는 단계; 및어드레스 부여부에 의해 |
| 10 |
10 제 9항에 있어서,상기 제1 디코더에서 복호화된 데이터를 제1 인터리버 또는 제2 인터리버에 의해 인터리빙된 데이터와 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙된 데이터를 저장하는 다수개의 메모리들을 구비하는 단계에서,상기 다수개의 메모리는 제1 인터리버, 제2 인터리버 및 디인터리버의 행렬 크기와 대응되는 크기로 할당되는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 방법 |
| 11 |
11 제 9항에 있어서,상기 제1 디코더에서 복호화된 데이터를 제1 인터리버 또는 제2 인터리버에 의해 인터리빙된 데이터와 제2 디코더에서 복호화된 데이터를 디인터리버에 의해 디인터리빙된 데이터를 저장하는 다수개의 메모리들을 구비하는 단계에서,상기 다수개의 메모리들은 상기 제1 디코더에서 복호화된 데이터를 상기 제1 인터리버가 인터리빙한 데이터를 저장하는 제1 메모리 블록, 시스테매틱 심볼의 입력 데이터를 토대로 상기 제2 인터리버가 인터리빙한 데이터를 저장하는 제2 메모리 블록, 상기 제2 디코더에서 복호화된 데이터를 상기 디인터리버가 디인터리빙한 데이터를 저장하는 제3 메모리 블록, 상기 제1 디코더에서 복호화된 데이터를 상기 제1 인터리버가 인터리빙한 데이터를 저장하는 제4 메모리 블록, 상기 시스테매틱 심볼의 임력 데이터를 토대로 상기 제2 인터리버가 인터리빙한 데이터를 저장하는 제5 메모리 블록 및 상기 제2 디코더에서 복호화된 데이터를 상기 디인터리버가 디인터리빙한 데이터를 저장하는 제6 메모리 블록을 포함하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 방법 |
| 12 |
12 제 9항에 있어서,상기 인터리빙 및 디인터리빙된 데이터를 상기 메모리 모듈부에 저장하기 위한 출력 신호가 전송되면 상기 다수개의 메모리들 중 어느 하나의 메모리에 포함되는 다수개의 메모리 블록 중 어느 하나의 메모리 블록을 선택하는 단계에서 |
| 13 |
13 제 9항에 있어서,상기 출력 신호에 어드레스를 부여하는 단계에서,상기 어드레스 부여부는 상기 출력 신호의 출력 순서에 따라 할당되는 다수개의 메모리들 중 어느 하나의 메모리 번호 정보를 포함하는 어드레스 신호를 출력하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 방법 |
| 14 |
14 제 9항에 있어서,상기 출력 신호에 어드레스를 부여하는 단계 이후에,상기 메모리 모듈부는 상기 블록 선택부로부터 출력되는 선택 신호(CS) 및 상기 어드레스 부여부로부터 출력되는 어드레스 신호(ADDR)와 매칭되는 해당 메모리의 메모리 블록에 상기 출력 신호에 대응되는 상기 인터리빙 또는 디인터리빙된 데이터를 저장하는 단계를 더 포함하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 방법 |
| 15 |
15 제 9항에 있어서,데이터 전송부에 의해, 상기 인터리빙 또는 디인터리빙된 데이터를 상기 메모리 모듈부에 전송하고, 상기 메모리 모듈부에 저장된 상기 인터리빙 또는 디인터리빙된 데이터를 상기 제1 인터리버, 제2 인터리버 및 디인터리버 중 어느 하나에 전송하는 것을 특징으로 하는 인터리빙 및 디인터리빙을 위한 메모리 엑세스 방법 |
| 지정국 정보가 없습니다 |
|---|
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | US20140359397 | US | 미국 | FAMILY |
DOCDB 패밀리 정보
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | US2014359397 | US | 미국 | DOCDBFAMILY |
| 순번 | 연구부처 | 주관기관 | 연구사업 | 연구과제 |
|---|---|---|---|---|
| 1 | 지식경제부 | 한국전자통신연구원 | 산업원천기술개발사업(정보통신) | 3G LTE 기반 All-In-One FemtoCell 기지국 SoC 플랫폼 |
| 등록사항 정보가 없습니다 |
|---|
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| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 | 2013.05.29 | 수리 (Accepted) | 1-1-2013-0476064-38 |
| 2 | 출원인정보변경(경정)신고서 | 2015.02.02 | 수리 (Accepted) | 4-1-2015-0006137-44 |
| 기술정보가 없습니다 |
|---|
| 과제고유번호 | 1415122235 |
|---|---|
| 세부과제번호 | KI002109 |
| 연구과제명 | 3G LTE 기반 All-In-One FemtoCell 기지국 SoC 플랫폼 |
| 성과구분 | 출원 |
| 부처명 | 지식경제부 |
| 연구관리전문기관명 | 한국산업기술평가관리원 |
| 연구주관기관명 | 한국전자통신연구원 |
| 성과제출연도 | 2012 |
| 연구기간 | 200903~201302 |
| 기여율 | 1 |
| 연구개발단계명 | 기초연구 |
| 6T분류명 | IT(정보기술) |
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