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게이트 전극 형성 방법 및 이를 통해 얻은 게이트 전극을 포함한 반도체 소자

  • 기술번호 : KST2015092508
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 게이트 전극 형성방법 및 이를 통해 얻은 게이트 전극을 포함한 반도체 소자에 관한 것으로, 상기 형성방법은 기판 상에 1차 절연막을 형성하는 단계; 상기 1차 절연막 위에 포토레지스트를 도포 및 식각하여 게이트 풋 패턴을 형성하는 단계; 상기 게이트 풋 패턴이 형성된 기판 위에 게이트 전극의 풋을 형성하는 단계; 상기 게이트 전극의 풋이 형성된 기판 상에 2차 절연막을 형성하는 단계; 상기 2차 절연막 위에 다층의 포토레지스트를 도포 및 식각하여 게이트 줄기 및 헤드 패턴을 형성하는 단계; 및상기 게이트 줄기 및 헤드 패턴이 형성된 기판 위에 게이트 전극을 형성하는 단계;를 포함하는, 이와 같이 제조되는 게이트 전극은 게이트 전극 풋 주위에 빈 공간을 모두 채워 빈 공간이 존재할 때 발생할 수 있는 전극 금속 물질의 이동을 억제하여 신뢰성있는 소자 특성을 확보할 수 있고, 게이트 전극 헤드가 게이트 전류의 패스로써 작동하여 게이트 전극의 자체 저항을 감소시킬 수 있는 효과가 있다.
Int. CL H01L 21/28 (2006.01.01) H01L 29/423 (2006.01.01) H01L 21/3213 (2006.01.01)
CPC H01L 21/28114(2013.01) H01L 21/28114(2013.01) H01L 21/28114(2013.01) H01L 21/28114(2013.01)
출원번호/일자 1020130159197 (2013.12.19)
출원인 한국전자통신연구원
등록번호/일자 10-2123845-0000 (2020.06.11)
공개번호/일자 10-2015-0072003 (2015.06.29) 문서열기
공고번호/일자 (20200618) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2018.12.17)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 민병규 대한민국 세종특별자치시 누리로

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.12.19 수리 (Accepted) 1-1-2013-1164644-59
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
3 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2016.10.24 수리 (Accepted) 1-1-2016-1030796-30
4 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2018.12.17 수리 (Accepted) 1-1-2018-1268673-62
5 선행기술조사의뢰서
Request for Prior Art Search
2019.11.12 수리 (Accepted) 9-1-9999-9999999-89
6 선행기술조사보고서
Report of Prior Art Search
2019.12.18 수리 (Accepted) 9-1-2019-0058522-26
7 의견제출통지서
Notification of reason for refusal
2020.02.10 발송처리완료 (Completion of Transmission) 9-5-2020-0097547-22
8 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2020.04.08 수리 (Accepted) 1-1-2020-0366439-96
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2020.04.08 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2020-0366440-32
10 등록결정서
Decision to grant
2020.06.09 발송처리완료 (Completion of Transmission) 9-5-2020-0395723-74
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기판 상에 1차 절연막을 형성하는 단계;상기 1차 절연막 위에 포토레지스트를 도포 및 식각하여 게이트 풋 패턴을 형성하는 단계;상기 게이트 풋 패턴이 형성된 기판 위에 게이트 전극의 풋을 형성하는 단계;상기 게이트 전극의 풋이 형성된 기판 상에 2차 절연막을 형성하는 단계;상기 2차 절연막 위에 다층의 포토레지스트를 도포 및 식각하여 게이트 줄기 및 헤드 패턴을 형성하는 단계; 및상기 게이트 줄기 및 헤드 패턴이 형성된 기판 위에 게이트 전극을 형성하는 단계;를 포함하는 게이트 전극 형성방법
2 2
제1항에 있어서,상기 기판으로는 SiC 기판상에 전이층과 AlGaN/GaN 에피층이 형성되어 있는 반도체 기판인 것을 특징으로 하는 게이트 전극 형성방법
3 3
제1항에 있어서,상기 1차 절연막 및 2차 절연막으로는 실리콘 질화물이 사용되는 것을 특징으로 하는 게이트 전극 형성방법
4 4
제1항에 있어서,상기 2차 절연막은 게이트 전극의 풋과 1차 절연막 사이의 노출된 영역을 채울 수 있는 두께를 갖는 것을 특징으로 하는 게이트 전극 형성방법
5 5
제1항에 있어서, 상기 2차 절연막 위에 다층의 포토레지스트로는 PMMA층/코폴리머층/PMMA층이 순차적으로 형성되는 것인 게이트 전극 형성방법
6 6
제5항에 있어서,상기 다층의 포토레지스트가 식각되어지는 경우, 상층 PMMA층의 오픈 영역의 길이는 코폴리머층(11)의 오픈 영역의 길이보다 짧게 하여 오버행(overhang) 구조를 갖게 하는 것을 특징으로 하는 것인 게이트 전극 형성방법
7 7
제1항에 있어서,상기 게이트 전극용 금속으로는 Ni 및 Au가 사용되는 것을 특징으로 하는 게이트 전극 형성방법
8 8
제1항에 있어서,상기 게이트 전극 풋 패턴 및 게이트 전극 줄기 및 헤드 패턴은 리소그라피 공정을 통해 형성되는 것을 특징으로 하는 게이트 전극 형성방법
9 9
제1항에 있어서,상기 게이트 전극이 형성된 기판 위에 보호막을 더 형성하는 것을 특징으로 하는 게이트 전극 형성방법
10 10
제1항 내지 제9항중 어느 하나의 항에 따라 형성된 게이트 전극을 포함하는 반도체 소자
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 舊지경부 (주)엘아이씨티 SW융합형부품기술개발사업 SW기반 디지털 무선통신용 핵심 모듈 및 트랜시버 개발