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중앙처리장치와주변입출력장치와의인터페이스회로

  • 기술번호 : KST2015092940
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 내용 없음.
Int. CL G06F 13/28 (2006.01)
CPC G06F 13/28(2013.01)
출원번호/일자 1019890010354 (1989.07.21)
출원인 한국전자통신연구원, 주식회사 케이티
등록번호/일자 10-0050320-0000 (1992.03.30)
공개번호/일자 10-1991-0003512 (1991.02.27) 문서열기
공고번호/일자 1019910008420 (19911015) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1989.07.21)
심사청구항수 0

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 주식회사 케이티 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 이경준 대한민국 대전시
2 전용태 대한민국 대전시대덕구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전시유성구
2 한국전기통신공사 대한민국 서울특별시종로구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 출원심사청구서
Request for Examination		 1989.07.21 수리 (Accepted) 1-1-1989-0060657-70
2 특허출원서
Patent Application		 1989.07.21 수리 (Accepted) 1-1-1989-0060656-24
3 대리인선임신고서
Notification of assignment of agent		 1989.07.21 수리 (Accepted) 1-1-1989-0060658-15
4 명세서등보정서
Amendment to Description, etc.		 1990.02.28 수리 (Accepted) 1-1-1989-0060659-61
5 출원공고결정서
Written decision on publication of examined application		 1991.09.14 발송처리완료 (Completion of Transmission) 1-5-1989-0031923-34
6 등록사정서
Decision to grant		 1991.12.26 발송처리완료 (Completion of Transmission) 1-5-1989-0031925-25
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 1999.01.20 수리 (Accepted) 4-1-1999-0010652-29
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2000.01.14 수리 (Accepted) 4-1-2000-0005008-66
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.04.09 수리 (Accepted) 4-1-2002-0032774-13
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.03.13 수리 (Accepted) 4-1-2009-5047686-24
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2010.04.19 수리 (Accepted) 4-1-2010-5068437-23
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.01.10 수리 (Accepted) 4-1-2012-5005621-98
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.03.21 수리 (Accepted) 4-1-2012-5058926-38
17 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.08 수리 (Accepted) 4-1-2012-5122434-12
18 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.07.31 수리 (Accepted) 4-1-2013-5106568-91
19 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.02.11 수리 (Accepted) 4-1-2014-5018159-78
20 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

제어 및 어드레스 신호와 연결되어 있고 DMA(Direct Memory Access)제어신호를 내장한 주변입출력장치(2a)와, 상기 주볍입출력장치(2a)의 DRQ(리드/라이트)신호와 연결되어 있는 NAND 게이트(2j)와, 상기 NAND 게이트(2j) 및 주변입출력장치(2a)의 DACK 신호와 연결되어 있는 AND게이트(2h)와, 상기 AND 게이트(2h)의 출력과 제어 및 어드레스 신호와 연결되어 명령의 추출 및 실행을 행하는 중앙처리장치(2b)와, 상기 중앙처리장치(2b)의 BUSACK 신호 및 시프트 레지스터(2c)와 연결되어 있는 OR게이트(2i)와, 상기 중앙처리장치(2b)의 BUSACK 신호에 연결되어 있는 인버터(2k)와, 상기 인버터(2k)의 출력 및 중앙처리장치(2b)의 클럭 신호와 연결되어 버스사용 기간을 결정하고 메모리 제어신호를 발생하는 시점을 결정해 주는 시프트 레지스터회로(2c)와, 상기 주변입출력장치(2a)의 DRQ(리드)신호 및 인버터(2k)출력과 연결되어 DMA동작 모드를 구별하는 플립플롭(2f)과, 상기 시프트 레지스터(2c) 및 플립플롭(2f)의 출력과 연결되어 DMA 동작시 상기 주변입출력장치(2a)의 특성에 따라 메모리 제어신호를 발생하는 메모리 제어신호 발생회로(2d)와, 상기 시프트 레지스터(2c) 및 메모리 제어신호발생회로(2d)와 연결되어 DMA동작 신호의 출력을 제어할때 이용되는 상기 제어 및 어드레스 신호를 전달하는 버퍼회로(2e)로 구성된 것을 특징으로 하는 인터페이스 회로

2 2

제1항에 있어서, 상기 제어 및 어드레스 신호에 연결되어 메모리(2g)를 더 포함한 것을 특징으로 하는 인터페이스 회로

3 3

제1항에 있어서, 상기 메모리 제어신호 발생회로(2d)는 상기 시프트 레지스터(2c)의 첫번째 출력을 이용하여 DMA동작을 시작하기 위한 메모리 제어신호의 출력을 인에이블하는 것을 특징으로 하는 인터페이스 회로

4 4

제1항에 있어서, 상기 플립플롭(2f)은 주변입출력장치(2a)의 DMA 리드/라이트 모드에 따라 토글(toggle)되어 동작하는 것을 특징으로 하는 인터페이스 회로

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.