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합성펄스를 동상 및 역상 합성펄스로 변환시키는 동상 및 역상합성 펄스 발생수단(1), 상기 동상 및 역상 합성펄스 발생수단(1)에 연결되어 상기 합성 펄스에서 클럭펄스를 복구해내는 클럭펄스 추출수단(2), 상기 클럭펄스 추출 수단(2)에 연결되어, 복구된 클럭펄스를 역상으로 변환시키고 상기 합성펄스의 2배이상의 클럭펄스 주기를 가진 클럭펄스를 추출된 클럭펄스의 한 주기 위상차 마다 각각 동상 및 역상으로 병렬발생시키는 위상차 분주 클럭 발생수단(3), 상기 동상 및 역상 합성펄스 발생수단(1)과 위상차 분주 클럭펄스 발생수단(30)에 연결되어, 위상차 분주클럭펄스마다 감시하여 상기 합성펄스에서 프레임 펄스 위치를 출력하는 프레임 펄스위치 출력수단(4), 상기 클럭펄스 추출수단(2)에 연결되어 프레임 위치 출력수단(4)에서의 전달지연을 보상하는 추출클럭펄스 지연 보상수단(5), 상기 프레임 펄스위치 클럭수단(4)과 추출 클럭펄스지연 보상 수단(5)에 연결되어 프레임 펄스위치를 검출해 프레임 펄스를 발생시키는 프레임 펄스발생수단(6), 상기 프레임 펄스 발생수단(6)과 외부의 프레임 펄스제어단자(FPEN)에 연결되어 프레임 펄스 발생을 제어하는 프레임 펄스제어수단(7)으로 구성되어 합성펄스에서 클럭펄스 및 프레임 펄스를 안정하게 복구하는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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제1항에 있어서, 상기 동상 및 역상 합성 펄스발생수단(1)은 버퍼(U1a)로 구성되어, 상기 합성펄스를 동상 및 역상으로 발생시키는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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제1항에 있어서, 상기 클럭펄스 추출수단(2)은 상기 버퍼(U1A)의 출력단에 연결된 대역여파기(U10), 상기 대역여파기(U10)에 연결된 비교기(U11)의 출력단에 연결된 버퍼(U1B)로 구성되는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복귀회로
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제1항에 있어서, 상기 위상차 분주 클럭펄스 발생수단(3)은 D플립플롭(U2a)으로 구성되는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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제1항에 있어서, 상기 프레임 펄스위치 출력수단(4)은 상기 버퍼(U1a)의 동상 클럭펄스 출력단에 클럭펄스입력단(CP1)이 연결되고, 상기 D플립플롭(U2a)의 출력단(Q1)에 세트단(S1)이 연결된 D플립플롭(U3a), 상기 버퍼(U1a)의 역상 클럭펄스 출력단에 클럭펄스 입력단(CP2)이 연결되고 상기 D플립플롭(U2a)의 출력단(Q1)에 세트단(S1)이 연결된 D플립플롭(U3b), 상기 버퍼(U1a)의 동상 클럭펄스 출력단에 클럭펄스 입력단(CP1)이 연결되고 D플립플롭(U2a)의 부출력단(Q1)에 세트단(S1)이 연결된 D플립플롭(U4a), 상기 버퍼(U1a)의 역상 클럭출력단에 클럭펄스 입력단(CP2)이 연결되고 상기 D플립플롭(U2a)의 부출력단(Q1)에 세트단(S2)이 연결된 D플립플롭(U4b), 상기 D플립플롭(U3a, U3b, U4a, U4b)의 부출력단(Q1, Q2)에 입력단이 연결된 OR게이트 (U7)로 구성되는 것을 특징으로 하는 것을 프레임펄스 및 복구회로
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제1항에 있어서, 추출클럭펄스 지연보상수단(5)은 상기 버퍼(U1b)의 역상 클럭펄스 출력단에 클리어단자(3)가 연결되고 동상 펄스 출력단에 세트단자(S3)가 연결된 D플립플롭(U2c), 상기 D플립플롭(U2c)의 출력단(Q3, Q3)이 입력단에 연결된 버퍼(U1c)로 구성되는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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7
제1항에 있어서, 프레임 펄스 발생수단(6)은 상기 OR게이트(U7)의 출력단에 데이터 입력단자(D2)가 연결되고 버퍼(U1c)의 역상 클럭펄스 출력단에 클럭펄스 입력단(CP2)이 연결된 D플립플롭(U8b), 상기 D플립플롭(U8b)의 출력단(Q2)에 데이터 입력단자(D3)가 연결되고 상기 버퍼(U1c)의 역상 클럭펄스 출력단에 클럭펄스 입력단(CP3)이 연결된 D플립플롭(U8c), 상기 OR게이트(U7)의 출력단에 데이타 입력단자(D1)가 연결되고 상기 버퍼(U1c)의 역상 클럭펄스 출력단에 클럭펄스 입력단(CP1)이 연결되고 상기 D플립플롭(U8c) 부출력단(Q3)에 세트단자(S1)가 연결된 프레임 펄스 복구회로
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8
제1항에 있어서, 프레임 펄스 제어수단(7)은 상기 D플립플롭(U8a)의 출력단(Q1)과 외부의 분주회로 또는 타이밍 신호 발생회로에서 발생되는 프레임 펄스 제어입력(FPEN)이 입력단에 연결된 NOR게이트(9)로 구성되는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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제4항 또는 제5항에 있어서, 추출된 클럭의 주파수에 따라 상기 위상차 분주 클럭 발생수단(3)을 n(자연수)개의 D플립플롭으로 확장하여 구성하여, 합성펄스에서 클럭펄스 및 프레임 펄스를 안정되게 복구하는 것을 특징으로 하는 프레임 펄스 및 클럭펄스 복구회로
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