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RISC의CPU용쉬프터

  • 기술번호 : KST2015094229
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 내용 없음.
Int. CL G06F 9/38 (2006.01)
CPC G06F 9/30032(2013.01)
출원번호/일자 1019890019500 (1989.12.26)
출원인 한국전자통신연구원
등록번호/일자 10-0055914-0000 (1992.10.30)
공개번호/일자 10-1991-0012912 (1991.08.08) 문서열기
공고번호/일자 1019920006276 (19920803) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1989.12.26)
심사청구항수 2

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 임인칠 대한민국 서울시성동구
2 홍인식 대한민국 경기도부천시남구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전시유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 1989.12.26 수리 (Accepted) 1-1-1989-0113924-98
2 대리인선임신고서
Notification of assignment of agent		 1989.12.26 수리 (Accepted) 1-1-1989-0113925-33
3 출원심사청구서
Request for Examination		 1989.12.26 수리 (Accepted) 1-1-1989-0113926-89
4 명세서등보정서
Amendment to Description, etc.		 1991.10.07 수리 (Accepted) 1-1-1989-0113927-24
5 출원공고결정서
Written decision on publication of examined application		 1992.06.30 발송처리완료 (Completion of Transmission) 1-5-1989-0060440-63
6 등록사정서
Decision to grant		 1992.10.26 발송처리완료 (Completion of Transmission) 1-5-1989-0060442-54
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

RISC의 CPU의 데이타 패스에 있어서, 버스 S 또는 제2 이미디잇 래치로 부터의 데이타를 선택적으로 입력하는 입력 셀렉터(11)와, 제어신호(Left),(Right 1, 2, 4, 8, 16)에 의해 제어되며 쉬프트 또는 로테이트 동작이 5단계로 나누어 수행되는 쉬프트/로테이트(12)와, 동작의 결과 또는 사인 신호를 출력시키는 멀티 플렉서(13)와, 멀티 플렉서(13)를 통과한 신호의 구동 능력이 커지도록 하는 버스 트라이버(14)와, 멀티플렉서의 동작을 결정하는 마스크 제너레이터(15)들로 구성됨을 특징으로 하는 RISC의 CPU용 쉬프터

2 2

제1항에 있어서, 쉬프터는 n채널 트랜지스터(A)∼(H)와, P채널 트랜지스터(P1), (P2)와, 인버터(I)및 버퍼(buffer)들로 도미노 구조가 되도록 구성한 RISC의 CPU용 쉬프터

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.