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중앙처리장치와 주기억장치의 인터페이스 장치 및 방법

  • 기술번호 : KST2015096676
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 중앙처리장치와 주기억장치의 인터페이스 장치 및 방법은 공유캐쉬 기억장치와 주기억장치를 하나의 광신호선으로 연결하도록 한 중앙처리장치와 주기억장치의 인터페이스 장치 및 방법이 제시된다. 제시된 중앙처리장치와 주기억장치의 인터페이스 장치는 중앙처리장치의 공유캐쉬 기억장치로부터 입력되는 동작 제어 신호를 직렬신호로 변환하는 마스터 광연결 프로토콜 엔진; 마스터 광연결 프로토콜 엔진에서 변환된 직렬신호를 광신호로 변환하는 제1전광 변환기; 제1전광 변환기에서 변환된 광신호를 직렬신호로 변환하는 제2전광 변환기; 제2전광 변환기에서 변환된 직렬신호를 동작 제어 신호로 변환하는 슬레이브 광연결 프로토콜 엔진; 및 슬레이브 광연결 프로토콜 엔진에서 변환된 동작 제어 신호를 근거로 주기억장치에 액세스하는 메모리 컨트롤러를 포함한다.
Int. CL G06F 13/00 (2006.01.01)
CPC
출원번호/일자 1020130159058 (2013.12.19)
출원인 한국전자통신연구원
등록번호/일자 10-2102160-0000 (2020.04.13)
공개번호/일자 10-2015-0071925 (2015.06.29) 문서열기
공고번호/일자 (20200421) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2018.04.10)
심사청구항수 18

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 최용석 대한민국 대전광역시 유성구
2 권혁제 대한민국 대전 유성구
3 김경옥 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 한양특허법인 대한민국 서울특별시 강남구 논현로**길 **, 한양빌딩 (도곡동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2013.12.19 수리 (Accepted) 1-1-2013-1163920-88
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)		 2018.04.10 수리 (Accepted) 1-1-2018-0357091-31
4 선행기술조사의뢰서
Request for Prior Art Search		 2019.03.15 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search		 2019.05.14 발송처리완료 (Completion of Transmission) 9-6-2019-0090225-83
6 의견제출통지서
Notification of reason for refusal		 2019.08.21 발송처리완료 (Completion of Transmission) 9-5-2019-0604712-06
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2019.10.21 수리 (Accepted) 1-1-2019-1070383-28
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2019.10.21 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-1070384-74
9 등록결정서
Decision to grant		 2020.02.20 발송처리완료 (Completion of Transmission) 9-5-2020-0129476-74
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번호 청구항
1 1
중앙처리장치의 공유캐쉬 기억장치로부터 입력되는 동작 제어 신호를 직렬신호로 변환하는 마스터 광연결 프로토콜 엔진;상기 마스터 광연결 프로토콜 엔진에서 변환된 직렬신호를 광신호로 변환하는 제1전광 변환기;상기 제1전광 변환기에서 변환된 광신호를 직렬신호로 변환하는 제2전광 변환기;상기 제2전광 변환기에서 변환된 직렬신호를 동작 제어 신호로 변환하는 슬레이브 광연결 프로토콜 엔진; 및상기 슬레이브 광연결 프로토콜 엔진에서 변환된 동작 제어 신호를 근거로 주기억장치에 액세스하는 메모리 컨트롤러를 포함하고,상기 마스터 광연결 프로토콜 엔진은,상기 공유캐쉬 기억장치로부터 입력된 동작 제어 신호를 근거로 패킷 헤더 및 패킷 데이터를 생성하는 제1패킷 생성 모듈;상기 제1패킷 생성 모듈에서 생성된 패킷 헤더를 저장하는 패킷 송신 헤더 버퍼 모듈;상기 제1패킷 생성 모듈에서 생성된 패킷 데이터를 저장하는 패킷 송신 데이터 버퍼 모듈;상기 패킷 헤더 및 패킷 데이터를 근거로 패킷 순서 및 CRC를 생성하고, 상기 패킷 헤더, 패킷 데이터, 패킷 순서 및 CRC를 연결하여 동작 제어 패킷을 생성하는 패킷 순서 및 CRC 생성 모듈; 및상기 동작 제어 패킷을 직렬신호로 변환하고, 상기 직렬신호를 상기 제1전광 변환기에게로 전송하는 제1패킷 데이터 직렬화 모듈을 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
2 2
청구항 1에 있어서,상기 메모리 컨트롤러는 상기 동작 제어 신호에 따른 주기억장치의 액세스 결과를 근거로 응답 신호를 생성하고,상기 슬레이브 광연결 프로토콜 엔진은 상기 메모리 컨트롤러에서 변환된 병렬신호를 직렬신호로 변환하고,상기 제2전광 변환기는 상기 슬레이브 광연결 프로토콜 엔진에서 변환된 직렬신호를 광신호로 변환하고,상기 제1전광 변환기는 상기 제2전광 변환기에서 변환된 광신호를 직렬신호로 변환하고,상기 마스터 광연결 프로토콜 엔진은 상기 제1전광 변환기에서 변환된 직렬신호를 병렬신호로 변환하여 상기 공유캐쉬 기억장치에게로 전송하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
3 3
삭제
4 4
청구항 1에 있어서,상기 마스터 광연결 프로토콜 엔진은,상기 슬레이브 광연결 프로토콜 엔진의 버퍼 모듈에 대한 상태 정보를 상기 제1전광 변환기로부터 직렬신호로 전송받고, 상기 직렬신호를 병렬신호로 변환하는 제1패킷 데이터 병렬화 모듈;상기 병렬신호를 근거로 상기 슬레이브 광연결 프로토콜 엔진의 버퍼 모듈에 대한 상태 정보를 관리하고, 자체 버퍼 모듈의 상태정보를 관리하는 패킷 검사 모듈;상기 공유캐쉬 기억장치로부터 동작 제어 신호가 입력되면 상기 슬레이브 광연결 프로토콜 엔진의 버퍼 모듈에 대한 상태 정보 및 상기 자체 버퍼 모듈의 상태정보를 근거로 여유 공간 존재 여부를 판단하고, 여유 공간이 존재하면 상기 동작 제어 신호를 근거로 패킷 헤더를 생성하여 상기 자체 버퍼 모듈에 저장하는 제1패킷 생성 모듈; 상기 패킷 헤더 및 상기 동작 제어 신호를 근거로 패킷 순서 및 CRC를 생성하고, 상기 패킷 순서, CRC, 패킷 헤더 및 동작 제어 신호를 연결하여 패킷을 생성하는 패킷 순서 및 CRC 생성 모듈; 및상기 패킷을 직렬신호로 변환하여 상기 제1전광 변환기에게로 전송하는 제1패킷 데이터 직렬화 모듈을 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
5 5
청구항 4에 있어서,상기 제1패킷 데이터 병렬화 모듈은 상기 제1전광 변환기로부터 상기 직렬신호에 대한 응답 신호를 수신하여 병렬신호로 변환하고,상기 패킷 검사 모듈은 상기 병렬신호를 근거로 패킷 수신 정보를 생성하고, 상기 패킷 순서 및 CRC 생성 모듈은 상기 패킷 수신 정보를 근거로 정상 수신 여부를 판단하여 정상 수신 신호 또는 수신 오류 신호를 생성하고,상기 제1패킷 데이터 직렬화 모듈은 상기 정상 수신 신호 또는 수신 오류 신호를 직렬신호로 변환하여 상기 제1전광 변환기에게로 전송하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
6 6
청구항 4에 있어서,상기 패킷 검사 모듈은 상기 슬레이브 광연결 프로토콜 엔진으로부터 수신한 병렬신호를 근거로 응답 신호에 포함된 패킷 헤더 및 패킷 데이터를 버퍼 모듈에 저장하고, 상기 마스터 광연결 프로토콜 엔진은,상기 버퍼 모듈에 저장된 패킷 헤더를 검출하고, 상기 패킷 헤더를 근거로 패킷 데이터를 검출하여 상기 공유캐쉬 기억장치에게로 전송하는 패킷 번역 모듈을 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
7 7
청구항 1에 있어서,상기 슬레이브 광연결 프로토콜 엔진은,상기 제2전광 변환기로부터 수신한 직렬신호를 병렬신호로 변환하는 제2패킷 데이터 병렬화 모듈; 및상기 변환된 병렬신호에 포함된 패킷 순서 및 CRC를 근거로 상기 병렬신호의 정상 수신 여부 및 중복 수신 여부를 판단하고, 정상 수신한 병렬신호들 중에서 중복 수신이 아닌 병렬신호를 상기 메모리 컨트롤러에게로 전송하는 패킷 검사 및 번역 모듈을 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
8 8
청구항 7에 있어서,상기 패킷 검사 및 번역 모듈은 상기 메모리 컨트롤러로부터 상기 동작 제어 신호에 대한 응답 신호를 수신하고,상기 슬레이브 광연결 프로토콜 엔진은,상기 응답 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 제2패킷 데이터 직렬화 모듈을 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
9 9
청구항 1에 있어서,상기 슬레이브 광연결 프로토콜 엔진은,상기 제2전광 변환기로부터 수신한 직렬신호를 병렬신호로 변환하는 제2패킷 데이터 병렬화 모듈;상기 변환된 병렬신호를 근거로 동작 제어 신호의 정상 수신 여부 및 중복 수신 여부를 판단하고, 정상 수신된 동작 제어 신호들 중에서 중복 수신이 아닌 동작 제어 신호를 상기 메모리 컨트롤러에게로 전송하는 패킷 검사 및 번역 모듈;상기 메모리 컨트롤러에서 상기 전송된 동작 제어 신호에 대응되는 데이터를 수신하여 저장하는 제2패킷 수신 데이터 버퍼 모듈;상기 제2패킷 수신 데이터 버퍼 모듈에 저장된 데이터를 근거로 패킷 순서 및 패킷 헤더를 생성하고, 상기 패킷 순서, 상기 패킷 헤더 및 상기 데이터를 근거로 CRC를 생성하여 응답 신호를 생성하는 제2패킷 생성 모듈; 및상기 제2패킷 생성 모듈에서 생성한 응답 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 제2패킷 데이터 직렬화 모듈을 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
10 10
청구항 9에 있어서,상기 패킷 검사 및 번역 모듈은 상기 제2전광 변환기로부터 수신한 병렬신호를 근거로 패킷 수신 정보를 생성하고,상기 제2패킷 생성 모듈은 상기 패킷 수신 정보를 근거로 상기 병렬신호의 정상 수신 여부를 검시하고, 상기 병렬 신호의 수신 오류시 상기 응답 신호의 재전송 요청 신호를 생성하고,상기 제2패킷 데이터 직렬화 모듈은 상기 재전송 요청 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 장치
11 11
마스터 광연결 프로토콜 엔진에 의해, 중앙처리장치의 공유캐쉬 기억장치로부터 입력되는 동작 제어 신호를 직렬신호로 변환하는 단계;제1전광 변환기에 의해, 상기 직렬신호로 변환하는 단계에서 변환된 직렬신호를 광신호로 변환하는 단계;제2전광 변환기에 의해, 상기 광신호로 변환하는 단계에서 변환된 광신호를 직렬신호로 변환하는 단계 ;슬레이브 광연결 프로토콜 엔진에 의해, 상기 직렬신호로 변환하는 단계에서 변환된 직렬신호를 동작 제어 신호로 변환하는 단계; 및메모리 컨트롤러에 의해, 상기 동작 제어 신호로 변환하는 단계에서 변환된 동작 제어 신호를 근거로 주기억장치에 액세스하는 단계를 포함하고,상기 동작 제어 신호를 직렬신호로 변환하는 단계는,상기 마스터 광연결 프로토콜 엔진에 의해, 상기 공유캐쉬 기억장치로부터 입력된 동작 제어 신호를 근거로 패킷 헤더 및 패킷 데이터를 생성하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 헤더 및 패킷 데이터를 근거로 패킷 순서 및 CRC를 생성하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 헤더, 패킷 데이터, 패킷 순서 및 CRC를 연결하여 동작 제어 패킷을 생성하는 단계; 및상기 마스터 광연결 프로토콜 엔진에 의해, 상기 동작 제어 패킷을 직렬신호로 변환하여 상기 제1전광 변환기에게로 전송하는 단계를 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
12 12
청구항 11에 있어서,상기 메모리 컨트롤러에 의해, 상기 동작 제어 신호에 따른 주기억장치의 액세스 결과를 근거로 응답 신호를 생성하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 응답 신호를 생성하는 단계에서 변환된 병렬신호를 직렬신호로 변환하는 단계;상기 제2전광 변환기에 의해, 상기 직렬신호를 광신호로 변환하는 단계;상기 제1전광 변환기에 의해, 상기 광신호를 직렬신호로 변환하는 단계; 및상기 마스터 광연결 프로토콜 엔진에 의해, 상기 직렬신호를 병렬신호로 변환하여 상기 공유캐쉬 기억장치에게로 전송하는 단계를 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
13 13
삭제
14 14
청구항 11에 있어서,상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 제2전광 변환기로부터 수신한 직렬신호를 병렬신호로 변환하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 병렬신호에 포함된 패킷 순서 및 CRC를 근거로 상기 병렬신호의 정상 수신 여부 및 중복 수신 여부를 판단하는 단계; 및,상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 판단하는 단계에서 정상 수신으로 판단한 병렬신호들 중에서 중복 수신이 아닌 것으로 판단한 병렬신호를 상기 메모리 컨트롤러에게로 전송하는 단계를 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
15 15
청구항 14에 있어서,상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 메모리 컨트롤러로부터 상기 동작 제어 신호에 대한 응답 신호를 수신하는 단계; 및상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 응답 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 단계를 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
16 16
청구항 11에 있어서,상기 마스터 광연결 프로토콜 엔진에 의해, 상기 슬레이브 광연결 프로토콜 엔진의 버퍼 모듈에 대한 상태 정보 및 자체 버퍼 모듈의 상태 정보를 관리하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 공유캐쉬 기억장치로부터 동작 제어 신호가 입력되면 상기 슬레이브 광연결 프로토콜 엔진의 버퍼 모듈에 대한 상태 정보 및 상기 자체 버퍼 모듈의 상태정보를 근거로 여유 공간 존재 여부를 판단하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 판단하는 단계에서 여유 공간이 존재하는 것으로 판단하면 상기 동작 제어 신호를 근거로 패킷 헤더를 생성하여 상기 자체 버퍼 모듈에 저장하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 헤더 및 상기 동작 제어 신호를 근거로 패킷 순서 및 CRC를 생성하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 순서, CRC, 패킷 헤더 및 동작 제어 신호를 연결하여 패킷을 생성하는 단계; 및상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷을 직렬신호로 변환하여 상기 제1전광 변환기에게로 전송하는 단계를 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
17 17
청구항 16에 있어서,상기 마스터 광연결 프로토콜 엔진에 의해, 상기 제1전광 변환기로부터 상기 직렬신호에 대한 응답 신호를 수신하여 병렬신호로 변환하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 병렬신호를 근거로 패킷 수신 정보를 생성하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 수신 정보를 근거로 정상 수신 여부를 판단하여 정상 수신 신호 또는 수신 오류 신호를 생성하는 단계; 및상기 마스터 광연결 프로토콜 엔진에 의해, 상기 정상 수신 신호 또는 수신 오류 신호를 직렬신호로 변환하여 상기 제1전광 변환기에게로 전송하는 단계를 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
18 18
청구항 17에 있어서,상기 마스터 광연결 프로토콜 엔진에 의해, 상기 슬레이브 광연결 프로토콜 엔진으로부터 수신한 병렬신호를 근거로 응답 신호에 포함된 패킷 헤더 및 패킷 데이터를 버퍼 모듈에 저장하는 단계;상기 마스터 광연결 프로토콜 엔진에 의해, 상기 저장된 패킷 헤더를 검출하는 단계; 및상기 마스터 광연결 프로토콜 엔진에 의해, 상기 패킷 헤더를 근거로 패킷 데이터를 검출하여 상기 공유캐쉬 기억장치에게로 전송하는 단계를 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
19 19
청구항 11에 있어서,상기 동작 제어 신호로 변환하는 단계는,상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 제2전광 변환기로부터 수신한 직렬신호를 병렬신호로 변환하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 변환된 병렬신호를 근거로 동작 제어 신호의 정상 수신 여부 및 중복 수신 여부를 판단하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 판단하는 단계에서 정상 수신으로 판단한 동작 제어 신호들 중에서 중복 수신이 아닌 것으로 판단한 동작 제어 신호를 상기 메모리 컨트롤러에게로 전송하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 메모리 컨트롤러로부터 상기 전송된 동작 제어 신호에 대응되는 데이터를 수신하여 저장하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 저장된 데이터를 근거로 패킷 순서 및 패킷 헤더를 생성하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 패킷 순서, 상기 패킷 헤더 및 상기 데이터를 근거로 CRC를 생성하여 응답 신호를 생성하는 단계; 및상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 응답 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 단계를 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
20 20
청구항 19에 있어서,상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 제2전광 변환기로부터 수신한 병렬신호를 근거로 패킷 수신 정보를 생성하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 패킷 수신 정보를 근거로 상기 병렬신호의 정상 수신 여부를 검시하는 단계;상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 정상 수신 여부를 검시하는 단계에서 상기 병렬 신호의 수신 오류로 판단하면 상기 응답 신호의 재전송 요청 신호를 생성하는 단계; 및상기 슬레이브 광연결 프로토콜 엔진에 의해, 상기 재전송 요청 신호를 직렬신호로 변환하여 상기 제2전광 변환기에게로 전송하는 단계를 더 포함하는 것을 특징으로 하는 중앙처리장치와 주기억장치의 인터페이스 방법
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2 US9379824 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 산업원천기술개발사업(ETRI연구개발지원사업) 실리콘 나노포토닉스 기반 차세대 컴퓨터 칩기술