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네트워크계층 및 전송계층 프로토콜 이중화를 위한 패킷전달방법

  • 기술번호 : KST2015096964
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 이중화된 프로세서 보드를 갖는 통신 프로토콜 기반의 통신장비에서 패킷의 전달을 담당하는 네트워크 계층(L3)과 전송계층(L4) 프로토콜 이중화를 위한 패킷 전달방법에 관한 것이다.이를 위한 본 발명은, 활성 프로세서 보드 및 대기 프로세서 보드로 이중화된 OSI 모델 구조의 통신 프로토콜 기반 통신장비에서 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법에 있어서, 상기 활성 프로세서 보드에서 각 계층별 헤더 정보를 갖는 패킷을 제1 물리계층(L1)을 통해 수신하는 패킷수신단계; 상기 활성 프로세서 보드의 가상 인터페이스에서 상기 수신된 패킷을 복사하여, 제1 패킷은 대기 프로세서 보드의 가상 인터페이스로 전달하고, 제2 패킷은 데이터링크계층(L2)의 헤더를 제거한 후 상위 프로토콜 스택으로 전송하는 제1패킷전송단계; 및상기 대기 프로세서 보드의 가상 인터페이스에서 상기 전송된 제1패킷으로부터 데이터링크계층(L2)의 헤더를 제거한 후, 상위 프로토콜 스택으로 전송하는 제2패킷전송단계를 포함한다.본 발명에 의하면, 활성 프로세서 보드의 상위 프로토콜 스택과 대기 프로세서 보드의 상위 프로토콜 스택이 같은 수행 과정을 동시에 진행할 수 있고, 대기/활성이 절체되는 과정에서 연결이 계속적으로 유지될 수 있다. 프로토콜, 네트워크계층, 전송계층, 이중화, 패킷, 활성화, 대기, 가상 인터페이스, 상위 프로토콜 스택, 절체
Int. CL H04L 12/24 (2014.01) H04L 29/06 (2014.01) H04L 12/70 (2014.01)
CPC H04L 69/321(2013.01) H04L 69/321(2013.01) H04L 69/321(2013.01)
출원번호/일자 1020020073075 (2002.11.22)
출원인 한국전자통신연구원
등록번호/일자 10-0456461-0000 (2004.11.01)
공개번호/일자 10-2004-0045072 (2004.06.01) 문서열기
공고번호/일자 (20041110) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.11.22)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 임성용 대한민국 경상북도경주
2 박재우 대한민국 대전광역시유성구
3 김성혜 대한민국 대전광역시유성구
4 김봉수 대한민국 대전광역시유성구
5 이규호 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 특허법인씨엔에스 대한민국 서울 강남구 언주로 **길 **, 대림아크로텔 *층(도곡동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2002.11.22 수리 (Accepted) 1-1-2002-0386267-86
2 선행기술조사의뢰서
Request for Prior Art Search		 2004.07.09 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2004.08.18 수리 (Accepted) 9-1-2004-0050038-24
4 등록결정서
Decision to grant		 2004.10.28 발송처리완료 (Completion of Transmission) 9-5-2004-0454017-23
5 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

활성 프로세서 보드 및 대기 프로세서 보드로 이중화된 OSI 모델 구조의 통신 프로토콜 기반 통신장비에서 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법에 있어서,

상기 활성 프로세서 보드에서 각 계층별 헤더 정보를 갖는 패킷을 제1 물리계층(L1)을 통해 수신하는 패킷수신단계;

상기 활성 프로세서 보드의 가상 인터페이스에서 상기 수신된 패킷을 복사하여, 제1 패킷은 대기 프로세서 보드의 가상 인터페이스로 전달하고, 제2 패킷은 데이터링크계층(L2)의 헤더를 제거한 후 상위 프로토콜 스택으로 전송하는 제1패킷전송단계; 및

상기 대기 프로세서 보드의 가상 인터페이스에서 상기 전송된 제1패킷으로부터 데이터링크계층(L2)의 헤더를 제거한 후, 상위 프로토콜 스택으로 전송하는 제2패킷전송단계를 포함하는 것을 특징으로 하는 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법

2 2

제 1항에 있어서,

상기 대기 프로세서 보드의 가상 인터페이스와 상기 활성 프로세서 보드의 가상 인터페이스는 상호 동일한 MAC 어드레스 및 동일한 IP 어드레스를 갖는 것을 특징으로 하는 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법

3 3

제 1항에 있어서, 상기 가상 인터페이스는,

운영체제에 존재하는 데이터링크계층(L2) 프로토콜 상에서 패킷의 경로를 설정하는 것을 특징으로 하는 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법

4 4

제 1항에 있어서, 상기 제1 패킷은,

상기 활성 프로세서 보드의 제2 물리계층(L1) 및 상기 대기 프로세서 보드의 제3 물리계층(L1) 간에 연결된 이중화 이더넷 라인을 통해 상기 대기 프로세서 보드의 가상 인터페이스로 전달되는 것을 특징으로 하는 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법

5 5

제 1항에 있어서, 상기 제2패킷전송단계는,

상기 대기 프로세서 보드의 가상 인터페이스는 외부망으로 전달되는 패킷을 삭제하는 단계를 더 포함하는 것을 특징으로 하는 네트워크계층 및 전송계층 이중화를 위한 패킷 전달방법

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.