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데이타전송능력을개선한디.엠.에이컨트롤러

  • 기술번호 : KST2015099415
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 DMA 컨트롤러에 관한 것으로, 어드레스 통로를 분리하여 DMA 컨트롤러가 양쪽 메모리에 동시에 접근하게 하므로써 데이타의 전송능력을 개선시킨 DMA 컨트롤러에 관한 것이다.상기 DMA 컨트롤러는 시스템 메모리 어드레스를 카운트하는 레지스터(14)와 데이타 버퍼 메모리 어드레스 카운트 레지스터(15)가 각각 공통의 버스에 연결되어 있다. 그리고 DMA 컨트를러의 동작을 제어하는 제어 레지스터(11)와, 에러 상태등을 저장하는 상태 레지스터(10)와, 데이타 전송도중 오류발생시 DMA 컨트롤러가 독립적으로 재시도를 행하기 위하여 초기값을 저장하는 임시 레지스터들(7, 8, 9)이 스텍구조를 이루고 워드를 카운트 하는 레지스터(13)가 공통의 버스에 연결되어 있고, 프로세서(I)와 정합되어 있고 데이타 버퍼(5)를 제어하고 내부상태 천이 제어및 필요한 신호를 생성하는 제어로직이 있다.상기한 구성에 의한 본 발명은 DMA 컨트롤러가 양쪽 메모리에 동시에 접근하여 많은 양의 정보의 데이타를 짧은 시간에 전송하고, 에러발생시 독자적으로 재시도를 할 수 있고, 데이타 버퍼를 DMA 컨트롤러와 분리하여 데이타 전송 쪽을 가변적이 되도록 하였다.
Int. CL G06F 13/28 (2006.01)
CPC G06F 13/28(2013.01) G06F 13/28(2013.01)
출원번호/일자 1019930027857 (1993.12.15)
출원인 한국전자통신연구원
등록번호/일자 10-0096234-0000 (1996.02.27)
공개번호/일자 10-1995-0020095 (1995.07.24) 문서열기
공고번호/일자 1019950014186 (19951122) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1993.12.15)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김중배 대한민국 대전직할시서구
2 이상민 대한민국 대전직할시유성구
3 김성국 대한민국 대전직할시서구
4 한순섭 대한민국 서울특별시영등포구
5 안희일 대한민국 대전직할시유성구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전직할시유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent		 1993.12.15 수리 (Accepted) 1-1-1993-0140331-84
2 출원심사청구서
Request for Examination		 1993.12.15 수리 (Accepted) 1-1-1993-0140332-29
3 특허출원서
Patent Application		 1993.12.15 수리 (Accepted) 1-1-1993-0140330-38
4 대리인사임신고서
Notification of resignation of agent		 1994.02.22 수리 (Accepted) 1-1-1993-0140333-75
5 출원공고결정서
Written decision on publication of examined application		 1995.10.30 발송처리완료 (Completion of Transmission) 1-5-1993-0065850-68
6 등록사정서
Decision to grant		 1996.02.22 발송처리완료 (Completion of Transmission) 1-5-1993-0065851-14
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

중앙처리장치(1), 데이타를 저장하는 메모리(2), 상기 메모리(2)에 직접 데이타를 전송하는 DMA 컨트롤러(3), 데이타를 입력시키고 출력시키는 입출력 프로세서(3)가 시스템 버스에 공통으로 연결되는 컴퓨터 시스템에 있어서, 상기 시스템 버스에 접근하기 위하여 어드레스를 저장하고 카운트하는 시스템 메모리 어드레스 카운트 레지스터(14)와, 상기 테이타 버퍼 메모리에 접근하기 위하여 어드레스를 저장하고 카운트하는 데이타 버퍼 메모리 어드레스 카운트 레지스터(15)와, 상기 메모리(2)에 전송할 데이타량을 제어하기 위하여 워드를 저장하고 카운트하는 워드 카운트 레지스터(13)와, 상기 DMA 컨트롤러의 동작을 제어하는 제어 레지스터(11)와, 상기 DMA 컨트롤러가 데이타 전송시 발생하는 에러 상태를 저장하는 상태 레지스터(10)와, 상기 에러가 발생시 상기 프로세서(1)의 간섭없이 재시도를 하기 위한 임시 레지스터인 워드 레지스터(7), 데이타 버퍼 메모리 어드레스 레지스터(8), 시스템 메모리 어드레스 레지스터(9)와, 상기 프로세서(1)와 정합되어 있는 제어로직(12)으로 구성되어 있는 것을 특징으로 하는 데이타 전송능력을 개선한 DMA 컨트롤러

2 2

제1항에 있어서, 데이타 전송도중 에러가 발생하여 재시도를 할 때, 상기 제어 레지스터(11)에 카운트레지스터를 구비하여 테이타 전송을 처음부터 다시 재시도하는 것을 특징으로 하는 데이타 전송능력을 개선한 DMA 컨트롤러

3 3

제2항에 있어서, 상기 재시도를 위한 초기값은 어드레스와 워드 카운터의 임시 레지스터를 이용하는 것을 특징으로 하는 데이타 전송능력을 개선한 DMA 컨트롤러

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제1항에 있어서, 데이타 버퍼(5)를 DMA 컨트롤러와 분리하여 데이타 전송폭이 가변적이 되는 것을 특징으로 하는 데이타 전송능력을 개선한 DMA 컨트롤러

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.