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프로세서간 통신을 위한 인터럽트 중계 장치 및 방법

  • 기술번호 : KST2015099802
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 ARM 프로세서 코어를 두 개 이상 사용하는 시스템 온 칩(System on-Chip : SoC)에서 마스터 프로세서(master processor)가 슬레이브 프로세서(slave processor)에게 인터럽트(interrupt)를 중계하는 장치 및 방법에 관한 것이다. 본 발명은 복수개의 ARM 프로세서를 사용하는 시스템 온 칩 설계에서 마스터 프로세서로 지정된 프로세서가 벡터 인터럽트 제어부(400)로부터 받은 인터럽트를 슬레이브 프로세서에게 재전송할 수 있는 하드웨어를 제공하여 인터럽트 분배를 가능하게 하고, 동 하드웨어를 사용하여 프로세서간 통신을 제공하여 궁극적으로 ARM 프로세서 기반형 멀티프로세서 구현을 가능하게 한다.
Int. CL G06F 13/24 (2006.01)
CPC
출원번호/일자 1020010078194 (2001.12.11)
출원인 한국전자통신연구원
등록번호/일자 10-0456630-0000 (2004.11.01)
공개번호/일자 10-2003-0047544 (2003.06.18) 문서열기
공고번호/일자 (20041110) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2001.12.11)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박경 대한민국 대전광역시서구
2 모상만 대한민국 대전광역시유성구
3 김용연 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 장성구 대한민국 서울특별시 서초구 마방로 ** (양재동, 동원F&B빌딩)(제일특허법인(유))
2 김원준 대한민국 서울특별시 서초구 마방로 ** (양재동, 동원F&B빌딩)(제일특허법인(유))

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2001.12.11 수리 (Accepted) 1-1-2001-0326770-11
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
3 선행기술조사의뢰서
Request for Prior Art Search		 2003.08.08 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2003.09.15 수리 (Accepted) 9-1-2003-0040625-02
5 의견제출통지서
Notification of reason for refusal		 2003.11.29 발송처리완료 (Completion of Transmission) 9-5-2003-0480370-45
6 지정기간연장신청서
Request for Extension of Designated Period		 2004.01.27 수리 (Accepted) 1-1-2004-0031048-37
7 지정기간연장신청서
Request for Extension of Designated Period		 2004.02.27 수리 (Accepted) 1-1-2004-0081129-43
8 명세서 등 보정서
Amendment to Description, etc.		 2004.03.29 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2004-0129231-17
9 의견서
Written Opinion		 2004.03.29 수리 (Accepted) 1-1-2004-0129232-52
10 등록결정서
Decision to grant		 2004.08.31 발송처리완료 (Completion of Transmission) 9-5-2004-0358591-89
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

다수의 ARM 프로세서와 각 프로세서의 제어를 받아 특정 기능을 수행하는 하드웨어에서 발생하는 인터럽트와 주변 하드웨어에서 발생하는 인터럽트를 수신하여 마스터 프로세서로 지정된 프로세서의 인터럽트 요청 신호로 전달하는 벡터 인터럽트 제어부를 구비하는 ARM 프로세서 기반 멀티 프로세서 시스템에 있어서,

상기 마스터 프로세서에 의해서 수신된 인터럽트를 슬레이브 프로세서로 지정된 프로세서에게 재전송하기 위해서, 버스 정합 장치를 통하여 인터럽트 재전송 명령을 수신하여 슬레이브 프로세서에 연결된 인터럽트 요청 신호를 구동하는 기능을 수행하기 위하여 인터럽트 목적지 및 종류를 지정하는 인터럽트 명령 레지스터와,

인터럽트 내용을 지정하는 인터럽트 데이터 레지스터와,

상기 인터럽트 명령 레지스터의 내용을 판독하여 특정 프로세서에 연결된 "FIQ" 인터럽트 요청 신호를 구동하는 인터럽트 신호 발생부와,

상기 인터럽트 명령 레지스터와 상기 인터럽트 데이터 레지스터의 읽기 및 쓰기 접근을 위한 버스 정합 장치

를 포함하는 것을 특징으로 하는 프로세서간 인터럽트 중계 장치

2 2

다수의 ARM 프로세서와 각 프로세서의 제어를 받아 특정 기능을 수행하는 하드웨어에서 발생하는 인터럽트와 주변 하드웨어에서 발생하는 인터럽트를 수신하여 마스터 프로세서로 지정된 프로세서의 인터럽트 요청 신호로 전달하는 벡터 인터럽트 제어부를 구비하는 ARM 프로세서 기반 멀티 프로세서 시스템에 있어서,

임의의 두 프로세서간에 메시지 전송을 위하여, 버스 정합장치를 통하여 송신 프로세서로부터 메시지 전송 명령을 수신하여 수신 프로세서에 연결된 인터럽트 요청 신호를 구동하는 기능을 수행하기 위하여 인터럽트 목적지 및 종류를 지정하는 인터럽트 명령 레지스터와,

인터럽트 내용을 지정하는 인터럽트 데이터 레지스터와,

상기 인터럽트 명령 레지스터의 내용을 판독하여 특정 프로세서에 연결된 "FIQ" 인터럽트 요청 신호를 구동하는 인터럽트 신호 발생부와,

상기 인터럽트 명령 레지스터와 상기 인터럽트 데이터 레지스터의 읽기 및 쓰기 접근을 위한 버스 정합 장치

를 포함하는 것을 특징으로 하는 프로세서간 인터럽트 중계 장치

3 3

제 1 항 또는 제 2 항에 있어서,

상기 인터럽트 명령 레지스터는, 32비트 레지스터로 구성되어 있으며,

인터럽트 중계 또는 요청 목적지 프로세서를 지정하는 DID[3:0] 필드와,

미사용 필드와,

인터럽트 중계 요청과 프로세서간 통신 요청인지를 구분하는 클래스 필드와,

인터럽트가 처리중인지의 여부를 표현하는 펜드 필드

를 포함하는 것을 특징으로 하는 프로세서간 인터럽트 중계 장치

4 4

제 3 항에 있어서,

상기 펜드 필드는, 인터럽트를 요청하는 프로세서에 의해서 "1"로 세트되고, 인터럽트를 수신한 프로세서에 의해서 "0"으로 클리어되는 것을 특징으로 하는 프로세서간 인터럽트 중계 장치

5 5

제 1 항 또는 제 2 항에 있어서,

상기 인터럽트 데이터 레지스터는, 32비트 레지스터로 구성되어 인터럽트 중계시에는 인터럽트 내용 전달용으로 사용되고, 프로세서간 통신시에는 고정된 크기의 메시지 시작주소 전달용으로 사용되는 것을 특징으로 하는 프로세서간 인터럽트 중계 장치

6 6

다수의 ARM 프로세서와 각 프로세서의 제어를 받아 특정 기능을 수행하는 하드웨어에서 발생하는 인터럽트와 주변 하드웨어에서 발생하는 인터럽트를 수신하여 마스터 프로세서로 지정된 프로세서의 인터럽트 요청 신호로 전달하는 벡터 인터럽트 제어부를 구비하는 인터럽트 중계 방법에 있어서,

상기 마스터 프로세서가 상기 벡터 인터럽트 제어부로부터 발생된 인터럽트를 인터럽트 중계부를 사용하여 슬레이브 프로세서로 지정된 프로세서로 전달하는 단계에는,

상기 마스터 프로세서가 상기 벡터 인터럽트 제어부로부터 인터럽트를 수신하는 제 411 단계와,

상기 마스터 프로세서가 상기 수신된 인터럽트에 대응하는 인터럽트 서비스 루틴으로 점프하는 제 412 단계와,

상기 마스터 프로세서가 상기 벡터 인터럽트 제어부의 인터럽트 상태 레지스터를 읽는 제 413 단계와,

상기 마스터 프로세서가 상기 읽은 인터럽트 상태 레지스터의 내용을 분석하는 제 414 단계와,

상기 마스터 프로세서는 상기 분석 결과에 따라 수신된 인터럽트가 마스터용인지 슬레이브용인지를 판단하는 제 415 단계와,

상기 단계 415의 판단 결과, 상기 마스터 프로세서는 상기 수신된 인터럽트가 슬레이브용 인터럽트일 경우 상기 인터럽트 중계부로 전송할 인터럽트 명령 레지스터 내용을 준비하는 제 417 단계와,

상기 마스터 프로세서가 상기 인터럽트 중계부의 인터럽트 명령 레지스터를 읽어서 펜드 필드를 검사하는 제 418 단계와,

상기 마스터 프로세서는 상기 인터럽트 중계부가 휴지 상태이면 상기 인터럽트 명령 레지스터에 인터럽트 중계 명령을 쓰기 동작으로 처리하는 제 419 단계와,

상기 마스터 프로세서가 인터럽트 데이터 레지스터에 상기 벡터 인터럽트 제어부의 인터럽트 상태 레지스터의 내용을 쓰는 제 420 단계와,

상기 마스터 프로세서가 상기 인터럽트 명령 레지스터의 펜드 필드를 주기적으로 검사하여 요청한 인터럽트가 상기 슬레이브 프로세서에 의해 수신되었는지 여부를 확인하는 제 421 단계와,

상기 마스터 프로세서가 상기 인터럽트 서비스 루틴을 탈출하는 제 422 단계와,

상기 단계 415의 판단 결과, 상기 마스터 프로세서는 상기 수신된 인터럽트가 마스터용 인터럽트일 경우 해당 인터럽트를 처리하는 서비스 루틴으로 분기하여 인터럽트를 처리하고 상기 단계 422를 수행하는 제 416 단계를 포함하며,

상기 마스터 프로세서의 인터럽트 중계 요청에 따라 상기 인터럽트 중계부를 통하여 상기 슬레이브 프로세서에게 FIQ 인터럽트를 요청하는 경우 상기 슬레이브 프로세서가 중계된 인터럽트를 처리하는 단계에는,

상기 슬레이브 프로세서가 상기 인터럽트 중계부로부터 FIQ를 수신하는 제 431 단계와,

상기 슬레이브 프로세서가 FIQ 서비스 루틴으로 점프하는 제 432 단계와,

상기 슬레이브 프로세서가 상기 인터럽트 명령 레지스터를 읽는다 제 433 단계와,

상기 슬레이브 프로세서가 상기 인터럽트 데이터 레지스터를 읽는 제 434 단계와,

상기 슬레이브 프로세서가 읽어온 인터럽트 명령 레지스터에서 클래스 필드를 검사하여 해당 인터럽트가 인터럽트 중계에 의한 것인지 프로세서간 통신에 의한 것인지를 판단하는 제 435 단계와,

상기 슬레이브 프로세서는 판단 결과, 인터럽트 중계에 의한 경우 중계 인터럽트 수신 루틴으로 분기하는 제 437 단계와,

상기 슬레이브 프로세서가 상기 인터럽트 명령 레지스터의 펜드 필드를 0으로 클리어하여 인터럽트를 정상적으로 수신했음을 알리는 제 438 단계와,

상기 슬레이브 프로세서가 해당 인터럽트의 근원지를 분석하는 제 439 단계와,

상기 슬레이브 프로세서가 상기 근원지 분석 결과에 대응하는 인터럽트 서비스 루틴으로 분기하는 제 440 단계와,

상기 슬레이브 프로세서가 상기 인터럽트 서비스 루틴을 탈출하는 제 441 단계와,

상기 슬레이브 프로세서는 상기 단계 435의 판단 결과, 프로세서간 통신 요청에 의한 인터럽트로 판명되면 프로세서간 통신 처리 루틴으로 분기하고 상기 단계 411를 수행하는 제 436 단계

를 포함하는 것을 특징으로 하는 프로세서간 인터럽트 중계 방법

7 7

다수의 ARM 프로세서와 각 프로세서의 제어를 받아 특정 기능을 수행하는 하드웨어에서 발생하는 인터럽트와 주변 하드웨어에서 발생하는 인터럽트를 수신하여 마스터 프로세서로 지정된 프로세서의 인터럽트 요청 신호로 전달하는 벡터 인터럽트 제어부를 구비하는 인터럽트 중계 방법에 있어서,

상기 마스터 프로세서인 임의의 송신 프로세서에서 상기 슬레이브 프로세서인 임의의 수신 프로세서로 인터럽트 중계부를 사용하여 메시지를 전송하는 단계에는,

상기 송신 프로세서가 기 설정된 공유 메모리 영역에 고정된 크기를 갖는 송신 메시지를 준비하는 제 530 단계와,

상기 송신 프로세서가 상기 인터럽트 중계부에 프로세서간 통신 요구를 의뢰하기 위해서 프로세서간 통신 명령을 지정하는 인터럽트 명령 및 레지스터용 명령에 대응하는 내용을 준비하는 제 531 단계와,

상기 송신 프로세서가 상기 인터럽트 데이터 레지스터용 메시지 시작 주소를 준비하는 제 532 단계와,

상기 송신 프로세서가 상기 인터럽트 중계부의 인터럽트 명령 레지스터의 펜드 필드를 검사하는 제 533 단계와,

상기 송신 프로세서는 펜드 필드의 검사 결과, 상기 인터럽트 중계부가 가용하면, 상기 인터럽트 중계부의 인터럽트 데이터 레지스터에 쓰기 동작을 통해서 통신 요구를 발생시키는 제 534 단계와,

상기 송신 프로세서가 메시지 시작 주소를 전달하기 위하여 상기 인터럽트 데이터 레지스터에 쓰기 동작을 수행하는 제 535 단계와,

상기 송신 프로세서가 상기 인터럽트 명령 레지스터의 펜드 필드를 주기적으로 검사하여 수신 프로세서가 메시지를 수신했는지 여부를 확인하는 제 536 단계와,

상기 송신 프로세서는 상기 수신 프로세서가 메시지를 수신했음을 확인하는 경우 메시지 전송을 완료 처리하는 제 537 단계를 포함하며,

상기 수신 프로세서의 수신 처리 단계에는,

상기 수신 프로세서가 상기 인터럽트 중계부로부터 FIQ 인터럽트를 수신하는 제 550 단계와,

상기 수신 프로세서가 FIQ 서비스 루틴으로 점프하는 제 551 단계와,

상기 수신 프로세서가 상기 인터럽트 명령 레지스터를 읽는 제 552 단계와,

상기 수신 프로세서가 상기 인터럽트 데이터 레지스터를 읽는 제 553 단계와,

상기 수신 프로세서가 읽어온 상기 인터럽트 명령 레지스터에서 클래스 필드를 검사하여 해당 인터럽트가 인터럽트 중계에 의한 것인지 프로세서간 통신에 의한 것인지를 판단하는 제 554 단계와,

수신 프로세서의 판단 결과, 프로세서간 통신 요청에 의한 인터럽트이면 프로세서간 통신 처리 루틴으로 분기하는 제 556 단계와,

수신 프로세서에서 인터럽트 데이터 레지스터를 통해서 전달된 메시지 시작 주소를 사용하여 메시지를 수신하는 제 557 단계와,

상기 수신 프로세서가 메시지를 수신했음을 상기 송신 프로세서에게 알리기 위해서 상기 인터럽트 명령 레지스터의 펜드 필드를 "0"으로 클리어하는 제 558 단계와,

상기 수신 프로세서가 상기 인터럽트 서비스 루틴을 탈출하는 제 559 단계와,

수신 프로세서는 상기 단계 554의 판단 결과, 인터럽트 중계에 의한 인터럽트이면 중계 인터럽트 수신 루틴으로 분기하고 상기 단계 559를 수행하는 제 555 단계

를 포함하는 것을 특징으로 하는 프로세서간 인터럽트 중계 방법

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