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단일 증폭기 아키텍처를 이용한 타임 인터리브 시그마-델타변조기

  • 기술번호 : KST2015125129
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 단일 증폭기 아키텍처를 이용하여 스테이지마다 증폭기 하나로 기존 전달함수를 유지하게 하는 타임 인터리브 시그마-델타 변조기에 관한 것이다. 본 발명은 시그마-델타 변조기에 있어서, 외부에서 입력되는 신호, 양자화된 후 피드백되는 신호 및 양자화 없이 피드백되는 신호들을 가산한 신호를 합산 증폭하는 합산부; 합산부가 출력한 신호를 일정 클럭만큼 지연시키고, 일정 계수만큼 곱셈하며, 입력되는 값을 가산하여 합산부에 양자화 없이 피드백되는 신호로써 제공하는 하나 이상의 적분부; 합산부가 출력한 신호를 양자화시키는 양자화부; 및 양자화부가 출력한 신호를 지연시켜 양자화된 후 피드백되는 신호로써 제공하는 클럭 지연부를 포함하는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기를 제공한다. 본 발명에 의하면, 유효 샘플링 주파수를 높여서 높은 동적 범위의 변조기를 구현할 수 있으면서도 부피는 대폭 감소되며, 저전력 설계구현이 가능하게 된다. 시그마-델타 변조기(Sigma-delta modulator), 타임 인터리브(Time-interleaved), A/D 컨버터, 로우패스(Low-pass), 밴드패스(Band-pass), 단일 증폭기 아키텍처(Single amplifier architecture)
Int. CL H03M 3/02 (2006.01)
CPC H03M 3/392(2013.01) H03M 3/392(2013.01) H03M 3/392(2013.01) H03M 3/392(2013.01)
출원번호/일자 1020070140028 (2007.12.28)
출원인 연세대학교 산학협력단
등록번호/일자 10-0933280-0000 (2009.12.14)
공개번호/일자 10-2009-0072053 (2009.07.02) 문서열기
공고번호/일자 (20091222) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.12.28)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 채영철 대한민국 서울 서대문구
2 이인희 대한민국 서울 마포구
3 권민호 대한민국 서울 서대문구
4 한건희 대한민국 경기 고양시 덕양구

대리인

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번호 이름 국적 주소
1 특허법인우인 대한민국 서울특별시 강남구 역삼로 ***, *층(역삼동, 중평빌딩)

최종권리자

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2007.12.28 수리 (Accepted) 1-1-2007-0944004-13
2 선행기술조사의뢰서
Request for Prior Art Search		 2009.02.04 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2009.03.18 수리 (Accepted) 9-1-2009-0018394-06
4 의견제출통지서
Notification of reason for refusal		 2009.05.29 발송처리완료 (Completion of Transmission) 9-5-2009-0230119-78
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.07.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0458994-24
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.07.27 수리 (Accepted) 1-1-2009-0458972-20
7 등록결정서
Decision to grant		 2009.11.27 발송처리완료 (Completion of Transmission) 9-5-2009-0490695-75
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.12.15 수리 (Accepted) 4-1-2011-5252006-10
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.04.24 수리 (Accepted) 4-1-2013-5062749-37
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.06.24 수리 (Accepted) 4-1-2013-5088566-87
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.09.25 수리 (Accepted) 4-1-2014-5114224-78
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
위상이 다른 클럭을 사용하는 스테이지로부터 입력된 지연 신호에 일정 계수를 곱하는 계수부 및 상기 곱셈된 값과 상기 계수부에 대하여 병렬 구성된 다른 계수부가 도출한 값을 가산시키는 가산부를 포함하며, 상기 가산된 값을 담은 신호를 제1 신호로 출력시키는 적분부; 수신 신호를 지연시키며, 상기 지연된 신호를 제2 신호로 출력시키는 클럭 지연부; 상기 제1 신호, 상기 제2 신호 및 외부로부터 입력되는 제3 신호를 합산 증폭시키는 합산부; 상기 합산 증폭된 신호를 양자화시키는 양자화부; 및 상기 양자화된 신호를 외부로 출력시키며, 상기 양자화된 신호 중에서 일부 신호를 상기 클럭 지연부에 상기 수신 신호로 피드백시키는 출력부 를 포함하며, 시그마-델타 변조기에 구비되는 상기 적분부의 총 개수는 상기 시그마-델타 변조기의 차수와 동일하며, 적어도 두개인 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
2 2
삭제
3 3
제 1 항에 있어서, 상기 적분부가 곱셈시 사용하는 상기 일정 계수는 (-1)k+1nCk(여기에서, n은 상기 타임 인터리브 시그마-델타 변조기의 차수이고, k는 상기 적분부의 해당 순번)에서 도출되는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
4 4
제 1 항에 있어서, 상기 클럭 지연부는 상기 양자화부가 출력한 신호를 (여기에서, N은 상기 타임 인터리브 시그마-델타 변조기의 차수)만큼 지연시키는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
5 5
제 1 항에 있어서, 상기 합산부에서 상기 양자화부로 이어지는 경로 또는 상기 양자화부에서 상기 클럭 지연부로 이어지는 경로에는 1-지연기(Z-1)가 구비되는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
6 6
제 5 항에 있어서, 상기 합산부에서 상기 양자화부로 이어지는 경로에 상기 1-지연기가 구비되는 경우, 상기 1-지연기로부터 입력된 지연 신호에 미리 정해진 계수를 곱하며 상기 곱셈된 값을 담은 신호를 상기 제1 신호에 가산시키는 최상위 적분부를 더 포함하는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
7 7
제 5 항에 있어서, 상기 양자화부에서 상기 클럭 지연부로 이어지는 경로에 상기 1-지연기가 구비되는 경우, 상기 합산부로부터 입력된 신호를 미리 정해진 값만큼 지연시키고 미리 정해진 계수를 곱하며 상기 곱셈된 값을 담은 신호가 상기 제1 신호에 가산되도록 출력시키는 최하위 적분부를 더 포함하는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
8 8
제 7 항에 있어서, 상기 최하위 적분부는 상기 합산부로부터 입력된 신호를 지연시키기 위한 상기 미리 정해진 값으로 상기 시그마-델타 변조기의 차수를 이용하는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
9 9
제 1 항에 있어서, 상기 타임 인터리브 시그마-델타 변조기는 로우패스 형태 또는 밴드패스 형태로 형성되는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
10 10
제 9 항에 있어서, 상기 타임 인터리브 시그마-델타 변조기가 밴드패스 형태일 경우 홀수패스로 구현되는 것을 특징으로 하는 타임 인터리브 시그마-델타 변조기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.