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직렬 변환기 및 그를 포함한 데이터 송신 장치
- 기술번호 : KST2015126820
- 담당센터 : 서울서부기술혁신센터
- 전화번호 : 02-6124-6930
| 요약 | 본 발명은 직렬 변환기 및 그를 포함한 데이터 송신 장치에 관한 것이다. 본 발명의 일 실시예에 따른 직렬 변환기는, 복수의 데이터 신호들을 기 결정된 위상 간격으로 정렬하는 데이터 신호 정렬부; 상기 정렬된 데이터 신호들 간 논리 레벨의 천이를 검출하여 상기 논리 레벨의 천이 시 토글 신호를 생성하는 천이 검출부; 및 상기 토글 신호를 상기 데이터 신호들을 직렬화한 직렬 데이터 신호로 변환하는 토글 신호 변환부;를 포함할 수 있다. |
|---|---|
| Int. CL | H03M 9/00 (2006.01) H04L 25/03 (2006.01) |
| CPC | H03M 9/00(2013.01) H03M 9/00(2013.01) H03M 9/00(2013.01) |
| 출원번호/일자 | 1020140177594 (2014.12.10) |
| 출원인 | 연세대학교 산학협력단 |
| 등록번호/일자 | 10-1543704-0000 (2015.08.05) |
| 공개번호/일자 | |
| 공고번호/일자 | (20150812) 문서열기 |
| 국제출원번호/일자 | |
| 국제공개번호/일자 | |
| 우선권정보 | |
| 법적상태 | 등록 |
| 심사진행상태 | 수리 |
| 심판사항 | |
| 구분 | 신규 |
| 원출원번호/일자 | |
| 관련 출원번호 | |
| 심사청구여부/일자 | Y (2014.12.10) |
| 심사청구항수 | 27 |
출원인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 연세대학교 산학협력단 | 대한민국 | 서울특별시 서대문구 |
발명자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 최우영 | 대한민국 | 서울특별시 마포구 |
| 2 | 김성근 | 대한민국 | 경기도 고양시 일산동구 |
대리인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 권혁수 | 대한민국 | 서울특별시 강남구 언주로 ***, *층(삼일빌딩, 역삼동)(KS고려국제특허법률사무소) |
| 2 | 송윤호 | 대한민국 | 서울특별시 강남구 언주로 *** (역삼동) *층(삼일빌딩)(케이에스고려국제특허법률사무소) |
최종권리자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 연세대학교 산학협력단 | 대한민국 | 서울특별시 서대문구 |
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 [Patent Application] Patent Application |
2014.12.10 | 수리 (Accepted) | 1-1-2014-1201402-65 |
| 2 | [대리인사임]대리인(대표자)에 관한 신고서 [Resignation of Agent] Report on Agent (Representative) |
2015.01.20 | 수리 (Accepted) | 1-1-2015-0060422-60 |
| 3 | [우선심사신청]심사청구(우선심사신청)서 [Request for Preferential Examination] Request for Examination (Request for Preferential Examination) |
2015.03.20 | 수리 (Accepted) | 1-1-2015-0272739-99 |
| 4 | [우선심사신청]선행기술조사의뢰서 [Request for Preferential Examination] Request for Prior Art Search |
2015.03.24 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 5 | [우선심사신청]선행기술조사보고서 [Request for Preferential Examination] Report of Prior Art Search |
2015.04.07 | 수리 (Accepted) | 9-1-2015-0021630-55 |
| 6 | 등록결정서 Decision to grant |
2015.07.30 | 발송처리완료 (Completion of Transmission) | 9-5-2015-0511261-19 |
| 번호 | 청구항 |
|---|---|
| 1 |
1 복수의 데이터 신호들을 기 결정된 위상 간격으로 정렬하는 데이터 신호 정렬부;상기 정렬된 데이터 신호들 간 논리 레벨의 천이를 검출하여 상기 논리 레벨의 천이 시 토글 신호를 생성하는 천이 검출부; 및상기 토글 신호를 상기 데이터 신호들을 직렬화한 직렬 데이터 신호로 변환하는 토글 신호 변환부;를 포함하는 직렬 변환기 |
| 2 |
2 제 1 항에 있어서,상기 데이터 신호 정렬부는:상기 복수의 데이터 신호들을 360°를 상기 데이터 신호들의 개수로 나눈 위상 차만큼 이격시켜 정렬하는 직렬 변환기 |
| 3 |
3 제 1 항에 있어서,상기 데이터 신호 정렬부는:상기 복수의 데이터 신호들을 RZ(Return to Zero) 방식으로 변환하면서 상기 위상 간격으로 정렬하는 직렬 변환기 |
| 4 |
4 제 3 항에 있어서,상기 데이터 신호 정렬부는:각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 상기 RZ 방식으로 변환한 RZ 데이터 신호, 및 상기 RZ 데이터 신호를 반전시킨 반전 RZ 데이터 신호를 출력하는 복수의 플립플롭들을 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 서로 간에 상기 위상 간격에 해당하는 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 서로 간에 상기 위상 간격에 해당하는 위상 차를 갖는 직렬 변환기 |
| 5 |
5 제 3 항에 있어서,상기 천이 검출부는:상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들의 논리 레벨을 동일한 타이밍에서 비교하여,위상이 앞선 데이터 신호의 논리 레벨이 0이고 위상이 뒤선 데이터 신호의 논리 레벨이 1인 경우, 양의 토글 신호를 생성하고,위상이 앞선 데이터 신호의 논리 레벨이 1이고 위상이 뒤선 데이터 신호의 논리 레벨이 0인 경우, 음의 토글 신호를 생성하는 직렬 변환기 |
| 6 |
6 제 4 항에 있어서,상기 천이 검출부는:각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 1 NAND 게이트들;각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 2 NAND 게이트들;상기 제 1 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 3 NAND 게이트; 및상기 제 2 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 4 NAND 게이트;를 포함하는 직렬 변환기 |
| 7 |
7 제 5 항에 있어서,상기 토글 신호 변환부는:상기 양의 토글 신호 및 상기 음의 토글 신호를 입력받아 상기 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NOR 게이트 SR 래치를 포함하는 직렬 변환기 |
| 8 |
8 제 1 항에 있어서,상기 데이터 신호 정렬부는:상기 복수의 데이터 신호들을 RO(Return to One) 방식으로 변환하면서 상기 위상 간격으로 정렬하는 직렬 변환기 |
| 9 |
9 제 8 항에 있어서,상기 데이터 신호 정렬부는:각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 상기 RO 방식으로 변환한 RO 데이터 신호, 및 상기 RO 데이터 신호를 반전시킨 반전 RO 데이터 신호를 출력하는 복수의 플립플롭들을 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 각각 상기 위상 간격에 해당하는 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 각각 상기 위상 간격에 해당하는 위상 차를 갖는 직렬 변환기 |
| 10 |
10 제 8 항에 있어서,상기 천이 검출부는:상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들의 논리 레벨을 동일한 타이밍에서 비교하여,위상이 앞선 데이터 신호의 논리 레벨이 1이고 위상이 뒤선 데이터 신호의 논리 레벨이 0인 경우, 양의 토글 신호를 생성하고,위상이 앞선 데이터 신호의 논리 레벨이 0이고 위상이 뒤선 데이터 신호의 논리 레벨이 1인 경우, 음의 토글 신호를 생성하는 직렬 변환기 |
| 11 |
11 제 9 항에 있어서,상기 천이 검출부는:각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 1 NOR 게이트들;각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 2 NOR 게이트들;상기 제 1 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 3 NOR 게이트; 및상기 제 2 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 4 NOR 게이트;를 포함하는 직렬 변환기 |
| 12 |
12 제 10 항에 있어서,상기 토글 신호 변환부는:상기 양의 토글 신호 및 상기 음의 토글 신호를 입력받아 상기 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NAND 게이트 SR 래치를 포함하는 직렬 변환기 |
| 13 |
13 각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 RZ 방식으로 변환한 RZ 데이터 신호, 및 상기 RZ 데이터 신호를 반전시킨 반전 RZ 데이터 신호를 출력하는 복수의 플립플롭들;각각이 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 1 NAND 게이트들;각각이 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 2 NAND 게이트들;상기 제 1 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 3 NAND 게이트;상기 제 2 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 4 NAND 게이트; 및상기 제 3 NAND 게이트의 출력 신호 및 상기 제 4 NAND 게이트의 출력 신호를 입력받아 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NOR 게이트 SR 래치를 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 서로 간에 기 결정된 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 서로 간에 상기 기 결정된 위상 차를 갖는 직렬 변환기 |
| 14 |
14 각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 RO 방식으로 변환한 RO 데이터 신호, 및 상기 RO 데이터 신호를 반전시킨 반전 RO 데이터 신호를 출력하는 복수의 플립플롭들;각각이 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 1 NOR 게이트들;각각이 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 2 NOR 게이트들;상기 제 1 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 3 NOR 게이트;상기 제 2 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 4 NOR 게이트; 및상기 제 3 NOR 게이트의 출력 신호 및 상기 제 4 NOR 게이트의 출력 신호를 입력받아 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NAND 게이트 SR 래치를 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 서로 간에 기 결정된 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 서로 간에 상기 기 결정된 위상 차를 갖는 직렬 변환기 |
| 15 |
15 복수의 데이터 신호들을 기 결정된 위상 간격으로 정렬하는 데이터 신호 정렬부, 상기 정렬된 데이터 신호들 간 논리 레벨의 천이를 검출하여 상기 논리 레벨의 천이 시 토글 신호를 생성하는 천이 검출부, 및 상기 토글 신호를 상기 데이터 신호들을 직렬화한 직렬 데이터 신호로 변환하는 토글 신호 변환부를 포함하는 직렬 변환기;상기 직렬 데이터 신호의 채널 손실을 보상하는 출력 드라이버; 및상기 토글 신호를 입력받아 상기 토글 신호가 인가되는 구간에서 강조 신호를 생성하고, 상기 강조 신호를 상기 출력 드라이버로부터 출력되는 출력 신호에 중첩시키는 프리-엠퍼시스부;를 포함하는 데이터 송신 장치 |
| 16 |
16 제 15 항에 있어서,상기 데이터 신호 정렬부는:상기 복수의 데이터 신호들을 RZ(Return to Zero) 방식으로 변환하면서 상기 위상 간격으로 정렬하는 데이터 송신 장치 |
| 17 |
17 제 16 항에 있어서,상기 데이터 신호 정렬부는:각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 상기 RZ 방식으로 변환한 RZ 데이터 신호, 및 상기 RZ 데이터 신호를 반전시킨 반전 RZ 데이터 신호를 출력하는 복수의 플립플롭들을 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 서로 간에 상기 위상 간격에 해당하는 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 서로 간에 상기 위상 간격에 해당하는 위상 차를 갖는 데이터 송신 장치 |
| 18 |
18 제 16 항에 있어서,상기 천이 검출부는:상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들의 논리 레벨을 동일한 타이밍에서 비교하여,위상이 앞선 데이터 신호의 논리 레벨이 0이고 위상이 뒤선 데이터 신호의 논리 레벨이 1인 경우, 양의 토글 신호를 생성하고,위상이 앞선 데이터 신호의 논리 레벨이 1이고 위상이 뒤선 데이터 신호의 논리 레벨이 0인 경우, 음의 토글 신호를 생성하는 데이터 송신 장치 |
| 19 |
19 제 17 항에 있어서,상기 천이 검출부는:각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 1 NAND 게이트들;각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RZ 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RZ 데이터 신호를 입력받아 NAND 연산하는 복수의 제 2 NAND 게이트들;상기 제 1 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 3 NAND 게이트; 및상기 제 2 NAND 게이트들의 출력 신호를 입력받아 NAND 연산하는 제 4 NAND 게이트;를 포함하는 데이터 송신 장치 |
| 20 |
20 제 18 항에 있어서,상기 토글 신호 변환부는:상기 양의 토글 신호 및 상기 음의 토글 신호를 입력받아 상기 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NOR 게이트 SR 래치를 포함하는 데이터 송신 장치 |
| 21 |
21 제 15 항에 있어서,상기 데이터 신호 정렬부는:상기 복수의 데이터 신호들을 RO(Return to One) 방식으로 변환하면서 상기 위상 간격으로 정렬하는 데이터 송신 장치 |
| 22 |
22 제 21 항에 있어서,상기 데이터 신호 정렬부는:각각이 데이터 신호, 클럭 신호 및 리셋 신호를 입력받고, 상기 클럭 신호 및 상기 리셋 신호의 타이밍에 따라 상기 데이터 신호를 상기 RO 방식으로 변환한 RO 데이터 신호, 및 상기 RO 데이터 신호를 반전시킨 반전 RO 데이터 신호를 출력하는 복수의 플립플롭들을 포함하며,상기 복수의 플립플롭들에 입력되는 복수의 클럭 신호들은 각각 상기 위상 간격에 해당하는 위상 차를 가지며,상기 복수의 플립플롭들에 입력되는 복수의 리셋 신호들은 각각 상기 위상 간격에 해당하는 위상 차를 갖는 데이터 송신 장치 |
| 23 |
23 제 21 항에 있어서,상기 천이 검출부는:상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들의 논리 레벨을 동일한 타이밍에서 비교하여,위상이 앞선 데이터 신호의 논리 레벨이 1이고 위상이 뒤선 데이터 신호의 논리 레벨이 0인 경우, 양의 토글 신호를 생성하고,위상이 앞선 데이터 신호의 논리 레벨이 0이고 위상이 뒤선 데이터 신호의 논리 레벨이 1인 경우, 음의 토글 신호를 생성하는 데이터 송신 장치 |
| 24 |
24 제 22 항에 있어서,상기 천이 검출부는:각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 반전 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 1 NOR 게이트들;각각이 상기 정렬된 데이터 신호들 중 위상이 연속된 두 데이터 신호들을 입력받되, 위상이 앞선 데이터 신호의 상기 반전 RO 데이터 신호 및 위상이 뒤선 데이터 신호의 상기 RO 데이터 신호를 입력받아 NOR 연산하는 복수의 제 2 NOR 게이트들;상기 제 1 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 3 NOR 게이트; 및상기 제 2 NOR 게이트들의 출력 신호를 입력받아 NOR 연산하는 제 4 NOR 게이트;를 포함하는 데이터 송신 장치 |
| 25 |
25 제 23 항에 있어서,상기 토글 신호 변환부는:상기 양의 토글 신호 및 상기 음의 토글 신호를 입력받아 상기 직렬 데이터 신호 및 상기 직렬 데이터 신호를 반전시킨 반전 직렬 데이터 신호를 출력하는 NAND 게이트 SR 래치를 포함하는 데이터 송신 장치 |
| 26 |
26 제 18 항에 있어서,상기 프리-엠퍼시스부는:논리 레벨 1에 대응하는 전위를 갖는 제 1 전원단과 논리 레벨 0에 대응하는 전위를 갖는 제 2 전원단 사이에서 서로 직렬로 연결된 제 1 NMOS 및 제 2 NMOS; 및상기 제 1 전원단과 상기 제 2 전원단 사이에서 서로 직렬로 연결된 제 3 NMOS 및 제 4 NMOS를 포함하며,상기 제 1 NMOS 및 상기 제 4 NMOS는 상기 양의 토글 신호를 입력받아 개폐가 제어되고,상기 제 2 NMOS 및 상기 제 3 NMOS는 상기 음의 토글 신호를 입력받아 개폐가 제어되는 데이터 송신 장치 |
| 27 |
27 제 23 항에 있어서,상기 프리-엠퍼시스부는:논리 레벨 1에 대응하는 전위를 갖는 제 1 전원단과 논리 레벨 0에 대응하는 전위를 갖는 제 2 전원단 사이에서 서로 직렬로 연결된 제 1 PMOS 및 제 2 PMOS; 및상기 제 1 전원단과 상기 제 2 전원단 사이에서 서로 직렬로 연결된 제 3 PMOS 및 제 4 PMOS를 포함하며,상기 제 1 PMOS 및 상기 제 4 PMOS는 상기 양의 토글 신호를 입력받아 개폐가 제어되고,상기 제 2 PMOS 및 상기 제 3 PMOS는 상기 음의 토글 신호를 입력받아 개폐가 제어되는 데이터 송신 장치 |
| 지정국 정보가 없습니다 |
|---|
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | CN105703778 | CN | 중국 | FAMILY |
| 2 | US09685978 | US | 미국 | FAMILY |
| 3 | US20160173274 | US | 미국 | FAMILY |
DOCDB 패밀리 정보
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | CN105703778 | CN | 중국 | DOCDBFAMILY |
| 2 | CN105703778 | CN | 중국 | DOCDBFAMILY |
| 3 | US2016173274 | US | 미국 | DOCDBFAMILY |
| 4 | US9685978 | US | 미국 | DOCDBFAMILY |
| 국가 R&D 정보가 없습니다. |
|---|
| 공개전문 정보가 없습니다 |
|---|
- 본 등록정보는 참고용으로 법적증빙자료로 사용할 수 없습니다.
- 데이터 이관에 따른 소요기간(1일)으로 인하여 등록원부와 일부 차이가 발생할 수 있으며, 일부 정보(부기, 상세 주소 등)를 제공하지 않고 있습니다.
- 법적증빙자료로 활용하시거나 더 자세한 정보를 보시려면 등록원부를 발급받아 사용하시기 바랍니다.
| 특허 등록번호 | 10-1543704-0000 |
|---|
권리란
| 표시번호 | 사항 |
|---|---|
| 1 |
출원 연월일 : 20141210 출원 번호 : 1020140177594 공고 연월일 : 20150812 공고 번호 : 특허결정(심결)연월일 : 20150730 청구범위의 항수 : 27 유별 : H03M 9/00 발명의 명칭 : 직렬 변환기 및 그를 포함한 데이터 송신 장치 존속기간(예정)만료일 : |
특허권자란
| 순위번호 | 사항 |
|---|---|
| 1 |
(권리자) 연세대학교 산학협력단 서울특별시 서대문구... |
등록료란
| 제 1 - 3 년분 | 금 액 | 549,000 원 | 2015년 08월 06일 | 납입 |
| 제 4 년분 | 금 액 | 326,510 원 | 2018년 08월 13일 | 납입 |
| 제 5 년분 | 금 액 | 317,000 원 | 2019년 08월 02일 | 납입 |
| 제 6 년분 | 금 액 | 326,510 원 | 2020년 08월 20일 | 납입 |
- 본 '원본보기 서비스'는 참고용이므로, 일부 오류 및 누락이 발생할 수 있습니다.
- 정확한 서류를 확인하시려면 해당 웹사이트에서 조회하시기 바랍니다. (특허로 바로가기: http://www.patent.go.kr)
- 해당 서비스는 점검으로 인해 매주 일요일 00:00 ~ 02:00까지 이용이 중단됩니다.
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 | 2014.12.10 | 수리 (Accepted) | 1-1-2014-1201402-65 |
| 2 | [대리인사임]대리인(대표자)에 관한 신고서 | 2015.01.20 | 수리 (Accepted) | 1-1-2015-0060422-60 |
| 3 | [우선심사신청]심사청구(우선심사신청)서 | 2015.03.20 | 수리 (Accepted) | 1-1-2015-0272739-99 |
| 4 | [우선심사신청]선행기술조사의뢰서 | 2015.03.24 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 5 | [우선심사신청]선행기술조사보고서 | 2015.04.07 | 수리 (Accepted) | 9-1-2015-0021630-55 |
| 6 | 등록결정서 | 2015.07.30 | 발송처리완료 (Completion of Transmission) | 9-5-2015-0511261-19 |
| 기술정보가 없습니다 |
|---|
| 과제정보가 없습니다 |
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