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선형성을 개선하기 위한 차동증폭회로 및 주파수 혼합기

  • 기술번호 : KST2015143021
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 선형성이 개선된 차동증폭회로 및 주파수 혼합기에 관한 것이다. 본 발명에 따른 차동증폭회로는 제1 부하 및 제2 부하와; 상기 제1 부하에 대한 제1 출력단과; 상기 제2 부하에 대한 제2 출력단과; 제1 입력단 및 제2 입력단 간의 전압차를 증폭하는 차동단과, 상기 차동단을 바이어싱하는 바이어싱 전류 소스가 마련된 차동증폭부와; 상기 제1 출력단과 상기 제2 출력단을 연결하는 제1 트랜지스터를 갖는 제1 크로스 회로부와, 상기 제1 출력단과 상기 제2 출력단을 연결하는 제2 트랜지스터를 갖는 제2 크로스 회로부가 마련되어 상기 차동증폭부에서 발생하는 비선형성 신호를 제거하는 비선형성 제거회로부를 포함하는 것을 특징으로 한다. 이에 따라, 차동증폭회로의 능동소자에서 발생하는 비선형 전류성분을 부하 측에서 상쇄하여 선형 전류 성분만을 출력하여 기존의 선형성 개선을 위한 차동증폭회로에 비해 선형성이 개선될 수 있다.
Int. CL H03F 3/45 (2006.01)
CPC
출원번호/일자 1020080018776 (2008.02.29)
출원인 성균관대학교산학협력단
등록번호/일자 10-0956000-0000 (2010.04.26)
공개번호/일자 10-2009-0093319 (2009.09.02) 문서열기
공고번호/일자 (20100504) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.02.29)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 김병성 대한민국 경기도 수원시 권선구
2 김태성 대한민국 서울시 용산구

대리인

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번호 이름 국적 주소
1 김인철 대한민국 서울특별시 서초구 반포대로**길 **, 매강빌딩*층 에이치앤에이치 H&H 국제특허법률사무소 (서초동)

최종권리자

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2008.02.29 수리 (Accepted) 1-1-2008-0150310-57
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)		 2008.03.10 수리 (Accepted) 1-1-2008-0171640-45
3 선행기술조사의뢰서
Request for Prior Art Search		 2009.04.10 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2009.05.15 수리 (Accepted) 9-1-2009-0030417-40
5 의견제출통지서
Notification of reason for refusal		 2009.10.29 발송처리완료 (Completion of Transmission) 9-5-2009-0445750-44
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.12.14 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0771513-07
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.12.14 수리 (Accepted) 1-1-2009-0771511-16
8 등록결정서
Decision to grant		 2010.04.19 발송처리완료 (Completion of Transmission) 9-5-2010-0161941-09
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.04.26 수리 (Accepted) 4-1-2012-5090770-53
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.20 수리 (Accepted) 4-1-2012-5131828-19
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.27 수리 (Accepted) 4-1-2012-5137236-29
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
선형성이 개선된 차동증폭회로에 있어서, 제1 부하 및 제2 부하와; 상기 제1 부하에 대한 제1 출력단과; 상기 제2 부하에 대한 제2 출력단과; 제1 입력단 및 제2 입력단 간의 전압차를 증폭하는 차동단과, 상기 차동단을 바이어싱하는 바이어싱 전류 소스가 마련된 차동증폭부와; 상기 제1 출력단과 상기 제2 출력단을 연결하는 제1 트랜지스터를 갖는 제1 크로스 회로부와, 상기 제1 출력단과 상기 제2 출력단을 연결하는 제2 트랜지스터를 갖는 제2 크로스 회로부가 마련되어 상기 차동증폭부에서 발생하는 비선형성 신호를 제거하는 비선형성 제거회로부를 포함하며, 상기 제1 트랜지스터의 드레인 단자는 상기 제2 출력단과 연결되고, 게이트 단자는 상기 제1 출력단과 연결되고, 소스 단자는 접지되고; 상기 제1 크로스 회로부는 상기 제1 트랜지스터의 상기 게이트 단자에 제1 바이어스 전압을 인가하는 제1 바이어스 전원부를 포함하고; 상기 제2 트랜지스터의 드레인 단자는 상기 제1 출력단에 연결되고, 게이트 단자는 상기 제2 출력단에 연결되고, 소스 단자는 접지되며; 상기 제2 크로스 회로부는 상기 제2 트랜지스터의 상기 게이트 단자에 제2 바이어스 전압을 인가하는 제2 바이어스 전원부를 포함하는 것을 특징으로 하는 차동증폭회로
2 2
삭제
3 3
제1항에 있어서, 상기 제1 바이어스 전원부는 상기 제1 트랜지스터의 상기 게이트 단자와 상기 제1 출력단 사이에 연결되는 제1 커패시터와, 상기 제1 커패시터와 상기 제1 트랜지스터의 상기 게이트 단자 사이에서 분기된 제1 바이어스 전압 소스를 포함하며; 상기 제2 바이어스 전원부는 상기 제2 트랜지스터의 상기 게이트 단자와 상기 제2 출력단 사이에 연결되는 제2 커패시터와, 상기 제2 커패시터와 상기 제2 트랜지스터의 상기 게이트 단자 사이에서 분기된 제2 바이어스 전압 소스를 포함하는 것을 특징으로 하는 차동증폭회로
4 4
제1항 또는 제3항에 있어서, 상기 차동단은 차동쌍을 이루는 제3 트랜지스터 및 제4 트랜지스터를 포함하는 것을 특징으로 하는 차동증폭회로
5 5
제4항에 있어서, 상기 차동단은 상기 제3 트랜지스터에 캐스코드 연결되는 제3 캐스코드 트랜지스터와 상기 제4 트랜지스터에 캐스코드 연결되는 제4 캐스코드 트랜지스터를 더 포함하며; 상기 제3 캐스코드 트랜지스터 및 상기 제4 캐스코드 트랜지스터는 차동쌍을 이루는 것을 특징으로 하는 차동증폭회로
6 6
제1항 또는 제3항에 있어서, 상기 제1 크로스 회로부는 상기 제1 트랜지스터와 캐스코드 연결된 제1 캐스코드 트랜지스터를 더 포함하며; 상기 제2 크로스 회로부는 상기 제2 트랜지시터와 캐스코드 연결된 제2 캐스코드 트랜지스터를 더 포함하는 것을 특징으로 하는 차동증폭회로
7 7
선형성이 개선된 주파수 혼합기에 있어서, 제1 부하 및 제2 부하와; 상기 제1 부하에 대한 제1 출력단과; 상기 제2 부하에 대한 제2 출력단과; 제1 입력단 및 제2 입력단 간의 전압차를 증폭하는 차동단과, 상기 차동단을 바이어싱하는 바이어싱 전류 소스가 마련된 차동증폭부와; 국부발진신호에 따라 상기 차동증폭부에 의해 증폭된 신호의 주파수를 변환하여 상기 제1 출력단 및 상기 제2 출력단 측으로 출력하는 주파수 혼합부와; 상기 주파수 혼합부의 제1 혼합부 입력단과 제2 혼합부 입력단을 연결하는 제1 트랜지스터를 갖는 제1 크로스 회로부와, 상기 제1 혼합부 입력단과 상기 제2 혼합부 입력단을 연결하는 제2 트랜지스터를 갖는 제2 크로스 회로부가 마련되어 상기 차동증폭부에서 발생하는 비선형성 신호를 제거하는 비선형성 제거회로부와; 국부발진신호에 따라 상기 차동증폭부에 의해 증폭된 신호의 주파수를 변환하여 상기 제1 출력단 및 상기 제2 출력단 측으로 출력하는 주파수 혼합부를 포함하며, 상기 제1 트랜지스터의 드레인 단자는 상기 제2 혼합부 입력단과 연결되고, 게이트 단자는 상기 제1 혼합부 입력단과 연결되고, 소스 단자는 접지되고; 상기 제1 크로스 회로부는 상기 제1 트랜지스터의 상기 게이트 단자에 제1 바이어스 전압을 인가하는 제1 바이어스 전원부를 포함하고; 상기 제2 트랜지스터의 드레인 단자는 상기 제1 혼합부 입력단에 연결되고, 게이트 단자는 상기 제2 혼합부 입력단에 연결되고, 소스 단자는 접지되며; 상기 제2 크로스 회로부는 상기 제2 트랜지스터의 상기 게이트 단자에 제2 바이어스 전압을 인가하는 제2 바이어스 전원부를 포함하는 것을 특징으로 하는 주파수 혼합기
8 8
삭제
9 9
제7항에 있어서, 상기 제1 바이어스 전원부는 상기 제1 트랜지스터의 상기 게이트 단자와 상기 제1 혼합부 입력단 사이에 연결되는 제1 커패시터와, 상기 제1 커패시터와 상기 제1 트랜지스터의 상기 게이트 단자 사이에서 분기된 제1 바이어스 전압 소스를 포함하며; 상기 제2 바이어스 전원부는 상기 제2 트랜지스터의 상기 게이트 단자와 상기 제2 혼합부 입력단 사이에 연결되는 제2 커패시터와, 상기 제2 커패시터와 상기 제2 트랜지스터의 상기 게이트 단자 사이에서 분기된 제2 바이어스 전압 소스 포함하는 것을 특징으로 하는 주파수 혼합기
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순번 패밀리번호 국가코드 국가명 종류
1 US07808319 US 미국 FAMILY
2 US20090219094 US 미국 FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 US2009219094 US 미국 DOCDBFAMILY
2 US7808319 US 미국 DOCDBFAMILY
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