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슬레이브 테스트 버스 제어기능을 갖는 ＰＣＩ 버스 제어기

  • 기술번호 : KST2015154653
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 PCI 버스 제어기 코어 및 TBC(Test Bus Controller) 슬레이브 코어를 단일 코어로 통합하여 PCI 버스 제어기능과 함께 테스트 버스 제어기능을 수행할 수 있는 슬레이브 테스트 버스 제어기능을 갖는 PCI 버스 제어기에 관한 것이다.
Int. CL G06F 11/22 (2006.01)
CPC G06F 11/2273(2013.01) G06F 11/2273(2013.01)
출원번호/일자 1020030031268 (2003.05.16)
출원인 국방과학연구소
등록번호/일자 10-0496653-0000 (2005.06.13)
공개번호/일자 10-2004-0098937 (2004.11.26) 문서열기
공고번호/일자 (20050622) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2003.05.16)
심사청구항수 2

출원인

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번호 이름 국적 주소
1 국방과학연구소 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박성주 대한민국 경기도성남시분당구
2 오형근 대한민국 경기도안양시만안구
3 오대식 대한민국 경기도안산
4 한기택 대한민국 경상남도진해시

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 국방과학연구소 대한민국 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2003.05.16 수리 (Accepted) 1-1-2003-0174519-60
2 의견제출통지서
Notification of reason for refusal		 2004.11.30 발송처리완료 (Completion of Transmission) 9-5-2004-0510663-01
3 명세서 등 보정서
Amendment to Description, etc.		 2005.01.25 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2005-0044334-29
4 의견서
Written Opinion		 2005.01.25 수리 (Accepted) 1-1-2005-0044330-47
5 등록결정서
Decision to grant		 2005.05.31 발송처리완료 (Completion of Transmission) 9-5-2005-0253030-48
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2005.07.18 수리 (Accepted) 4-1-2005-0024313-50
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.07.22 수리 (Accepted) 4-1-2013-0033275-90
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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바운더리스캔구조를 포함하는 PCI 버스 제어기 블록과, 테스트 버스 마스터와 상기 PCI 버스 제어기 블록을 연결시키는 테스트 버스 컨트롤러 슬레이브 코어를 포함하고, 상기 PCI 버스 제어기 블록은 PCI 버스를 제어하는 일반 동작 모드 및 보드의 칩간 연결 상태를 테스트 하는 테스트 모드를 구비하며, 상기 테스트 모드의 경우, 상기 테스트 버스 컨트롤러 슬레이브 코어에서는 상기 테스트 버스 마스터로부터 전송된 보드주소가 미리 지정된 보드주소와 일치하는지를 검사하여, 일치하지 않으면 상기 PCI 버스 제어기 블록과 상기 테스트 버스 마스터의 연결을 차단하고, 일치하면 상기 테스트 버스 마스터로부터 받은 테스트 패턴을 상기 PCI 버스 제어기 블록에 포함된 상기 바운더리스캔구조에 전달하고, 상기 PCI 버스 제어기 블록은 상기 바운더리스캔구조를 통해 시프트 시킨 상기 테스트 패턴을 테스트 보드에 전달하여, 상기 테스트 보드에서의 테스트 결과가 상기 테스트 버스 컨트롤러 슬레이브 코어를 통해 상기 테스트 버스 마스터로 전달되는 것을 특징으로 하는 슬레이브 테스트 버스 제어기능을 갖는 PCI 버스 제어기
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제 1항에 있어서, 상기 보드주소를 사용자가 임의로 설정할 수 있도록 한 보드주소설정부를 더 포함하는 것을 특징으로 하는 슬레이브 테스트 버스 제어기능을 갖는 PCI 버스 제어기
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제 1항에 있어서, 상기 보드주소를 사용자가 임의로 설정할 수 있도록 한 보드주소설정부를 더 포함하는 것을 특징으로 하는 슬레이브 테스트 버스 제어기능을 갖는 PCI 버스 제어기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.