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데이터 통신시스템

  • 기술번호 : KST2015154790
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 시스템의 제어부를 EPLD에 의하여 프로그램화된 소자를 하드웨어적으로 구성하여 프로세서에 발생하는 부하와 오동작을 방지할 수 있는 데이터 통신시스템을 개시한다. 개시된 본 발명은 직렬 제어 신호와 병렬 상태 신호를 컨버터하여 송수신하는 PPD 단자와 클럭 신호가 입력되는 클럭 단자를 갖는 인터페이스 로직 회로; 상기 병렬 상태 신호를 직렬 상태 신호로 변환하는 제 1 시프트 레지스터; 상기 직렬 제어 신호를 병렬 상태 신호로 변환하는 제 2 시프트 레지스터; 및 상기 제어 신호와 상태 신호의 송수신 주기를 카운팅하는 카운터를 포함하는 것을 특징으로 한다.여기서, 상기 인터페이스 로직 회로는 입력되는 클럭 신호의 타이밍을 제어하는 타이밍 제어기; PPD 제어 신호를 상기 제 2 시프트 레지스터에 인가하기 위한 제 1 비교기; 클럭 신호의 동기 클럭 신호를 검출하는 제 2 비교기; 및 상기 PPD 단자로 입력되는 직렬 제어 신호의 프레임 시작 구간을 검출하는 클럭 신호를 검출하는 제 3 비교기로 구성되어 있는 것을 특징으로 한다.제어, 클럭, 인터페이스, 레지스터, EPLD
Int. CL G06F 13/00 (2006.01)
CPC G06F 13/4291(2013.01)
출원번호/일자 1020020010558 (2002.02.27)
출원인 국방과학연구소
등록번호/일자
공개번호/일자 10-2003-0071039 (2003.09.03) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.02.02)
심사청구항수 2

출원인

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번호 이름 국적 주소
1 국방과학연구소 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 윤기천 대한민국 충남 연기군
2 박석희 대한민국 대전 서구

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2002.02.27 수리 (Accepted) 1-1-2002-0059073-44
2 대리인 변경 신고서
Agent change Notification		 2004.07.27 수리 (Accepted) 1-1-2004-0332932-11
3 출원인 변경 신고서
Applicant change Notification		 2004.09.13 수리 (Accepted) 1-1-2004-0413475-79
4 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2006.09.05 수리 (Accepted) 4-1-2006-5126039-87
5 출원심사청구서
Request for Examination		 2007.02.02 수리 (Accepted) 1-1-2007-0102490-52
6 출원인변경신고서
Applicant change Notification		 2007.02.14 수리 (Accepted) 1-1-2007-5017749-48
7 서지사항보정서
Amendment to Bibliographic items		 2007.02.15 수리 (Accepted) 1-1-2007-0143882-41
8 선행기술조사의뢰서
Request for Prior Art Search		 2007.11.06 수리 (Accepted) 9-1-9999-9999999-89
9 선행기술조사보고서
Report of Prior Art Search		 2007.12.05 수리 (Accepted) 9-1-2007-0072463-34
10 의견제출통지서
Notification of reason for refusal		 2008.02.20 발송처리완료 (Completion of Transmission) 9-5-2008-0085016-71
11 거절결정서
Decision to Refuse a Patent		 2008.08.07 발송처리완료 (Completion of Transmission) 9-5-2008-0415138-39
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.07.22 수리 (Accepted) 4-1-2013-0033275-90
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

직렬 제어 신호와 병렬 상태 신호를 컨버터하여 송수신하는 PPD 단자와 클럭 신호가 입력되는 클럭 단자를 갖는 인터페이스 로직 회로;

상기 병렬 상태 신호를 직렬 상태 신호로 변환하는 제 1 시프트 레지스터;

상기 직렬 제어 신호를 병렬 상태 신호로 변환하는 제 2 시프트 레지스터; 및

상기 제어 신호와 상태 신호의 송수신 주기를 카운팅하는 카운터를 포함하는 것을 특징으로 하는 데이터 통신 시스템

2 2

제 1 항에 있어서,

상기 인터페이스 로직 회로는 입력되는 클럭 신호의 타이밍을 제어하는 타이밍 제어기;

PPD 제어 신호를 상기 제 2 시프트 레지스터에 인가하기 위한 제 1 비교기;

클럭 신호의 동기 클럭 신호를 검출하는 제 2 비교기; 및

상기 PPD 단자로 입력되는 직렬 제어 신호의 프레임 시작 구간을 검출하는 클럭 신호를 검출하는 제 3 비교기로 구성되어 있는 것을 특징으로 하는 데이터 통신 시스템

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.