요약 | 본 발명은 베이스 저항조정 사이리스터에 있어서 트렌치 이중게이트를 형성하고, 각각의 게이트에 일정한 게이트 구동 전압을 인가함으로써 전류포화 특성을 나타내는 트렌치 이중게이트 베이스 저항조정 사이리스터(TDGBRT) 및 그 제조공정에 관한 것으로서, 본 발명은, p+ 기판(5)의 상부에 n형 반도체가 에피택셜 성장되어 형성되는 n- 베이스층(4); 상기 n- 베이스층(4)의 상부에 p형 이온이 확산되어 형성되는 p- 베이스층(3); 상기 p- 베이스층(3)의 상부에 n형 이온이 확산되어 형성되는 n+층(2); 상기 n- 베이스층(4) 영역의 일부까지 트렌치 식각하고, 노출된 표면에 이산화실리콘이 확산되어 형성되는 게이트 산화막(6); 상기 트렌치 식각된 영역에 폴리실리콘을 매립하여 형성되고, 서로 교번하여 위치하는 온 게이트(7) 및 오프 게이트(8): 상기 두 게이트(7,8) 영역의 상부와 트렌치 식각되지 않은 상기 n+층(2)의 영역의 상부에 금속이 증착되어 형성되는 금속층을 포함하여 구성되며, 본 발명에 따른 트렌치 이중게이트 베이스 저항조정 사이리스터는 손가락이 교차된 형태의 두 개의 게이트로 사이리스터를 구동시켜 전류 포화 현상을 갖도록 함으로써, 안전동작 영역을 확보하고, 또한 과부하나 단락의 경우에도 스위칭 소자의 열적인 파괴를 방지할 수 있는 유용한 발명인 것이다. |
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Int. CL | H01L 29/74 (2006.01) |
CPC | H01L 29/7455(2013.01) |
출원번호/일자 | 1019980012690 (1998.04.02) |
출원인 | 한국전기연구원 |
등록번호/일자 | 10-0274835-0000 (2000.09.16) |
공개번호/일자 | 10-1999-0079855 (1999.11.05) 문서열기 |
공고번호/일자 | (20001215) 문서열기 |
국제출원번호/일자 | |
국제공개번호/일자 | |
우선권정보 | |
법적상태 | 소멸 |
심사진행상태 | 수리 |
심판사항 | |
구분 | |
원출원번호/일자 | |
관련 출원번호 | |
심사청구여부/일자 | Y (1998.04.02) |
심사청구항수 | 6 |