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결정 궤환 등화기(Decision Feedback Equalizer: DFE); 및상기 결정 궤환 등화기의 출력을 한 주기 동안 적분하여, 상기 결정 궤환 등화기 내 판정기로 제공하는 적분기를 구비하고,상기 결정 궤환 등화기에서 등화한 파형의 신호간 간섭(Inter-Symbol Interference: ISI)을 한 주기 전과 두 주기 전의 판정된 데이터 값을 이용하여 제거하는 것을 특징으로 하는 적분 수신기
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제1항에 있어서, 상기 결정 궤환 등화기는상기 적분 수신기로 입력되는 입력 신호와, 궤환 필터로부터의 한 주기와 두 주기 전의 판별된 데이터의 값을 수신하고, 이들을 가산하여 출력 신호를 발생하는 가산기;상기 적분기의 출력 전압과 소정의 기준 전압을 비교하여 판정하는 상기 판정기; 및상기 한 주기와 상기 두 주기 전의 판정된 데이터의 값에다가 제1 및 제2 등화기 계수를 각각 곱하여 상기 가산기로 제공하는 궤환 필터를 구비하는 것을 특징으로 하는 적분 수신기
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제2항에 있어서, 상기 제1 등화기 계수는 1
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제2항에 있어서, 상기 적분 수신기는상기 입력 신호 패턴이 1111일 때와 X011일 때의 상기 결정 궤환 등화기의 출력 신호의 면적 차이를 에러 신호로 나타내고, 상기 에러 신호의 값이 0일 때, Sign-sign LMS(Least Mean-squared Error Argorithm) 알고리즘을 통하여 상기 입력 신호가 1011이면 제1등화기 계수를 결정하고, 상기 입력 신호가 0011이면 제2등화기 계수를 결정하는 것을 특징으로 하는 적분 수신기
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제1 결정 궤환 등화기(Decisin Feedback Equalizer: DFE)의 출력을 한 주기 동안 적분하고, 등화한 파형의 신호간 간섭(Inter-Symbol Interference: ISI)을 한 주기 전과 두 주기 전의 판정된 데이터 값을 이용하여 제거하는 적분 수신기;제2 결정 궤환 등화기의 입력 신호 패턴이 1111일 때와 X011일 때의 출력 신호의 면적 차이를 에러 신호로 발생하는 에러 검출부; 및상기 에러 신호와 상기 적분 수신기에서 판정된 데이터의 부호를 바탕으로 상기 적분 수신기의 등화기 계수를 구하는 LMS 조절부를 구비하는 것을 특징으로 하는 적분 수신기 시스템
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제5항에 있어서, 상기 적분 수신기는상기 적분 수신기로 입력되는 입력 신호와, 궤환 필터로부터의 한 주기와 두 주기 전의 판정된 데이터의 값을 수신하고, 이들을 가산하여 출력 신호를 발생하는 가산기;상기 가산기의 출력을 한 주기 동안 적분하는 상기 적분기;상기 적분기의 출력 전압과 소정의 기준 전압을 비교하여 판정하는 상기 판정기; 및상기 한 주기와 상기 두 주기 전의 판별된 데이터의 값에다가 제1 및 제2 등화기 계수를 각각 곱하여 상기 가산기로 제공하는 궤환 필터를 구비하는 것을 특징으로 하는 적분 수신기 시스템
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제6항에 있어서, 상기 에러 검출부는상기 에러 신호의 값이 0일 때, Sign-sign LMS(Least Mean-squared Error Argorithm) 알고리즘을 통하여 상기 입력 신호가 1011이면 제1등화기 계수를 결정하고, 상기 입력 신호가 0011이면 제1등화기 계수를 결정하는 것을 특징으로 하는 적분 수신기 시스템
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제6항에 있어서, 상기 적분 수신기 시스템은초기 시스템 셋팅 모드에서 상기 입력 신호로 클럭을 받아들여 상기 입력 신호의 중간 전압을 가지는 기준 전압을 발생하는 기준 전압 발생부를 더 구비하는 것을 특징으로 하는 적분 수신기 시스템
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제8항에 있어서, 상기 기준 전압 발생부는상기 입력 신호인 클럭을 적분하는 적분기;상기 적분기의 출력과 상기 기준 전압을 비교하는 비교기;상기 비교기의 판별값에 따라 상기 클럭을 적분한 값이 0이 되게 제어하는 업/다운 카운터;상기 업/다운 카운터의 디지털 출력 값을 전류값으로 변환하는 디지털-아날로그 변환부; 및상기 디지털-아날로그 변환부의 전류 값이 인가되어 상기 기준 전압을 발생하는 저항을 구비하는 것을 특징으로 하는 적분 수신기 시스템
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룩-어헤드(look-ahead) 적분 기능을 가진 결정 궤환 등화기들;상기 결정 궤환 등화기들 각각과 연결되는 플립 플롭들을 구비하고,상기 적분 기능을 가진 결정 궤환 등화기 각각은데이터 주기의 1/4 시간 동안 입력 신호를 받아 들이고, 상기 데이터의 두 주기 전과 한 주기 전에 판별된 값을 받아들이되,상기 한 주기 전의 판별된 데이터 값이 0일 때 동작되는 제1 결정 궤환 등화 적분기;상기 한 주기 전의 판별된 데이터 값이 1일 때 동작되는 제2 결정 궤환 등화 적분기; 및상기 한 주기 전의 판별된 데이터에 따라 상기 제1 및 제2 결정 궤환 등화 적분기들의 출력 중 어느 하나를 선택하는 비교기를 구비하는 것을 특징으로 하는 수신기
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제10항에 있어서, 상기 제1 및 제2 결정 궤환 등화 적분기 각각은제1 클럭 신호에 응답하여 상기 제1 및 제2 결정 궤환 등화 적분기의 출력들을 전원 전압으로 프리차아지시키는 프리차아지부;상기 제1 및 제2 결정 궤환 등화 적분기의 출력들에 연결되는 커패시터; 및제2 클럭 신호에 응답하여, 상기 데이터 주기의 1/4 시간 동안의 입력 신호와, 상기 데이터의 두 주기 전과 한 주기 전에 판별된 값에 따라 적분하여 상기 커패시터에 저장하는 차동 비교기들을 구비하는 것을 특징으로 하는 수신기
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제10항에 있어서, 상기 비교기는선택 신호에 응답하여 상기 제1 및 제2 결정 궤환 등화 적분기들의 출력 중 어느 하나를 선택하는 차등 형식의 2-to-1 멀티플렉스;상기 멀티 플렉서의 출력을 미세 증폭하는 플립플롭; 및상기 플립플롭의 출력에 연결되는 인버터를 구비하는 것을 특징으로 하는 수신기
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