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동적기반의 설계 검증에서의 효과적인 순수시뮬레이션 방법, 시뮬레이션가속 방법, 또는 순수시뮬레이션/시뮬레이션가속 혼성방법 및 디버깅 방법

  • 기술번호 : KST2015171733
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 시뮬레이션 내지는 시뮬레이션가속과 같은 동적기반의 설계검증에서 일반적으로 일어나는 반복되는 시뮬레이션 실행과 디버깅 진행을 신속하며 효과적으로 진행할 수 있는 방법에 관한 것이다.본 발명에서는 1 이상의 설계객체에 존재하는 1 이상의 설계오류를 찾아내고, 이를 제거하기 위하여 설계 코드 내지는 설계 네트리스트를 수정하는 디버깅을 수행하고, 이와 같은 디버깅이 제거 대상이 된 1 이상의 설계오류를 올바르게 제거하는 동시에 새로운 오류를 도입하지 않았는지를 확인하기 위한 디버깅후-시뮬레이션 실행을 신속하게 진행할 수 있도록 함으로서 디버깅 턴어라운드 시간의 단축을 가능하게 한다.설계 검증
Int. CL G06F 9/445 (2006.01) G06F 9/00 (2006.01) G06F 11/36 (2006.01)
CPC
출원번호/일자 1020060117303 (2006.11.25)
출원인 부산대학교 산학협력단
등록번호/일자
공개번호/일자 10-2008-0009246 (2008.01.28) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020060068811   |   2006.07.23
대한민국  |   1020060105947   |   2006.10.30
법적상태 취하
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 10

출원인

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번호 이름 국적 주소
1 부산대학교 산학협력단 대한민국 부산광역시 금정구

발명자

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1 양세양 대한민국 부산광역시 금정구

대리인

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번호 이름 국적 주소
1 특허법인부경 대한민국 부산광역시 연제구 법원남로**번길 **, *층 (거제동, 대한타워)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2006.11.25 수리 (Accepted) 1-1-2006-0867722-02
2 보정요구서
Request for Amendment
2006.12.07 발송처리완료 (Completion of Transmission) 1-5-2006-0150123-39
3 서지사항보정서(납부자번호)
Amendment to Bibliographic items(Payer Number)
2007.01.08 수리 (Accepted) 1-1-2006-0905962-23
4 명세서등보정서
Amendment to Description, etc.
2007.03.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2007-0211833-43
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2007.05.07 수리 (Accepted) 4-1-2007-5069809-90
6 출원인변경신고서
Applicant change Notification
2007.05.08 수리 (Accepted) 1-1-2007-0340934-48
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.01.02 수리 (Accepted) 4-1-2014-0000027-56
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2016.01.13 수리 (Accepted) 4-1-2016-5004891-78
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.01.09 수리 (Accepted) 4-1-2017-5004005-98
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.01.10 수리 (Accepted) 4-1-2017-5004797-18
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번호 청구항
1 1
설계 검증 과정에서 1 이상의 설계 오류의 존재 여부를 시뮬레이션 실행으로 알아내고(디버깅전-시뮬레이션) 상기 1 이상의 설계 오류의 원인을 알아내어서 이를 제거하는 설계 수정을 진행하고(앞단-디버깅) 상기 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션(디버깅후-시뮬레이션)을 진행하는 단계에 있어서,상기 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션을 상기 1 이상의 설계 오류의 특성에 따라서 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식3-가정 기반 디버깅후-시뮬레이션 방법들 중에서 선택된 1 내지는 2 이상의 방법을 사용하여 진행하는 디버깅 방법
2 2
설계 검증 과정에서 1 이상의 설계 오류의 존재 여부를 시뮬레이션 실행으로 알아내고(디버깅전-시뮬레이션) 상기 1 이상의 설계 오류의 원인을 알아내어서 이를 제거하는 설계 수정을 진행하고(앞단-디버깅) 상기 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션(디버깅후-시뮬레이션)을 진행하는 단계에 있어서,상기 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션이 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식3-가정 기반 디버깅후-시뮬레이션 방법들 중에서 1 내지는 2 이상의 방법을 포함한 디버깅 방법
3 3
설계 오류들을 제거하는 설계 검증 과정에서 특정 1 이상의 설계 오류의 존재 여부를 시뮬레이션 실행으로 알아내고(디버깅전-시뮬레이션) 상기 특정 1 이상의 설계 오류의 원인을 알아내어서 이를 제거하는 설계 수정을 진행하고(앞단-디버깅) 상기 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션(디버깅후-시뮬레이션)을 진행하는 단계들을 반복적으로 진행하며,상기 특정 1 이상의 설계 오류를 제거하기 위한 설계 수정이 올바르게 진행되었는지를 판단하기 위한 시뮬레이션을 상기 1 이상의 설계 오류의 특성에 따라서 설계자 내지는 검증엔지니어가 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식3-가정 기반 디버깅후-시뮬레이션 방법들 중에서 1 내지는 2 이상의 방법을 선택적으로 사용하여 진행하는 디버깅 방법
4 4
제 1 항 내지는 제 2 항 내지는 3 항에 있어서,상기 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법을 통하여 진행되는 동적기반의 설계 검증 방법이 중첩된 디버깅후-시뮬레이션과 디버깅전-시뮬레이션 기반의 디버깅 방법을 포함하는 동적기반의 설계 검증 방법
5 5
제 1 항 내지는 제 2 항 내지는 3 항에 있어서,상기 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법을 통하여 진행되는 동적기반의 설계 검증 방법에서 1 이상의 특정 버그가 올바르게 제거되었는지를 조사하는 디버깅후-시뮬레이션에서 시뮬레이션가속기 내지는 하드웨어에뮬레이터를 이용한 시뮬레이션 실행 내지는 추상화 상위수준에서의 시뮬레이션 실행에서 시뮬레이션 시간 0 이후의 특정 시뮬레이션 시점 t_o1 내지는 특정 시뮬레이션 구간 t_o2에서 수집된 DUV의 상태정보와 t_o1 내지는 t_o2에서부터 일정 시뮬레이션 구간에서의 DUV의 입력값들을 이용하여서 상기 시뮬레이션가속기 내지는 하드웨어에뮬레이터를 이용한 시뮬레이션 실행에 이은 시뮬레이터를 이용한 시뮬레이션 실행 내지는 상기 추상화 상위수준에서의 시뮬레이션 실행에 이은 추상화 하위수준에서의 시뮬레이션 실행을 통하여 상기 특정 버그가 올바르게 제거되었는지를 조사하는 동시에 새로운 1 이상의 특정 버그의 존재 여부를 조사하는 중첩된 디버깅후-시뮬레이션과 디버깅전-시뮬레이션 기반의 디버깅 방법을 포함하는 동적기반의 설계 검증 방법
6 6
제 1 항 내지는 3 항에 있어서,상기 1 이상의 설계 오류의 특성에 따라서 적용되는 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식3-가정 기반 디버깅후-시뮬레이션 방법들 중에서 2 이상의 방법이 독립적으로 동시에 실행되는 과정을 포함하는 디버깅 방법
7 7
제 1 항 내지는 제 2 항 내지는 3 항에 있어서,상기 방식1-가정 기반 디버깅후-시뮬레이션 방법 내지는 방식2-가정 기반 디버깅후-시뮬레이션 방법에서 가정에 근거한 디버깅후-시뮬레이션 실행과 가정확인을 위한 디버깅후-시뮬레이션을 병렬적으로 진행하는 디버깅 방법
8 8
제 1 항 내지는 제 2 항 내지는 제 3 항 내지는 제 4 항 내지는 제 5 항 내지는 제 6 항 내지는 제 7 항에 있어서,상기 방식2-가정 기반 디버깅후-시뮬레이션 방법에 "시뮬레이션가속기 내지는 하드웨어에뮬레이터를 우선적으로 이용하여 전환시점 Ts(i)를 결정하고 시뮬레이션가속의 결과를 이용하는 시뮬레이터를 활용한 시뮬레이션을 통한 방식2-가정 기반 디버깅후-시뮬레이션"이 포함된 디버깅 방법
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순번 패밀리번호 국가코드 국가명 종류
1 JP19528553 JP 일본 FAMILY
2 KR100767957 KR 대한민국 FAMILY
3 KR100794916 KR 대한민국 FAMILY
4 KR100800412 KR 대한민국 FAMILY
5 KR100921314 KR 대한민국 FAMILY
6 KR101328263 KR 대한민국 FAMILY
7 KR1020040063845 KR 대한민국 FAMILY
8 KR1020040063846 KR 대한민국 FAMILY
9 KR1020050090053 KR 대한민국 FAMILY
10 KR1020050101105 KR 대한민국 FAMILY
11 KR1020050118099 KR 대한민국 FAMILY
12 KR1020050118107 KR 대한민국 FAMILY
13 KR1020060066634 KR 대한민국 FAMILY
14 KR1020070062399 KR 대한민국 FAMILY
15 KR1020070108303 KR 대한민국 FAMILY
16 US08781808 US 미국 FAMILY
17 US20080306721 US 미국 FAMILY
18 US20090150136 US 미국 FAMILY
19 US20110184713 US 미국 FAMILY
20 WO2005093575 WO 세계지적재산권기구(WIPO) FAMILY
21 WO2007043786 WO 세계지적재산권기구(WIPO) FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 JP2007528553 JP 일본 DOCDBFAMILY
2 US2008306721 US 미국 DOCDBFAMILY
3 US2009150136 US 미국 DOCDBFAMILY
4 US2011184713 US 미국 DOCDBFAMILY
5 US8781808 US 미국 DOCDBFAMILY
국가 R&D 정보가 없습니다.