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다중 양자비트 논리게이트

  • 기술번호 : KST2015185071
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 다중 양자비트 로직게이트에 관한 것으로, 이와 같은 목적을 달성하기 위한 본 발명의 제조방법은 SOI(SOI: Silicon On Insulator)기판의 위층실리콘층(top-Si)에 소오스, 드레인을 연결하는 수십 나노미터이하 선폭 및 길이의 이중양자점이 형성될 전도채널 및 이와 수직방향인 다중 측면게이트들을 이격거리 수십 나노미터이하로 형성하는 단계와, 다중양자점을 제외한 나머지 부분을 도핑하는 단계, 이후 게이트 산화막을 형성한 다음, 전도채널에 이차원 전자개스층을 유발하는 제어게이트를 형성하는 단계 및 통상적인 금속화 공정을 포함하여 이루어진 것이다. 이러한 구조 및 제조방법을 통해서 완성된 소자의 핵심적인 동작에 있어서의 특징은 자기장 혹은 전기장 펄스하의 두 개의 커플링된 이중양자점내 2개전자의 스핀으로 구성된 시스템 내부 전자들의 스핀 기저상태 및 들뜬 스핀 고유상태간의 뒤얽힘(Entanglement)현상 및 스핀 Singlet-Triplet 천이현상을 이용하여 원하는 바, 양자전산을 수행할 수 있도록 고안된 소자이다. SOI, 단전자 트랜지스터, 양자점, 양자전산, Spin, Spintronics, Qubit, Quantum Gate, Quantum Computation, Nano Device
Int. CL H01L 27/12 (2011.01) B82Y 10/00 (2011.01)
CPC H01L 29/7613(2013.01) H01L 29/7613(2013.01)
출원번호/일자 1020080053507 (2008.06.09)
출원인 충북대학교 산학협력단
등록번호/일자
공개번호/일자 10-2009-0127495 (2009.12.14) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 취하
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 8

출원인

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번호 이름 국적 주소
1 충북대학교 산학협력단 대한민국 충청북도 청주시 서원구

발명자

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번호 이름 국적 주소
1 최중범 대한민국 충청북도 청주시 흥덕구
2 이상돈 대한민국 충청북도 청주시 흥덕구

대리인

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번호 이름 국적 주소
1 김정현 대한민국 서울특별시 강남구 역삼로 ***, *층 (역삼동, 신명빌딩)(한맥국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2008.06.09 수리 (Accepted) 1-1-2008-0408057-28
2 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status
2008.11.03 수리 (Accepted) 1-1-2008-0762944-15
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.08.28 수리 (Accepted) 4-1-2014-5103343-45
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.06.17 수리 (Accepted) 4-1-2015-5081402-70
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.05.15 수리 (Accepted) 4-1-2018-5086612-26
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.06 수리 (Accepted) 4-1-2020-5149268-82
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번호 청구항
1 1
본 출원된 다중 양자비트 로직게이트에 있어서, SOI기판의 위층실리콘층에 대하여 소오스와 드레인을 연결하는 전도채널 중앙부분에 수직방향으로, 수십 나노미터 이격거리에 측면게이트1, 측면게이트2 및 측면게이트3과 측면게이트4가 동일 위층 실리콘평면상에 위치하고, 이후 형성되어진 게이트 산화막 위로 통상적인 제어게이트가 위치하는 구조를 특징으로 하는 다중 양자비트 양자전산 로직게이트,
2 2
본 출원의 다중 양자비트 로직게이트 제작방식에 있어서, 수 내지 수십 나노미터 폭 및 길이의 전도채널로 연결된 소오스와 드레인 및 다중 측면게이트를 위층 실리콘에 전자빔 리소그래피를 이용한 극미세 패턴을 이용하여 한정하는 단계: 이후, 전자빔 리소그래피를 이용한 극미세 패턴을 식각하여 위층 실리콘에 액티브 영역 및 측면게이트를 형성하는 단계: 이후, 기판 전면에 게이트 산화막을 형성하는 단계: 이후, 기판 전면에 제어 게이트로 사용될 물질을 적층하는것을 특징으로 하는 다중 양자비트 양자전산 로직게이트
3 3
측면게이트1과 측면게이트4의 기능과 역할에 있어, 측면게이트1과 4에 음의 전압을 인가, 전도채널에 양자점을 형성함과 동시에, 이중 양자점과 소스 및 드레인과의 접합 부분에서의 명확한 터널장벽 형성 및 독립된 포텐샬 인가로 인한 동일 크기의 2개 양자점의 구현이 가능함을 특징으로 하는 다중 양자비트 양자전산 로직게이트
4 4
측면게이트2의 기능과 역할에 있어, 음의 전압을 인가함으로써 양자점1과 양자점2간의 커플링 상수의 조절이 가능함을 특징으로 하는 다중 양자비트 양자전산 로직게이트
5 5
측면게이트4의 기능 및 역할에 부가하여, 외부자기장 변화에 따른 이중 양자점내 2개전자 스핀 exchange J의 변화를 이중양자점내 2개전자 파동함수의 반대칭 특성상, even 및 odd간 극미세 전하분포 차이를 유발하는데, 이를 측면게이트4와 이중양자점간 급격한 전압변화를 RF-SET 또는 QPC를 써서 감지하는 것을 특징으로 하는 다중 양자비트 로직 게이트
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다중 양자비트 양자전산 로직게이트의 핵심 작동방식에 있어서, 외부자기장 BEX를 천이자기장 BT에 고정시킨 후, 진동수 f의 국소자기장펄스를 양자점에 수직으로 가해주거나 혹은 측면게이트2에 전기장펄스를 가해주어 이중양자점내 2개 전자의 스핀 뒤얽힘 상태가 스핀 singlet에서 triplet 또는 역방향의 천이를 발생 시키는 것을 특징으로 하는 다중 양자비트 양자전산 로직게이트
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청구항 2에서 소자구조의 전체적인 구조는 유지하되 측면게이트들의 개수를 늘리거나 혹은 배치를 달리하여 다중 양자비트까지 확장 가능케 하는 다중 양자비트 양자전산 로직게이트
8 8
측면게이트1과 2, 3, 4는 각각 독립적으로 조절이 가능함을 특징으로 하는 다중 양자비트 양자전산 로직게이트
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.