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반도체 나노구조체를 이용한 샤트키 전극을 포함하는전기소자 및 이의 제조방법

  • 기술번호 : KST2015186871
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요약 본 발명은 반도체 나노선 또는 나노막대를 이용하여 형성된 샤트키(Schottky) 전극 구조를 포함하는 전기 소자, 특히 샤트키 다이오드 및 금속/반도체 전계트랜지스터(MESFET), 및 이들을 적절히 배열해서 구성한 로직회로에 관한 것이다. 본 발명에 따르면 미리 형성된 금속 패턴 위에 반도체 나노구조체를 분산시켜 샤트키 컨택(Schottky contact)을 형성하도록 한 샤트키 전극을 이용함으로써, 정류특성이 우수한 샤트키 다이오드 및 우수한 성능의 금속/반도체 전계트랜지스터(MESFET)를 제작할 수 있으며, 이들 소자들을 이용하여 기존의 방법보다 훨씬 간단한 구조로 로직회로를 구현할 수 있다.
Int. CL H01L 29/812 (2011.01) B82Y 10/00 (2011.01)
CPC H01L 29/0673(2013.01) H01L 29/0673(2013.01) H01L 29/0673(2013.01) H01L 29/0673(2013.01)
출원번호/일자 1020040042040 (2004.06.09)
출원인 학교법인 포항공과대학교
등록번호/일자 10-0593257-0000 (2006.06.19)
공개번호/일자 10-2005-0116925 (2005.12.14) 문서열기
공고번호/일자 (20060626) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2004.06.09)
심사청구항수 17

출원인

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번호 이름 국적 주소
1 학교법인 포항공과대학교 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 이규철 대한민국 경상북도 포항시 남구
2 박원일 대한민국 경상북도 포항시 남구
3 김진숙 대한민국 경상북도 포항시 남구

대리인

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번호 이름 국적 주소
1 오규환 대한민국 서울특별시 강남구 강남대로 ***, ****호 (역삼동, 유니온센터)(리제특허법률사무소)
2 장성구 대한민국 서울특별시 서초구 마방로 ** (양재동, 동원F&B빌딩)(제일특허법인(유))

최종권리자

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번호 이름 국적 주소
1 엘지디스플레이 주식회사 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2004.06.09 수리 (Accepted) 1-1-2004-0248130-17
2 선행기술조사의뢰서
Request for Prior Art Search
2005.12.14 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.01.13 수리 (Accepted) 9-1-2006-0001997-15
4 등록결정서
Decision to grant
2006.03.25 발송처리완료 (Completion of Transmission) 9-5-2006-0166102-53
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.07.25 수리 (Accepted) 4-1-2019-5149263-30
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기판 상 일부에 위치된 샤트키 컨택(Schottky contact)용 금속층, 상기 금속층 위에 일부분이 결합된 반도체 나노구조체 및 상기 나노구조체의 다른 일부분 위에 결합된 오믹 컨택(ohmic contact)용 금속층을 포함하는 금속/반도체 전기 소자
2 2
제 1 항에 있어서, 반도체 나노구조체가 한쪽 말단부에서 샤트키 컨택용 금속층과 결합되고 다른 한쪽 말단부에서 오믹 컨택용 금속층과 결합된 구조를 가진, 샤트키 다이오드임을 특징으로 하는 전기 소자
3 3
제 1 항에 있어서, 반도체 나노구조체가 중앙부에서 샤트키 컨택용 금속층과 결합되고 양 말단부에서 오믹 컨택용 금속층과 결합된 구조를 가진, 금속/반도체 전계트랜지스터임을 특징으로 하는 전기 소자
4 4
제 1 항에 있어서, 반도체 나노구조체가 한쪽 말단부에서 샤트키 컨택용 금속층과 결합되고 다른 한쪽 말단부에서 오믹 컨택용 금속층과 결합된 샤트키 다이오드 구조와, 반도체 나노구조체가 중앙부에서 샤트키 컨택용 금속층과 결합되고 양 말단부에서 오믹 컨택용 금속층과 결합된 전계트랜지스터 구조가 조합된 로직회로(logic circuit)임을 특징으로 하는 전기 소자
5 5
제 1 항에 있어서, 반도체 나노구조체가 지름 1 내지 100 nm 범위, 길이 5 nm 내지 10 ㎛ 범위의 나노선 또는 나노 막대임을 특징으로 하는, 전기 소자
6 6
제 5 항에 있어서, 반도체 나노구조체의 비저항이 0
7 7
제 1 항에 있어서, 반도체 나노구조체가 ZnO, CdO, In2O3, MgO, Al2O3, AlN, InN, GaN, Si, Ge, AlP, InP, GaP, InAs, GaAs, AlAs, InSb, GaSb, ZnSe, ZnS, CdS, CdSe, BiSb 및 이들의 합금으로 이루어진 군 중에서 선택된 물질로 형성된 것임을 특징으로 하는, 전기 소자
8 8
제 7 항에 있어서, 반도체 나노 구조체가 Mg, Zn, Cd, Ti, Li, Cu, Al, Ni, Y, Ag, Mn, V, Fe, La, Ta, Nb, Ga, In, S, Se, P, As, Co, Cr, B, N, Sb 및 H로 이루어진 군 중에서 선택된 1종 이상의 이종물질로 도핑된 것임을 특징으로 하는, 전기 소자
9 9
제 1 항에 있어서, 반도체 나노구조체가 단일벽 구조, 다중벽 구조, 양자우물 구조, 초격자 구조, p-n 접합 구조 또는 이들의 동종 또는 이종 접합 구조로 이루어진 것임을 특징으로 하는, 전기 소자
10 10
제 1 항에 있어서, 샤트키 컨택용 금속층이, 반도체의 전자 친화도(electron affinity)보다 큰 일함수를 갖는 금속으로 이루어짐을 특징으로 하는, 전기 소자
11 11
제 9 항에 있어서, 샤트키 컨택용 금속층이, Ni, Pt, Pd, Au, W, Ag 또는 이들의 합금, 또는 실리사이드 계열 물질로 이루어짐을 특징으로 하는, 전기 소자
12 12
기판 일부에 샤트키 컨택용 금속의 패턴을 형성한 후, 그 위에 반도체 나노 구조체를 그의 일부분이 상기 금속 패턴과 접촉되도록 결합시키고, 상기 반도체 나노구조체 상의 다른 일부분 위에 오믹 컨택용 금속층을 적층하는 것을 포함하는, 금속/반도체 전기 소자의 제조방법
13 13
제 12 항에 있어서, 기판 일부에 형성된 금속 패턴 위에 반도체 나노구조체의 한 쪽 말단부를 결합시키고, 상기 나노구조체의 다른 한 쪽 말단부에 오믹 컨택용 금속층을 적층하는 것을 포함하는 공정에 의해 샤트키 다이오드를 제조하는 것을 특징으로 하는 방법
14 14
제 12 항에 있어서, 기판 일부에 형성된 금속 패턴 위에 반도체 나노구조체의 길이방향 중앙부를 결합시키고, 상기 나노구조체의 양 말단부에 오믹 컨택용 금속층을 적층하는 것을 포함하는 공정에 의해 금속/반도체 전계트랜지스터를 제조하는 것을 특징으로 하는 방법
15 15
제 12 항에 있어서, 반도체 나노구조체가 나노선 또는 나노막대임을 특징으로 하는 방법
16 16
제 12 항에 있어서, 샤트키 컨택용 금속이, 반도체의 전자 친화도(electron affinity)보다 큰 일함수를 갖는 금속임을 특징으로 하는, 방법
17 17
제 12 항에 있어서, 샤트키 컨택용 금속이, Ni, Pt, Pd, Au, W, Ag 또는 이들의 합금, 또는 실리사이드 계열임을 특징으로 하는, 방법
18 17
제 12 항에 있어서, 샤트키 컨택용 금속이, Ni, Pt, Pd, Au, W, Ag 또는 이들의 합금, 또는 실리사이드 계열임을 특징으로 하는, 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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