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이리듐 함유 게이트 전극을 갖춘 HFET 소자 및 반도체소자와 이들의 제조방법

  • 기술번호 : KST2015186990
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 Ir을 열처리에 의해 산화시켜 형성된 전도성 산화물을 포함하는 게이트 전극을 갖춘 반도체 소자 및 그 제조 방법에 관하여 개시한다. 본 발명에 따른 반도체 소자는 기판과, 상기 기판 위에 형성된 제1 질화물계 반도체층으로 이루어지는 제1층과, 상기 제1층 위에 형성되고 상기 제1 질화물계 반도체층과는 다른 격자 상수를 갖는 제2 질화물계 반도체층으로 이루어지는 제2층과, 상기 제2층 위에 형성된 소오스 및 드레인 전극과, 상기 제2층 위에 형성되고, Ir 함유 물질로 이루어지는 게이트 전극을 포함한다. Ir 함유 물질로 이루어지는 게이트 전극을 형성하기 위하여, 먼저 상기 패터닝된 질화물계 반도체층 위에 Ir 함유 금속층을 형성한다. 그 후, 상기 Ir 함유 금속층을 열처리한다. 상기 Ir 함유 금속층의 열처리는 200 ∼ 600℃의 온도로 행해진다. 상기 Ir 함유 금속층의 열처리는 RTP 장치를 이용하여 행해지며, 산소, 질소 또는 아르곤 분위기하에서 행해진다. AlGaN/GaN HFET, 게이트 전극, Ir, 전도성 산화물, 쇼트키 장벽.
Int. CL H01L 29/778 (2006.01)
CPC H01L 29/7782(2013.01) H01L 29/7782(2013.01)
출원번호/일자 1020020015110 (2002.03.20)
출원인 학교법인 포항공과대학교
등록번호/일자 10-0458163-0000 (2004.11.12)
공개번호/일자 10-2003-0075749 (2003.09.26) 문서열기
공고번호/일자 (20041126) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.03.20)
심사청구항수 28

출원인

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번호 이름 국적 주소
1 학교법인 포항공과대학교 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 이종람 대한민국 경상북도포항시남구
2 전창민 대한민국 서울특별시양천구
3 장호원 대한민국 경상북도의성군

대리인

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번호 이름 국적 주소
1 이영필 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)
2 이해영 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)

최종권리자

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번호 이름 국적 주소
1 학교법인 포항공과대학교 경북 포항시 남구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2002.03.20 수리 (Accepted) 1-1-2002-0081466-45
2 의견제출통지서
Notification of reason for refusal
2004.02.26 발송처리완료 (Completion of Transmission) 9-5-2004-0072002-90
3 명세서 등 보정서
Amendment to Description, etc.
2004.04.21 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2004-0164064-43
4 의견서
Written Opinion
2004.04.21 수리 (Accepted) 1-1-2004-0164063-08
5 등록결정서
Decision to grant
2004.10.28 발송처리완료 (Completion of Transmission) 9-5-2004-0455139-63
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.07.25 수리 (Accepted) 4-1-2019-5149263-30
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번호 청구항
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기판 위에 질화물계 반도체층을 형성하는 단계와,

상기 질화물계 반도체층을 메사 에칭(mesa etching)에 의해 패터닝하여 소자 분리하는 단계와,

상기 패터닝된 질화물계 반도체층 위에 소오스 및 드레인 전극을 형성하는 단계와,

상기 패터닝된 질화물계 반도체층 위에 Ir 함유 금속층을 형성하는 단계와,

상기 Ir 함유 금속층을 열처리하여 게이트 전극을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법

16 16

제15항에 있어서, 상기 기판은 사파이어 또는 SiC로 이루어진 것을 특징으로 하는 반도체 소자의 제조 방법

17 17

제15항에 있어서, 상기 질화물계 반도체층을 형성하는 단계는

상기 기판 위에 제1 질화물계 화합물을 성장시켜 제1 반도체층을 형성하는 단계와,

상기 제1 반도체층 위에 상기 제1 질화물계 화합물과는 다른 격자 상수를 갖는 제2 질화물계 화합물을 성장시켜 제2 반도체층을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법

18 18

제17항에 있어서, 상기 제1 질화물계 화합물은 GaN으로 이루어지는 것을 특징으로 하는 반도체 소자의 제조 방법

19 19

제17항에 있어서, 상기 제2 질화물계 화합물은 AlGaN으로 이루어지는 것을 특징으로 하는 반도체 소자의 제조 방법

20 20

제15항에 있어서, 상기 소오스 및 드레인 전극을 형성하는 단계는

상기 패터닝된 질화물계 반도체층 위에 오믹 금속층을 형성하는 단계와,

상기 오믹 금속층을 RTP(rapid thermal processing)로 열처리하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법

21 21

제20항에 있어서, 상기 오믹 금속층은 Ti/Al/Ni/Au의 적층 구조로 이루어지는 것을 특징으로 하는 반도체 소자의 제조 방법

22 22

제20항에 있어서, 상기 오믹 금속층의 열처리는 600 ∼ 800℃의 온도로 행해지는 것을 특징으로 하는 반도체 소자의 제조 방법

23 23

제20항에 있어서, 상기 오믹 금속층의 열처리는 불활성 가스 분위기하에서 행해지는 것을 특징으로 하는 반도체 소자의 제조 방법

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제15항에 있어서, 상기 Ir 함유 금속층의 열처리는 200 ∼ 600℃의 온도로 행해지는 것을 특징으로 하는 반도체 소자의 제조 방법

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제15항에 있어서, 상기 Ir 함유 금속층의 열처리는 RTP 장치를 이용하여 행해지는 것을 특징으로 하는 반도체 소자의 제조 방법

27 27

제15항에 있어서, 상기 Ir 함유 금속층의 열처리는 산소, 질소 또는 아르곤 분위기하에서 행해지는 것을 특징으로 하는 반도체 소자의 제조 방법

28 28

제15항에 있어서, 상기 Ir 함유 금속층은 Ir 또는 Ir 합금으로 이루어지는 것을 특징으로 하는 반도체 소자의 제조 방법

29 29

제28항에 있어서, 상기 Ir 함유 금속층은 Ir, Ir/Au, Ir/Pt 또는 Ir/Ni로 이루어지는 것을 특징으로 하는 반도체 소자의 제조 방법

30 30

기판 위에 질화물계 반도체층으로 이루어지는 채널층을 형성하는 단계와,

상기 채널층 위에 오믹 전극을 형성하는 단계와,

상기 채널층 위에 Ir 함유 금속층을 형성하는 단계와,

상기 Ir 함유 금속층을 열처리하여 쇼트키 전극을 형성하는 단계를 포함하는 것을 특징으로 하는 HFET(heterostructure field effect transistor) 소자의 제조 방법

31 31

제30항에 있어서, 상기 기판은 사파이어 또는 SiC로 이루어진 것을 특징으로 하는 HFET 소자의 제조 방법

32 32

제30항에 있어서, 상기 채널층을 형성하는 단계는

상기 기판 위에 제1 질화물계 반도체층을 형성하는 단계와,

상기 제1 질화물계 반도체층 위에 상기 제1 질화물계 반도체층과는 다른 격자 상수를 갖는 제2 질화물계 반도체층을 형성하는 단계를 포함하는 것을 특징으로 하는 HFET 소자의 제조 방법

33 33

제32항에 있어서, 상기 제1 질화물계 반도체층은 GaN으로 이루어지는 것을 특징으로 하는 HFET 소자의 제조 방법

34 34

제32항에 있어서, 상기 제2 질화물계 반도체층은 AlGaN으로 이루어지는 것을 특징으로 하는 HFET 소자의 제조 방법

35 35

제30항에 있어서, 상기 오믹 전극을 형성하는 단계는

상기 채널층 위에 오믹 금속층을 형성하는 단계와,

상기 오믹 금속층을 RTP(rapid thermal processing)로 열처리하는 단계를 포함하는 것을 특징으로 하는 HFET 소자의 제조 방법

36 36

제35항에 있어서, 상기 오믹 금속층은 Ti/Al/Ni/Au의 적층 구조로 이루어지는 것을 특징으로 하는 HFET 소자의 제조 방법

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제35항에 있어서, 상기 오믹 금속층의 열처리는 600 ∼ 800℃의 온도로 행해지는 것을 특징으로 하는 HFET 소자의 제조 방법

38 38

제35항에 있어서, 상기 오믹 금속층의 열처리는 불활성 가스 분위기하에서 행해지는 것을 특징으로 하는 HFET 소자의 제조 방법

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제30항에 있어서, 상기 Ir 함유 금속층의 열처리는 200 ∼ 600℃의 온도로 행해지는 것을 특징으로 하는 HFET 소자의 제조 방법

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제30항에 있어서, 상기 Ir 함유 금속층의 열처리는 RTP 장치를 이용하여 행해지는 것을 특징으로 하는 HFET 소자의 제조 방법

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제30항에 있어서, 상기 Ir 함유 금속층의 열처리는 산소, 질소 또는 아르곤 분위기하에서 행해지는 것을 특징으로 하는 HFET 소자의 제조 방법

43 43

제30항에 있어서, 상기 Ir 함유 금속층은 Ir 또는 Ir 합금으로 이루어지는 것을 특징으로 하는 HFET 소자의 제조 방법

44 44

제43항에 있어서, 상기 Ir 함유 금속층은 Ir, Ir/Au, Ir/Pt 또는 Ir/Ni로 이루어지는 것을 특징으로 하는 HFET 소자의 제조 방법

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패밀리정보가 없습니다
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