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비적층적 및 대칭적 전류모드 논리회로

  • 기술번호 : KST2015188418
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 비적층적이며 대칭적인 특징을 갖는 전류모드 논리회로가 개시된다. 본 발명의 실시예에 따른 전류모드 논리회로는 제1 전원전압이 제1 출력단을 통해 인가되고, 목적하는 논리식 이 1일 때에만 전류가 흐르도록 구성된 제1 입력 트랜지스터 그룹, 제2 전원전압이 제2 출력단을 통해 인가되고, 상기 의 보수(complement) 인 논리식 이 1일 때에만 전류를 흐르도록 구성된 제2 입력 트랜지스터 그룹, 및 상기 제1 입력 트랜지스터 그룹의, 상기 제1 출력단의 반대단 및 상기 제2 트랜지스터 그룹의, 상기 제2 출력단의 반대단과 접지단 사이에 연결된 단일 전류원을 포함하여 논리 게이트를 구성한다.
Int. CL H03K 19/0944 (2006.01) H03K 3/356 (2006.01)
CPC H03K 19/09432(2013.01) H03K 19/09432(2013.01) H03K 19/09432(2013.01)
출원번호/일자 1020130022399 (2013.02.28)
출원인 동국대학교 산학협력단
등록번호/일자 10-1428027-0000 (2014.08.01)
공개번호/일자
공고번호/일자 (20140811) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2013.02.28)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 동국대학교 산학협력단 대한민국 서울특별시 중구

발명자

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번호 이름 국적 주소
1 변상진 대한민국 서울 용산구

대리인

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번호 이름 국적 주소
1 특허법인이지 대한민국 서울특별시 금천구 가산디지털*로 ***(가산동, KCC웰츠밸리) ***-***

최종권리자

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번호 이름 국적 주소
1 동국대학교 산학협력단 서울특별시 중구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2013.02.28 수리 (Accepted) 1-1-2013-0184625-26
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.01.10 수리 (Accepted) 4-1-2014-0002002-62
3 선행기술조사의뢰서
Request for Prior Art Search		 2014.02.06 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2014.03.10 수리 (Accepted) 9-1-2014-0019800-83
5 의견제출통지서
Notification of reason for refusal		 2014.03.19 발송처리완료 (Completion of Transmission) 9-5-2014-0192531-57
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2014.05.07 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2014-0429725-53
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2014.05.07 수리 (Accepted) 1-1-2014-0429686-60
8 거절결정서
Decision to Refuse a Patent		 2014.06.19 발송처리완료 (Completion of Transmission) 9-5-2014-0416951-18
9 [명세서등 보정]보정서(재심사)
Amendment to Description, etc(Reexamination)		 2014.06.30 보정승인 (Acceptance of amendment) 1-1-2014-0615598-14
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2014.06.30 수리 (Accepted) 1-1-2014-0615538-85
11 등록결정서
Decision to Grant Registration		 2014.07.30 발송처리완료 (Completion of Transmission) 9-5-2014-0522643-69
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.16 수리 (Accepted) 4-1-2019-5163486-33
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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제1 전원전압이 제1 출력단을 통해 인가되고, 입력 가 인가된 제1 트랜지스터와 입력 가 인가된 제2 트랜지스터가 직렬 연결된 제1 지로(branch)와, 입력 가 인가된 제3 트랜지스터와 입력 가 인가된 제4 트랜지스터가 직렬 연결된 제2 지로의 병렬 연결로 구성되는 제1 입력 트랜지스터 그룹; 제2 전원전압이 제2 출력단을 통해 인가되고, 입력 가 인가된 제5 트랜지스터와 입력 가 인가된 제6 트랜지스터가 직렬 연결된 제3 지로와, 입력 가 인가된 제7 트랜지스터와 입력 가 인가된 제8 트랜지스터가 직렬 연결된 제4 지로의 병렬 연결로 구성되는 제2 입력 트랜지스터 그룹; 상기 제1 입력 트랜지스터 그룹에 병렬 연결되고, 상기 제1 입력 트랜지스터 그룹과 대칭적 구조를 갖는 제3 입력 트랜지스터 그룹; 상기 제2 입력 트랜지스터 그룹에 병렬 연결되고, 상기 제2 입력 트랜지스터 그룹과 대칭적 구조를 갖는 제4 입력 트랜지스터 그룹; 및 상기 제1 입력 트랜지스터 그룹의 상기 제1 출력단의 반대단 및 상기 제2 입력 트랜지스터 그룹의 상기 제2 출력단의 반대단과 접지단 사이에 연결되며, 지속적으로 일정한 전류를 발생시키는 단일 전류원을 포함하는 전류모드 논리회로
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제1 전원전압이 제1 출력단을 통해 인가되고, 입력 가 인가된 제1 트랜지스터와 입력 가 인가된 제2 트랜지스터가 직렬 연결된 제1 지로와, 입력 가 인가된 제3 트랜지스터와 입력 가 인가된 제4 트랜지스터가 직렬 연결된 제2 지로의 병렬 연결로 구성되는 제1 입력 트랜지스터 그룹; 제2 전원전압이 제2 출력단을 통해 인가되고, 입력 가 인가된 제5 트랜지스터와 입력 가 인가된 제6 트랜지스터의 직렬 연결로 구성되는 제2 입력 트랜지스터 그룹; 상기 제2 입력 트랜지스터 그룹에 병렬 연결되고, 상기 제2 입력 트랜지스터 그룹과 대칭적 구조를 갖는 제 3 입력 트랜지스터 그룹; 및 상기 제1 입력 트랜지스터 그룹의 상기 제1 출력단의 반대단 및 상기 제2 입력 트랜지스터 그룹의 상기 제2 출력단의 반대단과 접지단 사이에 연결되며, 지속적으로 일정한 전류를 발생시키는 단일 전류원을 포함하는 전류모드 논리회로
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제1 전원 전압이 제1 출력단을 통해 인가되고, 입력 가 인가된 제1 트랜지스터와 입력 가 인가된 제2 트랜지스터의 직렬 연결로 구성되는 제1 입력 트랜지스터 그룹; 제2 전원전압이 제2 출력단을 통해 인가되고, 입력 가 인가된 제3 트랜지스터와 입력 가 인가된 제4 트랜지스터가 직렬 연결된 제1 지로와 입력 가 인가된 제5 트랜지스터와 입력 가 인가된 제6 트랜지스터가 직렬 연결된 제2 지로의 병렬 연결로 구성되는 제2 입력 트랜지스터 그룹; 상기 제1 입력 트랜지스터 그룹에 병렬 연결되고, 상기 제1 입력 트랜지스터 그룹과 대칭적 구조를 갖는 제3 입력 트랜지스터 그룹; 및 상기 제1 입력 트랜지스터 그룹의 상기 제1 출력단의 반대단 및 상기 제2 입력 트랜지스터 그룹의 상기 제2 출력단의 반대단과 접지단 사이에 연결되며, 지속적으로 일정한 전류를 발생시키는 단일 전류원을 포함하는 전류모드 논리회로
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순번 연구부처 주관기관 연구사업 연구과제
1 교육과학기술부 동국대학교 산학협력단 일반연구자지원사업(신진) 모바일 전자정보 기기용 저 전력 광대역 직렬 데이터 송수신기 설계연구 [1/3]