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써미스터-바리스터 복합칩 소자 및 그 제조방법

  • 기술번호 : KST2015188723
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 써미스터와 바리스터를 결합하여 단일의 칩으로 구현한 써미스터-바리스터 복합칩 소자와 이의 제조비용을 절감할 수 있는 제조방법에 관한 것이다. 본 발명에 의한 써미스터-바리스터 복합칩 소자는 복수개의 써미스터층과 바리스터층이 각각 적층되어 단일칩으로 제조된 복합칩 소자에 있어서, 상기 써미스터층은 티탄산바륨(BaTiO3)에 사마륨산화물(Sm2O3), 이산화규소(SiO2) 및 산화망간(Mn3O4)를 첨가한 조성물로 되고, 상기 바리스터층은 산화아연(ZnO)에 테르븀산화물(TeO2), 산화망간(Mn3O4), 코발트산화물(Co3O4), 이산화규소(SiO2) 및 프라세오디뮴산화물(Pr6O11)를 첨가한 조성물로 구성된다. 또한, 상기 적어도 하나 이상의 써미스터층과 바리스터층의 각 상면 및 하면에는 니켈(Ni) 재질의 전극패턴이 형성된다. 써미스터-바리스터복합칩소자
Int. CL H01C 7/10 (2006.01)
CPC H01C 7/10(2013.01) H01C 7/10(2013.01) H01C 7/10(2013.01) H01C 7/10(2013.01)
출원번호/일자 1020080037655 (2008.04.23)
출원인 한국세라믹기술원
등록번호/일자 10-0973058-0000 (2010.07.23)
공개번호/일자 10-2009-0112005 (2009.10.28) 문서열기
공고번호/일자 (20100729) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.04.23)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국세라믹기술원 대한민국 경상남도 진주시 소호로 ***

발명자

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번호 이름 국적 주소
1 홍연우 대한민국 대구 중구
2 신효순 대한민국 경기 수원시 장안구
3 여동훈 대한민국 서울 송파구
4 김종희 대한민국 서울 송파구

대리인

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번호 이름 국적 주소
1 이두희 대한민국 서울특별시 강남구 테헤란로 ***(역삼동) 한신인터밸리** 빌딩 서관 ****호(이훈국제특허법률사무소)
2 이훈 대한민국 서울특별시 강남구 테헤란로 ***, 한신인터밸리 서관 ****호 이훈국제특허법률사무소 (역삼동)
3 특허법인충정 대한민국 서울특별시 강남구 역삼로***,*층(역삼동,성보역삼빌딩)

최종권리자

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번호 이름 국적 주소
1 한국세라믹기술원 대한민국 경상남도 진주시 소호로 ***
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2008.04.23 수리 (Accepted) 1-1-2008-0289601-53
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.11.25 수리 (Accepted) 4-1-2008-5187618-45
3 선행기술조사의뢰서
Request for Prior Art Search
2009.02.10 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2009.03.13 수리 (Accepted) 9-1-2009-0013903-85
5 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status
2009.07.06 수리 (Accepted) 1-1-2009-0410356-13
6 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2009.07.14 수리 (Accepted) 1-1-2009-0427491-55
7 의견제출통지서
Notification of reason for refusal
2010.02.26 발송처리완료 (Completion of Transmission) 9-5-2010-0086800-87
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2010.04.16 수리 (Accepted) 1-1-2010-0243295-66
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2010.04.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2010-0243318-28
10 등록결정서
Decision to grant
2010.07.08 발송처리완료 (Completion of Transmission) 9-5-2010-0293049-04
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.01.03 수리 (Accepted) 4-1-2014-0000353-25
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.03.31 수리 (Accepted) 4-1-2015-5040685-78
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
적어도 하나 이상의 써미스터층과 바리스터층이 각각 적층되어 단일칩으로 제조된 복합칩 소자에 있어서, 상기 써미스터층은 티탄산바륨(BaTiO3)에 사마륨산화물(Sm2O3), 산화망간(Mn3O4) 및 이산화규소(SiO2)를 첨가한 조성물로 되고; 상기 바리스터층은 산화아연(ZnO)에 테르븀산화물(TeO2), 산화망간(Mn3O4), 코발트산화물(Co3O4), 이산화규소(SiO2) 및 프라세오디뮴산화물(Pr6O11)를 첨가한 조성물로 되는 것을 특징으로 하는 복합칩 소자
2 2
삭제
3 3
제1항에 있어서, 상기 써미스터층의 조성물들은 다음의 함유량으로 포함되는 것을 특징으로 하는 복합칩 소자: BaTiO3: 97
4 4
제1항에 있어서, 상기 바리스터층의 조성물들은 다음의 함유량으로 포함되는 것을 특징으로 하는 복합칩 소자: ZnO: 90
5 5
제1항에 있어서, 상기 적어도 하나 이상의 써미스터층과 바리스터층의 각 상면 및 하면에는 니켈(Ni) 재질의 전극패턴이 형성되는 것을 특징으로 하는 복합칩 소자
6 6
적어도 하나 이상의 써미스터층과 바리스터층이 각각 적층되어 단일칩으로 제조된 복합칩 소자의 제조방법에 있어서, 적어도 하나 이상의 써미스터 시트와 바리스터 시트를 형성하는 제1단계와; 상기 적어도 하나 이상의 써미스터층과 바리스터층의 각 상면 및 하면에 내부전극을 형성하는 제2단계와; 상기 적어도 하나 이상의 써미스터 시트와 바리스터 시트를 적층하고 이를 소결하여 복합칩 소자를 형성하는 제3단계와; 상기 내부전극과 각각 전기적으로 연결되도록 상기 복합칩 소자의 외표면 종단부에 써미스터 전극 및 바리스터 전극을 형성하는 제4단계로 이루어지고, 상기 제1단계에서 상기 써미스터 시트는 97
7 7
제6항에 있어서, 상기 제2단계에서 상기 내부전극은 니켈(Ni) 재질로 형성되는 것을 특징으로 하는 복합칩 소자의 제조방법
8 8
제6항 또는 제7항에 있어서, 상기 제3단계에서 상기 소결은 환원분위기에서 1150 ~ 1300℃에서 1 ~ 3시간 소결한 후 공기중에서 600 ~ 800℃에서 재산화 처리하는 것으로 이루어지는 것을 특징으로 하는 복합칩 소자의 제조방법
9 9
제8항에 있어서, 상기 환원분위기는 0보다 크고 10-9 MPa 이하의 산소분압으로 되는 것을 특징으로 하는 복합칩 소자의 제조방법
10 10
제6항에 있어서, 상기 제1단계에서 상기 써미스터 시트 및 바리스터 시트의 각 조성물은 PVB계 바인더를 각 조성물 총량대비 6 ~ 8wt% 포함하는 것을 특징으로 하는 복합칩 소자의 제조방법
11 11
제10항에 있어서, 상기 제3단계의 상기 소결은 300℃ 이하에서 20시간 열처리하는 공정을 더 포함하여 상기 PVB계 바인더를 번아웃하는 것을 특징으로 하는 복합칩 소자의 제조방법
12 12
제6항에 있어서, 상기 제1단계에서 상기 적어도 하나 이상의 써미스터 시트와 바리스터 시트는 닥터 블레이드로 형성되는 것을 특징으로 하는 복합칩 소자의 제조방법
13 13
제6항에 있어서, 상기 써미스터 전극 및 바리스터 전극은 은(Ag) 재질로 형성되는 것을 특징으로 하는 복합칩 소자의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.