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연산 증폭기, 직류 정전압원(DC Regulator), 반도체 스위치(semiconductor switch) 및 부하 안정화 회로(load stabilizer circuit)를 포함하는 오차 증폭기(error amplifier); 오차 증폭기의 입력단과 출력단 사이에 연결된 노이즈 보상 회로(noise compensation circuit); 및상기 오차 증폭기의 입력단에 연결된 로우 패스 필터(Low Pass Filter)를 포함하는 능동 루프 필터로,상기 노이즈 보상 회로는, 상기 능동 루프 필터의 출력 신호에 대하여 로우 패스 필터링을 수행하여 상기 연산 증폭기의 비반전 입력으로 인가하는 능동 루프 필터
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제1항에 있어서,상기 직류 정전압원은 로우 드롭아웃(LDO, Low Drop Out) 전압 레귤레이터로, 출력 신호가 연산 증폭기의 반전 입력단에 인가되는 능동 루프 필터
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제1항에 있어서, 반도체 스위치의 제어전극은 연산 증폭기의 출력에 전기적으로 연결되고, 반도체 스위치의 일 전극은 부하 안정화 회로와 노이즈 보상 회로에 전기적으로 연결된 능동 루프 필터
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제1항에 있어서,상기 노이즈 보상 회로는 상기 반도체 스위치의 일 전극과 상기 연산 증폭기의 비반전 입력(non-inverting input)에 전기적으로 연결되어 상기 반도체 스위치의 상기 일 전극을 통하여 출력된 전압을 로우 패스 필터링(low pass filtering)하여 상기 연산 증폭기의 비반전 입력에 인가하는 능동 루프 필터
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5
제1항에 있어서, 상기 로우 패스 필터 회로는 1차 이상의 필터로 입력 전극으로 인가된 전류 신호를 전압 신호로 변환하고 로우 패스 필터링을 수행하여 오차 증폭기에 인가하는 능동 루프 필터
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제1항에 있어서, 상기 부하 안정화 회로(load stabilizer circuit)는, 전기적으로 연결된 저항과 커패시터를 포함하는 능동 루프 필터
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8
클록, 데이터 복원(CDR, Clock Data Recovery) 회로에 있어서,연산 증폭기, 직류 정전압원(DC Regulator), 반도체 스위치(semiconductor switch) 및 부하 안정화 회로(load stabilizer circuit)를 포함하는 오차 증폭기(error amplifier); 오차 증폭기의 입력단과 출력단 사이에 연결된 노이즈 보상 회로(noise compensation circuit);상기 오차 증폭기의 입력단에 연결된 로우 패스 필터를 포함하는 능동 루프 필터를 포함하며,상기 노이즈 보상 회로는 상기 반도체 스위치의 일 전극과 상기 연산 증폭기의 비반전 입력(non-inverting input)에 전기적으로 연결되어 상기 반도체 스위치의 상기 일 전극을 통하여 출력된 전압을 로우 패스 필터링(low pass filtering)하여 상기 연산 증폭기의 상기 비반전 입력에 인가하는 클록, 데이터 복원 회로
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9
제8항에 있어서,상기 직류 정전압원은 로우 드롭아웃(LDO, Low Drop Out) 전압 레귤레이터로, 출력 신호가 연산 증폭기의 반전 입력단에 인가되는 클록, 데이터 복원 회로
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10
삭제
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제8항에 있어서, 상기 로우 패스 필터 회로는 1차 이상의 필터로 입력 전극으로 인가된 전류 신호를 전압 신호로 변환하고 로우 패스 필터링을 수행하여 오차 증폭기에 인가하는 클록, 데이터 복원 회로
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제8항에 있어서, 상기 부하 안정화 회로(load stabilizer circuit)는, 전기적으로 연결된 저항과 커패시터를 포함하는 클록, 데이터 복원 회로
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13
제8항에 있어서, 상기 클록, 데이터 복원 회로는,전압-전류 변환 회로를 더 포함하는 클록, 데이터 복원 회로
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제8항에 있어서, 전압-전류 변환 회로는,펌프 업 신호(pump up signal)와 펌프 다운 신호(pump down signal)가 인가되는 제1 차동쌍(differential pair);펌프 업 신호에 상보적인 펌프 업 바 신호와 펌프 다운 신호에 상보적인 펌프 다운 바 신호가 인가되는 제2 차동쌍;제1 차동쌍의 능동 부하(active load)인 제1 전류 미러(current mirror); 제2 차동쌍의 능동 부하인 제2 전류 미러; 및제1 미러의 전류를 미러링하는 제3 전류 미러를 포함하는 클록, 데이터 복원 회로
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위상 고정 루프(PLL, Phase Locked Loop)에 있어서,연산 증폭기, 직류 정전압원(DC Regulator), 반도체 스위치(semiconductor switch) 및 부하 안정화 회로(load stabilizer circuit)를 포함하는 오차 증폭기(error amplifier); 오차 증폭기의 입력단과 출력단 사이에 연결된 노이즈 보상 회로(noise compensation circuit);상기 오차 증폭기의 입력단에 연결된 로우 패스 필터를 포함하는 능동 루프 필터를 포함하며,상기 노이즈 보상 회로는 상기 반도체 스위치의 일 전극과 상기 연산 증폭기의 비반전 입력(non-inverting input)에 전기적으로 연결되어 상기 반도체 스위치의 상기 일 전극을 통하여 출력된 전압을 로우 패스 필터링(low pass filtering)하여 상기 연산 증폭기의 비반전 입력에 인가하는 위상 고정 루프
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제15항에 있어서,상기 직류 정전압원은 로우 드롭아웃(LDO, Low Drop Out) 전압 레귤레이터로, 출력 신호가 연산 증폭기의 반전 입력단에 인가되는 위상 고정 루프
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17
삭제
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제15항에 있어서, 상기 로우 패스 필터 회로는 1차 이상의 필터로 입력 전극으로 인가된 전류 신호를 전압 신호로 변환하고 로우 패스 필터링을 수행하여 오차 증폭기에 인가하는 위상 고정 루프
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제15항에 있어서, 상기 부하 안정화 회로(load stabilizer circuit)는, 전기적으로 연결된 저항과 커패시터를 포함하는 위상 고정 루프
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제15항에 있어서, 상기 위상 고정 루프는,전압-전류 변환 회로를 더 포함하는 위상 고정 루프
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제15항에 있어서, 전압-전류 변환 회로는,펌프 업 신호(pump up signal)와 펌프 다운 신호(pump down signal)가 인가되는 제1 차동쌍(differential pair);펌프 업 신호에 상보적인 펌프 업 바 신호와 펌프 다운 신호에 상보적인 펌프 다운 바 신호가 인가되는 제2 차동쌍;제1 차동쌍의 능동 부하(active load)인 제1 전류 미러(current mirror); 제2 차동쌍의 능동 부하인 제2 전류 미러; 및제1 미러의 전류를 미러링하는 제3 전류 미러를 포함하는 위상 고정 루프
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