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게이트 절연막과 유기 반도체층 간에 계면안정화층을형성시킨 유기 박막 트랜지스터 및 그의 제조 방법

  • 기술번호 : KST2015196933
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은, 일반적으로 능동행렬형(Active Matrix) 디스플레이의 스위칭 소자로 사용되는 유기 박막 트랜지스터의 전계 효과 이동도(Field Effect Mobility)와 온/오프율(Ion/Ioff ratio)을 향상시키기 위하여 게이트 절연막과 유기 반도체 층 간에 계면안정화층을 형성시킨 유기 박막 트랜지스터 및 그의 제조 방법에 관한 것이다. 보다 상세하게는 본 발명은, 유기 박막 트랜지스터의 전계 효과 이동도와 온/오프율을 향상시키기 위한, 기판(1); 상기 기판의 상부에 형성된 게이트 전극(3); 상기 게이트 전극과 기판을 덮도록 형성된 게이트 절연막(4); 상기 게이트 절연막의 상부에 상호 이격된 형태로 형성된 소오스/드레인 전극(5),(6)들; 그리고 상기 소오스/드레인 전극(5),(6)들을 덮는 유기 반도체 층을 포함하는 유기 박막 트랜지스터에 있어서, 상기 유기 반도체층 하부와 상기 게이트 절연층 상부에 형성된 계면안정화층을 포함하는 것을 특징으로 하는 유기 박막 트랜지스터에 대한 것이다.유기 박막 트랜지스터, 표면처리, 펜타센
Int. CL H01L 29/786 (2006.01)
CPC H01L 51/0516(2013.01) H01L 51/0516(2013.01) H01L 51/0516(2013.01) H01L 51/0516(2013.01)
출원번호/일자 1020060061253 (2006.06.30)
출원인 단국대학교 산학협력단
등록번호/일자
공개번호/일자 10-2008-0002414 (2008.01.04) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.03.19)
심사청구항수 29

출원인

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번호 이름 국적 주소
1 단국대학교 산학협력단 대한민국 경기도 용인시 수지구

발명자

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번호 이름 국적 주소
1 강정원 대한민국 서울특별시 용산구
2 오명환 대한민국 경기 용인시 수지구
3 장지근 대한민국 충남 천안시
4 김종무 대한민국 서울특별시 은평구

대리인

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번호 이름 국적 주소
1 서근복 대한민국 서울특별시 강남구 논현로 ***, ****호 동명국제특허법률사무소 (역삼동, 성지하이츠*)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2006.06.30 수리 (Accepted) 1-1-2006-0473952-11
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.02.11 수리 (Accepted) 4-1-2008-5020510-08
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2008.03.19 수리 (Accepted) 1-1-2008-0199741-03
4 선행기술조사의뢰서
Request for Prior Art Search
2009.11.09 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2009.12.04 수리 (Accepted) 9-1-2009-0065280-91
6 의견제출통지서
Notification of reason for refusal
2010.02.25 발송처리완료 (Completion of Transmission) 9-5-2010-0085534-68
7 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2010.04.26 수리 (Accepted) 1-1-2010-0265396-84
8 보정요구서
Request for Amendment
2010.05.03 발송처리완료 (Completion of Transmission) 1-5-2010-0040128-93
9 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2010.05.24 수리 (Accepted) 1-1-2010-0331324-90
10 [출원서등 보정]보정서(납부자번호)
[Amendment to Patent Application, etc.] Amendment(Payer number)
2010.05.25 수리 (Accepted) 1-1-2010-0284899-27
11 보정요구서
Request for Amendment
2010.06.01 발송처리완료 (Completion of Transmission) 1-5-2010-0048712-23
12 [출원서등 보정]보정서(납부자번호)
[Amendment to Patent Application, etc.] Amendment(Payer number)
2010.06.22 수리 (Accepted) 1-1-2010-0351733-18
13 거절결정서
Decision to Refuse a Patent
2010.07.19 발송처리완료 (Completion of Transmission) 9-5-2010-0307240-92
14 [법정기간연장]기간연장(단축, 경과구제)신청서
[Extension of Legal Period] Request for Extension of Period (Reduction, Expiry Reconsideration)
2010.08.18 수리 (Accepted) 7-1-2010-0034682-71
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.03.07 수리 (Accepted) 4-1-2012-5047629-25
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.01.06 수리 (Accepted) 4-1-2014-0000870-18
17 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.10.26 수리 (Accepted) 4-1-2020-5239146-54
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번호 청구항
1 1
기판; 상기 기판의 상부에 형성된 게이트 전극; 상기 게이트 전극과 기판을 덮도록 형성된 게이트 절연막;상기 게이트 절연막의 상부에 상호 이격된 형태로 형성된 소오스/드레인 전극(5),(6)들; 그리고 상기 소오스/드레인 전극(5),(6)들을 덮는 유기 반도체 층을 포함하는 유기 박막 트랜지스터에 있어서, 상기 유기 반도체층 하부와 상기 게이트 절연층 상부에 형성된 계면안정화층을 포함하는 것을 특징으로 하는 유기 박막 트랜지스터
2 2
제1항에 있어서, 상기 기판이 플라스틱인 것임을 특징으로 하는 유기 박막 트랜지스터
3 3
제2항에 있어서, 상기 플라스틱 기판의 상부와 게이트 전극 및 게이트 절연막의 하부 사이에 보호 및 접착력을 위한 박막을 추가로 더 포함하는 것임을 특징으로 하는 유기 박막 트랜지스터
4 4
상기 제3항에 있어서, 상기 추가된 박막이 실리콘 산화막(SiO2)인 것임을 특징으로 하는 유기 박막 트랜지스터
5 5
제3항에 있어서, 상기 추가된 박막은 두께가 200nm인 것임을 특징으로 하는 유기 박막 트랜지스터
6 6
제1항에 있어서, 상기 기판은 폴리에테르설폰(polyethersulfone:PES)인 것임을 특징으로 하는 유기 박막 트랜지스터
7 7
제1항에 있어서, 상기 게이트 전극은 금(AU)인 것임을 특징으로 하는 유기 박막 트랜지스터
8 8
제1항에 있어서, 상기 게이트 전극은 두께가 100nm인 것임을 특징으로 하는 유기 박막 트랜지스터
9 9
제1항에 있어서, 상기 게이트 절연막은 지르코늄 산화막(ZrO2)인 것임을 특징으로 하는 유기 박막 트랜지스터
10 10
제1항에 있어서, 상기 게이트 절연막은 폴리부틸메타크릴레이트 (polybutylmethacrylate:PBMA), 폴리비닐피롤리돈(polyvinyl pyrrolidone:PVP), 폴리메틸메타크릴레이트(polymethylmethacrylate: PMMA) 또는 PCMA 중에서 선택되는 적어도 하나의 물질막인 것임을 특징으로 하는 유기 박막 트랜지스터
11 11
제1항에 있어서, 상기 게이트 절연막은 두께가 250nm인 것임을 특징으로 하는 유기 박막 반도체 트랜지스터
12 12
제1항에 있어서, 상기 소오스/드레인 전극은 금(AU) 또는 인듐 틴 옥사이드(Indium Thin Oxide;ITO)인 것임을 특징으로 하는 유기 박막 트랜지스터
13 13
제1항에 있어서, 상기 소오스/드레인 전극은 두께가 100nm인 것임을 특징으로 하는 유기 박막 트랜지스터
14 14
제1항에 있어서, 상기 유기 반도체 물질이 펜타센(pentacene)인 것임을 특징으로 하는 유기 박막 트랜지스터
15 15
기판을 제공하는 단계; 상기 기판 상부에 게이트 전극을 형성하는 단계; 상기 기판과 게이트 전극의 상부에 게이트 절연막을 형성하는 단계; 상기 절연막 상부에 서로 상호 이격된 형태로 형성된 소오스/드레인 전극을 형성하는 단계; 이소프로판올에 용해시킨 옥타데실트리메톡시실란(octadecyltrimethoxysilan e: OTMS)용액을 제공하는 단계; 불활성 가스 분위기에서 상기의 옥타데실트리메톡시실란 이소프로판올 용액으로 상기의 게이트 절연막의 상부를 표면 처리하는 단계상기 게이트 절연막의 상부에 계면안정화층이 형성되는 단계;불활성 가스로 충진된 오븐에서 건조시키는 단계; 그리고 상기 계면안정화층의 상부와 상기 소오스/드레인 전극의 상부를 포함하는 영역에 유기 반도체 층을 형성하는 단계를 포함하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조방법
16 16
제15항에 있어서, 상기 기판이 플라스틱일 경우 사전에 플라스틱 기판을 온도조건이 120℃인 오븐에서 가열하는 단계를 더 포함하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
17 17
제15항에 있어서, 가열시간이 1시간인 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
18 18
제15항에 있어서, 상기 플라스틱 기판의 상부와 게이트 전극 및 게이트 절연막의 하부 사이에 보호 및 접착력을 위한 박막을 추가하는 단계를 더 포함하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
19 19
제15항에 있어서, 상기 게이트 전극은 디시/알에프 스퍼터링(DC/RF Sputtering) 또는 전자-빔(e-beam)을 사용하여 상기 기판 상부에 형성하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
20 20
제15항에 있어서, 상기 게이트 절연막은 스핀-코팅(Spin-coating)방법을 사용하여 형성하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
21 21
제15항에 있어서, 상기 게이트 절연막은 전자-빔을 사용하여 형성하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
22 22
제15항에 있어서, 상기 소오스/드레인 전극은 스퍼터링하여 형성하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
23 23
제15항에 있어서, 상기 불활성 가스는 질소인 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
24 24
제15항에 있어서, 상기 옥타데실트리메톡시실란과 이소프로판올 용액의 부피비가 1:20인 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
25 25
제15항에 있어서, 상기 옥타데실트리메톡시실란과 이소프로판올 용액에 2 내지 3분간 담그는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
26 26
제15항에 있어서, 건조 온도 조건이 80℃인 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
27 27
제15항에 있어서, 건조 시간이 12시간인 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
28 28
제15항에 있어서, 상기 유기 반도체 층을 섀도우 마스크(shadow mask) 와 열-증착기(thermal-evaporator)를 사용하여 형성하는 것임을 특징으로 하는 유기 박막 트랜지스터 제조 방법
29 29
제28항에 있어서, 60℃의 온도조건에서 0
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.