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CAN 통신 기반의 반도체 테스트 방법 및 시스템

  • 기술번호 : KST2015199899
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 CAN(Controller Area Network) 통신 기반의 반도체 테스트 방법은 테스트 인터페이스에서, CAN 버스를 통하여 메인 컨트롤러로부터 테스트 대상 반도체(Device-Under-Test; DUT)에 대한 테스트를 수행하기 위한 데이터 프레임을 수신하는 단계; 상기 테스트 인터페이스에 포함되는 테스트 인터페이스 컨트롤러에서, 상기 데이터 프레임에 기초하여 상기 테스트 인터페이스의 작동 모드를 상기 테스트 대상 반도체에 대한 테스트를 수행하는 테스트 모드 또는 상기 테스트 대상 반도체의 미리 설정된 일반적인 동작을 수행하는 일반 모드 중 적어도 어느 하나로 결정하는 단계; 및 상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 데이터 프레임을 상기 테스트 대상 반도체에 포함되는 복수의 시프트 스캔 체인들로 인가하여, 상기 테스트 대상 반도체에 대한 테스트를 수행하는 단계를 포함한다.
Int. CL G01R 31/26 (2014.01)
CPC G01R 31/3183(2013.01) G01R 31/3183(2013.01) G01R 31/3183(2013.01) G01R 31/3183(2013.01)
출원번호/일자 1020140012088 (2014.02.03)
출원인 한양대학교 에리카산학협력단
등록번호/일자 10-1473144-0000 (2014.12.09)
공개번호/일자
공고번호/일자 (20141216) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.02.03)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 대한민국 경기도 안산시 상록구

발명자

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번호 이름 국적 주소
1 김두영 대한민국 경기 군포시 용호*로 **, *
2 황도연 대한민국 서울 송파구
3 박성주 대한민국 경기 성남시 분당구
4 문창민 대한민국 경기도 부천시 원미구
5 정지훈 대한민국 경기 안산시 상록구

대리인

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번호 이름 국적 주소
1 양성보 대한민국 서울특별시 강남구 선릉로***길 ** (논현동) 삼성빌딩 *층(피앤티특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 대한민국 경기도 안산시 상록구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.02.03 수리 (Accepted) 1-1-2014-0103452-37
2 등록결정서
Decision to grant
2014.11.28 발송처리완료 (Completion of Transmission) 9-5-2014-0819595-42
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번호 청구항
1 1
CAN(Controller Area Network) 통신 기반의 반도체 테스트 방법에 있어서, 테스트 인터페이스에서, CAN 버스를 통하여 메인 컨트롤러로부터 테스트 대상 반도체(Device-Under-Test; DUT)에 대한 테스트를 수행하기 위한 데이터 프레임을 수신하는 단계; 상기 테스트 인터페이스에 포함되는 테스트 인터페이스 컨트롤러에서, 상기 데이터 프레임에 기초하여 상기 테스트 인터페이스의 작동 모드를 상기 테스트 대상 반도체에 대한 테스트를 수행하는 테스트 모드 또는 상기 테스트 대상 반도체의 미리 설정된 일반적인 동작을 수행하는 일반 모드 중 적어도 어느 하나로 결정하는 단계; 및 상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 데이터 프레임을 상기 테스트 대상 반도체에 포함되는 복수의 시프트 스캔 체인들로 인가하여, 상기 테스트 대상 반도체에 대한 테스트를 수행하는 단계를 포함하는 반도체 테스트 방법
2 2
제1항에 있어서,상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 단계는 상기 수신된 데이터 프레임의 예비 비트(Reserved Bit)에 기초하여 상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 단계를 포함하는 반도체 테스트 방법
3 3
제2항에 있어서,상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 단계는 상기 예비 비트가 제1 논리값을 갖는 경우, 상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드로 결정하는 단계를 포함하는 반도체 테스트 방법
4 4
제3항에 있어서,상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 단계는 상기 예비 비트가 상기 제1 논리값과 구별되는 제2 논리값을 갖는 경우, 상기 테스트 인터페이스의 작동 모드를 상기 일반 모드로 결정하는 단계를 포함하는 반도체 테스트 방법
5 5
제1항에 있어서,상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 단계는 상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 테스트 인터페이스에 포함되는 모드 변환 회로에서, 상기 테스트 대상 반도체의 미리 설정된 일반적인 동작을 조작하는 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 단계; 및 상기 테스트 인터페이스 컨트롤러에서, 비트 스터프 에러(Bit Stuff Error)를 이용하여 상기 CAN 컨트롤러를 초기화하는 단계를 포함하는 반도체 테스트 방법
6 6
제5항에 있어서,상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 단계는 상기 모드 변환 회로에서 상기 테스트 인터페이스 컨트롤러로부터 셀렉트 신호를 수신하는 단계; 및 상기 수신된 셀렉트 신호에 기초하여 상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 단계를 포함하는 반도체 테스트 방법
7 7
제6항에 있어서,상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 단계는 상기 수신된 셀렉트 신호가 제1 논리값을 갖는 경우, 상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 단계를 포함하는 반도체 테스트 방법
8 8
제5항에 있어서,상기 CAN 컨트롤러를 초기화하는 단계는 상기 CAN 컨트롤러에서 상기 비트 스터프 에러가 발생하도록, 상기 CAN 컨트롤러로 미리 설정된 횟수만큼 제1 논리값을 인가하는 단계를 포함하는 반도체 테스트 방법
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제1항에 있어서,상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 테스트 인터페이스 컨트롤러에서, 상기 데이터 프레임이 수신 완료됨을 알리는 ACK 비트(Acknowledge Bit)를 상기 메인 컨트롤러로 전송하는 단계를 더 포함하는 반도체 테스트 방법
10 10
제9항에 있어서,상기 수신된 데이터 프레임에 오류가 검출되는 경우, 상기 테스트 인터페이스 컨트롤러에서, 에러 프레임을 상기 메인 컨트롤러로 전송하는 단계를 더 포함하는 반도체 테스트 방법
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CAN(Controller Area Network) 통신 기반의 반도체 테스트 시스템에 있어서, 테스트 대상 반도체(Device-Under-Test; DUT)에 대한 테스트를 수행하기 위한 데이터 프레임을 전송하는 메인 컨트롤러; 상기 테스트 대상 반도체의 미리 설정된 일반적인 동작을 조작하는 CAN 컨트롤러; 상기 메인 컨트롤러 및 상기 CAN 컨트롤러 각각과 CAN 버스를 통하여 연결되어 상기 메인 컨트롤러로부터 상기 데이터 프레임을 수신하고, 상기 데이터 프레임에 기초하여 상기 테스트 대상 반도체에 대한 테스트를 수행하는 테스트 모드 또는 상기 테스트 대상 반도체의 미리 설정된 일반적인 동작을 수행하는 일반 모드 중 적어도 어느 하나로 결정되는 작동 모드를 갖는 테스트 인터페이스; 및 상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 테스트 인터페이스에 의해 상기 데이터 프레임이 복수의 시프트 스캔 체인들로 인가되어 테스트가 수행되는 테스트 대상 반도체를 포함하는 반도체 테스트 시스템
12 12
제11항에 있어서,상기 테스트 인터페이스는 상기 수신된 데이터 프레임의 예비 비트(Reserved Bit)에 기초하여 상기 테스트 인터페이스의 작동 모드를 상기 테스트 모드 또는 상기 일반 모드 중 적어도 어느 하나로 결정하는 테스트 인터페이스 컨트롤러를 포함하는 반도체 테스트 시스템
13 13
제12항에 있어서,상기 테스트 인터페이스는 상기 테스트 인터페이스의 작동 모드가 상기 테스트 모드로 결정된 경우, 상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 모드 변환 회로를 포함하고, 상기 테스트 인터페이스 컨트롤러는 비트 스터프 에러(Bit Stuff Error)를 이용하여 상기 CAN 컨트롤러를 초기화하는 반도체 테스트 시스템
14 14
제13항에 있어서,상기 모드 변환 회로는 상기 테스트 인터페이스 컨트롤러로부터 셀렉트 신호를 수신하고, 상기 수신된 셀렉트 신호에 기초하여 상기 CAN 컨트롤러 및 상기 메인 컨트롤러 사이의 통신 경로를 차단하는 반도체 테스트 시스템
15 15
제13항에 있어서,상기 테스트 인터페이스 컨트롤러는 상기 CAN 컨트롤러에서 상기 비트 스터프 에러가 발생하도록, 상기 CAN 컨트롤러로 미리 설정된 횟수만큼 제1 논리값을 인가하는 반도체 테스트 시스템
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