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레지스터

  • 기술번호 : KST2015205676
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 복수 개가 종속 연결되어 시프트 레지스터를 구성하는 레지스터에 있어서, 레지스터의 입력부의 구성을 개선하여 전단의 레지스터로부터 입력되는 신호를 손실이 발생됨이 없이 입력할 수 있도록 하는 것으로서 입력신호를 전압강하가 발생됨이 없이 입력하여 회로의 동작 특성이 안정되도록 하고, 시프터 레지스터의 동작 특성을 향상시키며, 사용 수명이 길게 연장할 수 있다. 시프터 레지스터, 트랜지스터, 구동회로
Int. CL G09G 3/36 (2006.01.01) H03K 21/38 (2006.01.01) H03K 23/40 (2006.01.01)
CPC G09G 3/3655(2013.01) G09G 3/3655(2013.01) G09G 3/3655(2013.01) G09G 3/3655(2013.01) G09G 3/3655(2013.01)
출원번호/일자 1020070054786 (2007.06.05)
출원인 호서대학교 산학협력단
등록번호/일자 10-0932799-0000 (2009.12.10)
공개번호/일자 10-2008-0107020 (2008.12.10) 문서열기
공고번호/일자 (20091221) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.08.21)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 호서대학교 산학협력단 대한민국 충청남도 아산시

발명자

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번호 이름 국적 주소
1 배병성 대한민국 경기 수원시 팔달구
2 정남현 대한민국 서울 성북구

대리인

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번호 이름 국적 주소
1 정종옥 대한민국 서울특별시 강남구 논현로**길 **, *층 노벨국제특허법률사무소 (도곡동, 덕영빌딩)
2 조현동 대한민국 서울특별시 강남구 논현로**길 **, *층 (도곡동, 덕영빌딩)(노벨국제특허법률사무소)
3 진천웅 대한민국 서울특별시 강남구 논현로**길 **, *층 노벨국제특허법률사무소 (도곡동, 덕영빌딩)

최종권리자

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번호 이름 국적 주소
1 호서대학교 산학협력단 대한민국 충청남도 아산시
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2007.06.05 수리 (Accepted) 1-1-2007-0409055-71
2 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status		 2008.08.07 수리 (Accepted) 1-1-2008-0567359-41
3 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)		 2008.08.07 수리 (Accepted) 1-1-2008-0567609-61
4 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)		 2008.08.21 수리 (Accepted) 1-1-2008-0594929-99
5 선행기술조사의뢰서
Request for Prior Art Search		 2009.06.04 수리 (Accepted) 9-1-9999-9999999-89
6 선행기술조사보고서
Report of Prior Art Search		 2009.07.16 수리 (Accepted) 9-1-2009-0042687-86
7 의견제출통지서
Notification of reason for refusal		 2009.07.28 발송처리완료 (Completion of Transmission) 9-5-2009-0312453-14
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.09.25 수리 (Accepted) 1-1-2009-0589177-88
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.09.25 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0589178-23
10 등록결정서
Decision to grant		 2009.12.09 발송처리완료 (Completion of Transmission) 9-5-2009-0507122-24
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.07.13 수리 (Accepted) 4-1-2011-5143226-24
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.08.30 수리 (Accepted) 4-1-2019-0045360-16
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수 개가 종속 연결로 시프트 레지스터를 구성하여 소정의 구동신호를 순차적으로 시프트시키는 레지스터로서, 전단의 레지스터가 출력하는 출력신호를 입력단자로 입력하여 노드에 공급하는 입력부와, 상기 노드에 공급된 신호를 클럭신호에 따라 다음 단의 레지스터로 출력하는 출력부와, 다음 단의 레지스터가 출력하는 출력신호에 따라 상기 출력부를 리세트시키는 출력 리세트부를 포함하는 레지스터에 있어서, 상기 입력부는; 상기 입력단자에, 제 1 트랜지스터의 게이트 및 드레인과 제 2 트랜지스터의 드레인이 공통으로 접속되어 상기 제 1 트랜지스터의 소스가 상기 제 2 트랜지스터의 게이트에 접속되고, 상기 제 2 트랜지스터의 게이트 및 소스의 사이에 커패시터가 접속되어 상기 제 2 트랜지스터의 소스와 상기 커패시터의 접속점이 상기 노드에 접속되는 레지스터
2 2
복수 개가 종속 연결로 시프트 레지스터를 구성하여 소정의 구동신호를 순차적으로 시프트시키는 레지스터로서, 전단의 레지스터가 출력하는 출력신호를 입력단자로 입력하여 노드에 공급하는 입력부와, 상기 노드에 공급된 신호를 클럭신호에 따라 다음 단의 레지스터로 출력하는 출력부와, 다음 단의 레지스터가 출력하는 출력신호에 따라 상기 출력부를 리세트시키는 출력 리세트부를 포함하는 레지스터에 있어서, 상기 입력부는; 상기 입력단자가 제 11 트랜지스터의 게이트에 접속되고, 제 2 전원전압 입력단자가 상기 제 11 트랜지스터의 드레인 및 제 12 트랜지스터의 드레인에 접속되며, 상기 제 11 트랜지스터의 소스가 상기 제 12 트랜지스터의 게이트에 접속되며, 제 12 트랜지스터의 게이트와 소스의 사이에 커패시터가 접속되며, 상기 제 12 트랜지스터의 소스와 상기 커패시터의 접속점이 상기 노드에 접속되는 레지스터
3 3
복수 개가 종속 연결로 시프트 레지스터를 구성하여 소정의 구동신호를 순차적으로 시프트시키는 레지스터로서, 전단의 레지스터가 출력하는 출력신호를 입력단자로 입력하여 노드에 공급하는 입력부와, 상기 노드에 공급된 신호를 클럭신호에 따라 다음 단의 레지스터로 출력하는 출력부와, 다음 단의 레지스터가 출력하는 출력신호에 따라 상기 출력부를 리세트시키는 출력 리세트부를 포함하는 레지스터에 있어서, 상기 입력부는; 상기 입력단자가 제 21 트랜지스터의 게이트에 접속되고, 상기 제 21 트랜지스터의 드레인 및 제 22 트랜지스터의 드레인에 제 2 전원전압 입력단자가 접속되며, 상기 제 21 트랜지스터의 소스가 상기 제 22 트랜지스터의 게이트에 접속되며, 상기 제 22 트랜지스터의 게이트와 소스의 사이에 커패시터가 접속되어 상기 제 22 트랜지스터의 소스와 상기 커패시터의 접속점이 상기 노드에 접속되는 레지스터
4 4
제 1 항 내지 제 3 항 중 어느 하나의 항에 있어서, 상기 출력부가 출력하는 신호에 따라 상기 커패시터의 충전전압을 방전시켜 상기 입력부를 리세트시키는 제 6 트랜지스터를 더 포함하는 레지스터
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.