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다중 주파수 클럭을 가지는 파이프라인 회로 장치(A pipeline circuit apparatus having multi-frequency clock)

  • 기술번호 : KST2016006785
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 다중 주파수 클럭을 가지는 파이프라인 회로에 관한 것으로, 이러한 본 발명은 복수의 스테이지로 구분되는 파이프라인 방식으로 배치되어 상기 파이프라인의 각 스테이지의 데이터를 논리 연산하는 복수의 조합논리부와, 복수의 조합논리부 사이에 배치되어 이전 스테이지의 조합논리부에서 출력된 데이터를 다음 스테이지의 조합논리부로 전달하는 복수의 래치부와, 복수의 래치부 각각에 비동기 방식으로 클럭 신호를 제공하며, 다음 스테이지의 동작이 진행되도록 요청하는 클럭 신호를 전송하는 복수의 클럭제공부와, 상기 요청 신호를 시간 지연하여 다음 스테이지로 전달하되, EMI의 피크를 낮추도록 입력되는 클럭 신호의 주파수를 적어도 적어도 2개의 주파수로 변조하여 확산시키는 적어도 하나의 다중주파수지연부를 포함한다. 이러한 본 발명에 따르면, 비동기 방식의 클럭을 제공하고 그 클럭의 주파수를 변조함으로써, EMI 피크치를 낮출 수 있다. 더욱이, 단지 몇 개의 주파수만 사용하기 때문에 회로 복잡도를 줄일 수 있다.
Int. CL H03K 5/13 (2014.01) H03K 19/173 (2006.01)
CPC H03K 5/13(2013.01) H03K 5/13(2013.01) H03K 5/13(2013.01) H03K 5/13(2013.01) H03K 5/13(2013.01) H03K 5/13(2013.01) H03K 5/13(2013.01)
출원번호/일자 1020140104004 (2014.08.11)
출원인 한림대학교 산학협력단
등록번호/일자 10-1621761-0000 (2016.05.11)
공개번호/일자 10-2016-0019335 (2016.02.19) 문서열기
공고번호/일자 (20160517) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.08.11)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 한림대학교 산학협력단 대한민국 강원도 춘천시 한림

발명자

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번호 이름 국적 주소
1 이정근 대한민국 강원도 춘천시 서부대성로 **

대리인

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번호 이름 국적 주소
1 특허법인 천지 대한민국 서울특별시 강남구 논현로**길 **, *층(역삼동, 신한빌딩)

최종권리자

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번호 이름 국적 주소
1 한림대학교 산학협력단 강원도 춘천시 한림
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.08.11 수리 (Accepted) 1-1-2014-0759156-80
2 선행기술조사의뢰서
Request for Prior Art Search
2015.09.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2015.11.10 수리 (Accepted) 9-1-2015-0068649-56
4 의견제출통지서
Notification of reason for refusal
2015.11.13 발송처리완료 (Completion of Transmission) 9-5-2015-0787158-53
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.01.13 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-0039692-11
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.01.13 수리 (Accepted) 1-1-2016-0039698-95
7 등록결정서
Decision to grant
2016.05.09 발송처리완료 (Completion of Transmission) 9-5-2016-0334116-89
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2016.12.27 수리 (Accepted) 4-1-2016-5194076-39
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.03.06 수리 (Accepted) 4-1-2018-5038639-99
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 스테이지로 구분되는 파이프라인 방식으로 배치되어 상기 파이프라인의 각 스테이지의 데이터를 논리 연산하는 복수의 조합논리부; 상기 복수의 조합논리부 사이에 배치되어 이전 스테이지의 조합논리부에서 출력된 데이터를 다음 스테이지의 조합논리부로 전달하는 복수의 래치부; 상기 복수의 래치부 각각에 비동기 방식으로 클럭 신호를 제공하며, 다음 스테이지의 동작이 진행되도록 요청하는 클럭 신호를 전송하는 복수의 클럭제공부; 및 상기 요청하는 클럭 신호를 시간 지연하여 다음 스테이지로 전달하되, EMI(Electromagnetic interference)의 피크를 낮추도록 입력되는 클럭 신호의 주파수를 미리 설정된 수 이하로 변조하여 확산시키는 적어도 하나의 다중주파수지연부;를 포함하며, 상기 다중주파수지연부는 상기 클럭 신호를 시간 지연하여 출력하는 기본지연소자와, 상기 기본지연소자에서 출력된 클럭 신호를 각각이 서로 다른 시간 동안 지연하여 출력하는 복수의 가변지연소자와, 상기 복수의 가변지연소자로부터 출력된 클럭 신호를 다중화하여 출력하는 다중화기를 포함하고, 상기 복수의 가변지연소자는 제1, 제2, 제3 및 제4 가변지연소자를 포함하며, 상기 기본지연소자 및 상기 제1 내지 제4 가변지연소자는 다음의 수학식을 만족하는 것을 특징으로 하는 파이프라인 회로 장치
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삭제
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제1항에 있어서, 상기 다중주파수지연부는 복수의 가변지연소자 중 적어도 2개를 선택하여 동작하도록 하는 선택 신호를 생성하여, 상기 선택 신호를 상기 다중화기에 제공하는 스케줄러;를 더 포함하며, 상기 스케줄러는 입력 신호와 복수의 플립플롭의 피드백을 가산하는 가산기; 및 상기 가산기로부터 입력에 따라 논리 연산을 통해 상기 선택 신호를 출력하는 상기 복수의 플립플롭;을 포함하는 것을 특징으로 하는 파이프라인 회로 장치
4 4
제1항에 있어서, 상기 다중주파수지연부의 시간 지연은 다음의 수학식을 만족하는 것을 특징으로 하는 파이프라인 회로 장치
5 5
삭제
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.