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반도체 칩 패키지와 이의 제조 장치 및 방법(SEMICONDUCTOR CHIP PACKAGE AND APPARATUS AND METHOD FOR MANUFACTURING THE SAME)

  • 기술번호 : KST2016008515
  • 담당센터 : 광주기술혁신센터
  • 전화번호 : 062-360-4654
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 반도체 칩과 패키지의 접합력을 증가시키고 반도체 칩의 동작시 발생하는 열의 냉각 효율을 개선하여 동작 특성과 내구성을 향상시킨 반도체 칩 패키지와 이의 제조 장치 및 방법을 제공하는 것을 목적으로 한다. 이를 위해 본 발명은 상면의 일부 영역에 절연부와 적어도 하나의 입출력 단자를 형성한 패키지 기판부 상에 적어도 하나의 반도체 칩이 설치되고, 상기 패키지 기판부와 반도체 칩 사이에 금속 나노입자를 내재한 접합부가 설치된 반도체 칩 패키지; 상기 반도체 칩 패키지가 로딩되어 고정되도록 하는 플레이트; 및 상기 플레이트의 상부에 설치되고, 상기 반도체 칩 패키지의 접합부가 가열되도록 하여 상기 접합부에 내재된 금속 나노입자의 가열을 통한 소결(燒結) 및 융착(融着)을 통해 상기 패키지 기판부와 반도체 칩이 접합되도록 하는 광원 모듈을 포함한다. 따라서 본 발명은 반도체 칩과 패키지의 접합력을 증가시켜 내구성 향상과, 반도체 칩의 동작시 발생하는 열의 냉각 효율을 개선하여 동작 특성을 향상시킬 수 있으며, 반도체 칩 패키지의 제조시간을 단축시켜 생산효율을 향상시킬 수 있는 장점이 있다.
Int. CL H01L 23/34 (2006.01) H01L 23/12 (2006.01)
CPC H01L 23/367(2013.01) H01L 23/367(2013.01) H01L 23/367(2013.01) H01L 23/367(2013.01)
출원번호/일자 1020140129995 (2014.09.29)
출원인 한국광기술원
등록번호/일자 10-1643463-0000 (2016.07.21)
공개번호/일자 10-2016-0037463 (2016.04.06) 문서열기
공고번호/일자 (20160727) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.09.29)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국광기술원 대한민국 광주광역시 북구

발명자

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번호 이름 국적 주소
1 윤창훈 대한민국 광주광역시 광산구
2 이유성 대한민국 광주광역시 북구 군
3 김완호 대한민국 광주광역시 광산구
4 김재필 대한민국 광주광역시 광산구
5 송상빈 대한민국 광주광역시 광산구

대리인

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번호 이름 국적 주소
1 우광제 대한민국 서울특별시 강남구 테헤란로*길 **-* (역삼동, 신도빌딩) *층(유리안국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한국광기술원 대한민국 광주광역시 북구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.09.29 수리 (Accepted) 1-1-2014-0924721-04
2 선행기술조사의뢰서
Request for Prior Art Search
2015.03.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2015.05.11 수리 (Accepted) 9-1-2015-0031076-49
4 의견제출통지서
Notification of reason for refusal
2015.10.01 발송처리완료 (Completion of Transmission) 9-5-2015-0679103-08
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2015.11.30 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2015-1165623-48
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2015.11.30 수리 (Accepted) 1-1-2015-1165612-46
7 최후의견제출통지서
Notification of reason for final refusal
2016.03.02 발송처리완료 (Completion of Transmission) 9-5-2016-0162915-18
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.03.08 수리 (Accepted) 1-1-2016-0223105-60
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.03.08 보정승인 (Acceptance of amendment) 1-1-2016-0223116-62
10 등록결정서
Decision to grant
2016.07.14 발송처리완료 (Completion of Transmission) 9-5-2016-0507799-44
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.03 수리 (Accepted) 4-1-2020-5148105-81
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.09 수리 (Accepted) 4-1-2020-5153634-39
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
상면의 일부 영역에 절연부(120)와 적어도 하나의 입출력 단자(130)를 형성한 패키지 기판부(110)상에 적어도 하나의 반도체 칩(140)이 설치되고, 내재된 금속 나노입자가 가열되어 상기 패키지 기판부(110)와 반도체 칩(140)을 접합하는 접합부(150)가 설치된 반도체 칩 패키지(100); 상기 반도체 칩 패키지(100)가 로딩되어 고정되도록 하고, 상기 패키지 기판부(110)의 열 손실과 그에 따른 패키지 기판부(110)의 온도 저하를 방지하는 단열 플레이트로 이루어진 플레이트(210); 및상기 플레이트(210)의 상부에 설치되고, 상기 반도체 칩 패키지(100)의 반도체 칩(140)이 가열되도록 빛을 조사하고, 상기 반도체 칩(140)의 열전도를 통해 가열된 상기 접합부(150)의 금속 나노입자가 소결(燒結) 및 융착(融着)을 통해 상기 패키지 기판부(110)와 반도체 칩(140)이 접합되도록 하는 광원 모듈(220)을 포함하는 반도체 칩 패키지 제조 장치
2 2
삭제
3 3
삭제
4 4
제 1 항에 있어서,상기 광원 모듈(220)은 800nm ~ 3um 사이의 파장을 갖는 빛을 출력하는 것을 특징으로 하는 반도체 칩 패키지 제조 장치
5 5
제 1 항에 있어서,상기 광원 모듈(220)은 레이저, 또는 광원에서 발광된 빛이 광학계의 광축 위의 한점에 모이도록 초점을 형성하는 광학계를 구비한 임의의 광원 중 어느 하나인 것을 특징으로 하는 반도체 칩 패키지 제조 장치
6 6
제 1 항에 있어서,상기 광원 모듈(220)은 반도체 칩(140)을 가열시켜 발생한 열에 의해 상기 접합부(150)의 금속 나노입자가 소결 및 융착되도록 하는 것을 특징으로 하는 반도체 칩 패키지 제조 장치
7 7
a) 패키지 기판부(110)의 열 손실과 그에 따른 패키지 기판부(110)의 온도 저하를 방지하는 단열 플레이트로 이루어진 플레이트(210)에 상기 패키지 기판부(110)의 상면 일부 영역에 절연부(120)와 적어도 하나의 입출력 단자(130)를 형성한 반도체 칩 패키지(100)를 로딩하는 단계;b) 상기 반도체 칩 패키지(100)의 패키지 기판부(110)상에 금속 나노입자를 내재한 접합 물질을 도포하는 단계;c) 상기 접합 물질이 도포된 패키지 기판부(110)상에 반도체 칩(140)을 실장하는 단계; 및d) 광원 모듈(220)이 상기 반도체 칩(140) 크기의 1%~100% 조사면적으로 빛을 조사하여 가열되도록 하고, 상기 반도체 칩(140)의 열전도를 통해 가열된 접합부(150)의 금속 나노입자가 소결(燒結) 및 융착(融着)을 통해 상기 패키지 기판부(110)와 반도체 칩(140)을 접합하는 단계를 포함하는 반도체 칩 패키지 제조 방법
8 8
삭제
9 9
제 7 항에 있어서,상기 d)단계의 광원 모듈(220)은 800nm ~ 3um 사이의 파장을 갖는 빛을 출력하는 것을 특징으로 하는 반도체 칩 패키지 제조 방법
10 10
제 7 항 또는 제 9 항에 따른 반도체 칩 패키지 제조 방법으로 제조된 반도체 칩 패키지로서,상면의 일부 영역에 절연부(120)와 적어도 하나의 입출력 단자(130)를 형성한 패키지 기판부(110);상기 패키지 기판부(110) 상에 설치한 적어도 하나의 반도체 칩(140);상기 패키지 기판부(110)와 반도체 칩(140) 사이에 설치되고, 내재된 금속 나노입자가 가열되어 상기 금속 나노입자의 소결(燒結) 및 융착(融着)을 통해 상기 패키지 기판부(110)와 반도체 칩(140)을 접합하는 접합부(150); 및상기 입출력 단자(130)와 반도체 칩(140)을 연결하는 적어도 하나의 와이어(160)를 포함하는 반도체 칩 패키지
11 11
제 10 항에 있어서,상기 패키지 기판부(110)는 표면에 니켈(Ni)과 금(Au)을 이용하여 도금한 것을 특징으로 하는 반도체 칩 패키지
12 12
제 10 항에 있어서,상기 반도체 칩(140)은 실리콘 트랜지스터, LDMOS(Lateral Double diffused MOS), GaAs MESFET(Metal Semiconductor Field Effect Transistor), GaAs HBT(Heterojunction Bipolar Transister), GaAs HEMT(High Electron Mobility Transistor), GaN HEMT(High Electron Mobility Transistor) 및 SCHOTTKY 다이오드 중 적어도 하나인 것을 특징으로 하는 반도체 칩 패키지
13 13
제 10 항에 있어서,상기 접합부(150)의 금속 나노입자는 금(Au), 은(Ag), 구리(Cu)의 나노입자 중 적어도 하나인 것을 특징으로 하는 반도체 칩 패키지
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패밀리정보가 없습니다
국가 R&D 정보가 없습니다.