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듀티 신호 보상 장치 및 그 방법(DUTY SIGNAL COMPENSATION APPARATUS AND METHOD THEREOF)

  • 기술번호 : KST2016011725
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 25%의 듀티 사이클을 가지고 있는 I 신호와 Q 신호에서, 서로 간에 타이밍이 어긋나 있는 경우에 이를 측정하여 보정하는 듀티 신호 보상 장치 및 방법을 제시한다. 제시된 장치는 제 1 신호 및 제 2 신호가 입력되는 신호 입력부, 제 1 조정신호 및 제 2 조정신호를 근거로 상기 제 1 신호 및 상기 제 2 신호의 각각의 타이밍을 조정하고, 타이밍이 조정된 상기 제 1 신호와 상기 제 2 신호가 결합되어 있는 결합 신호를 출력하는 신호 조정부, 듀티 신호와 상기 결합 신호를 논리연산처리하여 제 1 논리연산 신호 및 제 2 논리연산 신호를 출력하는 결합 신호 제어부, 상기 제 1 신호와 상기 제 2 신호간에 타이밍이 어긋나 있는지를 판단하여 타이밍이 어긋나 있는 경우에 상기 제 1 조정신호 및 상기 제 2 조정신호를 생성하여 출력하고, 상기 결합 신호의 타이밍을 조정하는 제 3 조정신호를 상기 결합 신호 제어부에게로 인가하는 판단부, 상기 신호 조정부에서 상기 제 1 신호와 상기 제 2 신호 간에 타이밍이 맞는 조정된 제 1 신호 및 조정된 제 2 신호를 출력하는 신호 출력부를 포함한다.
Int. CL H04L 7/00 (2006.01.01)
CPC H04L 7/00(2013.01) H04L 7/00(2013.01) H04L 7/00(2013.01)
출원번호/일자 1020140174751 (2014.12.08)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2016-0069163 (2016.06.16) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 취하
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 15

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이승식 대한민국 대전광역시 유성구
2 김재영 대한민국 서울특별시 서초구
3 남홍순 대한민국 대전광역시 유성구
4 최상성 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 한양특허법인 대한민국 서울특별시 강남구 논현로**길 **, 한양빌딩 (도곡동)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.12.08 수리 (Accepted) 1-1-2014-1190634-92
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1
제 1 신호 및 제 2 신호가 입력되는 신호 입력부;제 1 조정신호 및 제 2 조정신호를 근거로 상기 제 1 신호 및 상기 제 2 신호의 각각의 타이밍을 조정하고, 타이밍이 조정된 상기 제 1 신호와 상기 제 2 신호가 결합되어 있는 결합 신호를 출력하는 신호 조정부;듀티 신호와 상기 결합 신호를 논리연산처리하여 제 1 논리연산 신호 및 제 2 논리연산 신호를 출력하는 결합 신호 제어부;상기 제 1 신호와 상기 제 2 신호간에 타이밍이 어긋나 있는지를 판단하여 타이밍이 어긋나 있는 경우에 상기 제 1 조정신호 및 상기 제 2 조정신호를 생성하여 출력하고, 상기 결합 신호의 타이밍을 조정하는 제 3 조정신호를 상기 결합 신호 제어부에게로 인가하는 판단부; 및상기 신호 조정부에서 상기 제 1 신호와 상기 제 2 신호 간에 타이밍이 맞는 조정된 제 1 신호 및 조정된 제 2 신호를 출력하는 신호 출력부;를 포함하는 것을 특징으로 하는 듀티 신호 보상 장치
2 2
제1항에 있어서,상기 제 1 신호는 I 신호이고, 상기 제 2 신호는 Q 신호인 것을 특징으로 하는 듀티 신호 보상 장치
3 3
제2항에 있어서,상기 I 신호와 상기 Q 신호는 25% 듀티 사이클을 갖는 신호인 것을 특징으로 하는 듀티 신호 보상 장치
4 4
제1항에 있어서,상기 제 1 조정신호는 상기 제 1 신호의 타이밍을 조정하기 위한 신호이고, 상기 제 2 조정신호는 상기 제 2 신호의 타이밍을 조정하기 위한 신호인 것을 특징으로 하는 듀티 신호 보상 장치
5 5
제1항에 있어서,상기 제 1 논리연산 신호는 상기 결합 신호와 상기 듀티 신호를 OR처리한 OR 출력 신호이고, 상기 제 2 논리연산 신호는 상기 결합 신호와 상기 듀티 신호를 AND처리한 AND 출력 신호인 것을 특징으로 하는 듀티 신호 보상 장치
6 6
제5항에 있어서,상기 결합 신호 제어부는,상기 OR 출력 신호를 생성하는 신호 결합기;상기 AND 출력 신호를 생성하는 비교기; 및 상기 제 3 조정신호를 근거로 상기 결합 신호의 타이밍을 조정하는 결합 신호 조정기;를 포함하는 것을 특징으로 하는 듀티 신호 보상 장치
7 7
제5항에 있어서,상기 판단부는 상기 AND 출력 신호와 상기 OR 출력 신호가 서로 일치할 때까지 상기 제 3 조정신호를 상기 결합 신호 제어부에게로 인가하는 것을 특징으로 하는 듀티 신호 보상 장치
8 8
제1항에 있어서,상기 결합 신호는 상기 제 1 신호의 폴링 엣지와 상기 제 2 신호의 라이징 엣지가 일치하는 것을 특징으로 하는 듀티 신호 보상 장치
9 9
판단부가, 신호 입력부로 입력되는 제 1 신호와 제 2 신호간에 타이밍이 어긋나 있는지를 판단하는 단계;상기 판단부가, 조정신호를 생성하는 단계;상기 신호 조정부가, 상기 제 1 신호와 상기 제 2 신호를 결합하여 결합 신호를 출력하는 단계;결합 신호 제어부가, 듀티 신호와 상기 결합 신호를 논리연산처리하여 제 1 논리연산 신호 및 제 2 논리연산 신호를 출력하는 단계; 및신호 출력부가, 상기 타이밍을 조정하는 단계에 의해 상기 제 1 신호와 상기 제 2 신호 간에 타이밍이 맞는 조정된 제 1 신호 및 조정된 제 2 신호를 출력하는 단계;를 포함하는 것을 특징으로 하는 듀티 신호 보상 방법
10 10
제9항에 있어서,상기 제 1 신호는 I 신호이고, 상기 제 2 신호는 Q 신호인 것을 특징으로 하는 듀티 신호 보상 방법
11 11
제9항에 있어서,상기 조정신호는 상기 제 1 신호의 타이밍을 조정하기 위한 제 1 조정신호, 상기 제 2 신호의 타이밍을 조정하기 위한 제 2 조정신호, 및 상기 결합 신호의 타이밍을 조정하기 위한 제 3 조정신호를 포함하는 것을 특징으로 하는 듀티 신호 보상 방법
12 12
제9항에 있어서,상기 신호 입력부로 입력되는 제 1 신호와 제 2 신호간에 타이밍이 어긋나 있는지를 판단하는 단계는,상기 제 1 신호의 폴링 엣지와 상기 제 2 신호의 라이징 엣지의 타이밍이 일치하는 지를 판단하는 것을 특징으로 하는 듀티 신호 보상 방법
13 13
제9항에 있어서,상기 결합 신호는 상기 제 1 신호의 폴링 엣지와 상기 제 2 신호의 라이징 엣지가 일치하는 것을 특징으로 하는 듀티 신호 보상 방법
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제9항에 있어서,상기 조정된 제 1 신호 및 상기 조정된 제 2 신호 각각은 상기 제 1 신호의 폴링 엣지와 상기 제 2 신호의 라이징 엣지의 타이밍이 일치하는 25%의 듀티 사이클을 갖는 신호인 것을 특징으로 하는 듀티 신호 보상 방법
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제9항에 있어서,상기 제 1 논리연산 신호는 상기 결합 신호와 상기 듀티 신호를 OR처리한 OR 출력 신호이고, 상기 제 2 논리연산 신호는 상기 결합 신호와 상기 듀티 신호를 AND처리한 AND 출력 신호인 것을 특징으로 하는 듀티 신호 보상 방법
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1 US2016164510 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 산업원천기술개발사업(정보통신) 스펙트럼 자원 효율성 극대화를 통한 스마트 홈네트워크용 다중대역 WPAN 시스템 개발