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트랜스포머 출력단과 트랜스포머 피드백 RF 부성저항 교차 결합 발진기 구조를 이용한 고출력 신호 발생기(HIGH POWER SIGNAL SOURCE USING TRANSFORMER OUTPUT WITH TRANSFORMER FEEDBACK RF NEGATIVE RESISTANCE CROSS-COUPLED OSCILLATOR)

  • 기술번호 : KST2016014706
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 고출력 신호 발생기는 제1 트랜지스터와 제2 트랜지스터로 구성되는 한 쌍의 부성저항 트랜지스터, 상기 제1 트랜지스터의 게이트 전극과 상기 제2 트랜지스터의 게이트 전극에 연결되고, 공통노드가 전원에 연결되어 있는 인덕터, 상기 제2 트랜지스터와 연결되며, 제4 트랜지스터와 상보적인 특성을 갖도록 교차 결합된 제3 트랜지스터, 상기 제1 트랜지스터와 연결되며, 상기 제3 트랜지스터와 상보적인 특성을 갖도록 교차 결합된 제4 트랜지스터, 상기 제1 트랜지스터의 소스 전극와 상기 제2 트랜지스터의 소스 전극에 연결되어 있는 1차 코일단과, 이 1차 코일단과 제1 상호 인덕턴스(M1)로 결합되어 있는 2차 코일단을 포함하는 제1 트랜스포머, 상보적인 특성을 갖도록 교차 결합되어 있으며, 게이트 전극이 상기 제1 트랜스포머의 1차 코일단의 양측에 각각 연결되어 있는 한 쌍의 피드백 트랜지스터, 게이트 전극이 상기 제1 트랜스포머의 2차 코일단의 양측에 각각 연결되어 있는 한 쌍의 버퍼 트랜지스터 및 양측이 상기 한 쌍의 버퍼 트랜지스터의 드레인 전극에 연결되는 1차 코일단과, 이 1차 코일단과 제2 상호 인덕턴스(M2)로 결합되어 있는 2차 코일단을 포함하는 제2 트랜스포머를 포함한다. 본 발명에 의하면, 트랜스포머 피드백 RF 부성저항 교차 결합 발진기 구조를 이용한 신호 발생기의 출력단을 트랜스포머로 구성함으로써, 출력 파워를 증가시킬 수 있는 효과가 있다.
Int. CL H03B 5/12 (2014.01)
CPC H03B 5/1212(2013.01) H03B 5/1212(2013.01)
출원번호/일자 1020150013487 (2015.01.28)
출원인 충북대학교 산학협력단
등록번호/일자 10-1678764-0000 (2016.11.16)
공개번호/일자 10-2016-0092735 (2016.08.05) 문서열기
공고번호/일자 (20161122) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.01.28)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 충북대학교 산학협력단 대한민국 충청북도 청주시 서원구

발명자

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번호 이름 국적 주소
1 홍종필 대한민국 세종특별자치시 달빛로 ***, *
2 권혁태 대한민국 충청북도 청주시 서원구

대리인

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번호 이름 국적 주소
1 김정현 대한민국 서울특별시 강남구 역삼로 ***, *층 (역삼동, 신명빌딩)(한맥국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 충북대학교 산학협력단 대한민국 충청북도 청주시 서원구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.01.28 수리 (Accepted) 1-1-2015-0094016-77
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.06.17 수리 (Accepted) 4-1-2015-5081402-70
3 선행기술조사의뢰서
Request for Prior Art Search
2015.10.28 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2015.12.10 수리 (Accepted) 9-1-2015-0079951-98
5 의견제출통지서
Notification of reason for refusal
2016.03.31 발송처리완료 (Completion of Transmission) 9-5-2016-0237655-78
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.05.17 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-0472033-44
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.05.17 수리 (Accepted) 1-1-2016-0472045-92
8 등록결정서
Decision to grant
2016.09.30 발송처리완료 (Completion of Transmission) 9-5-2016-0704224-35
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.05.15 수리 (Accepted) 4-1-2018-5086612-26
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.06 수리 (Accepted) 4-1-2020-5149268-82
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번호 청구항
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제1 트랜지스터와 제2 트랜지스터로 구성되는 한 쌍의 부성저항 트랜지스터;상기 제1 트랜지스터의 게이트 전극과 상기 제2 트랜지스터의 게이트 전극에 연결되고, 공통노드가 전원에 연결되어 있는 인덕터;상기 제2 트랜지스터와 연결되며, 제4 트랜지스터와 상보적인 특성을 갖도록 교차 결합된 제3 트랜지스터;상기 제1 트랜지스터와 연결되며, 상기 제3 트랜지스터와 상보적인 특성을 갖도록 교차 결합된 제4 트랜지스터;상기 제1 트랜지스터의 소스 전극와 상기 제2 트랜지스터의 소스 전극에 연결되어 있는 1차 코일단과, 이 1차 코일단과 제1 상호 인덕턴스(M1)로 결합되어 있는 2차 코일단을 포함하는 제1 트랜스포머; 상보적인 특성을 갖도록 교차 결합되어 있으며, 게이트 전극이 상기 제1 트랜스포머의 1차 코일단의 양측에 각각 연결되어 있는 한 쌍의 피드백 트랜지스터;게이트 전극이 상기 제1 트랜스포머의 2차 코일단의 양측에 각각 연결되어 있는 한 쌍의 버퍼 트랜지스터; 양측이 상기 한 쌍의 버퍼 트랜지스터의 드레인 전극에 연결되는 1차 코일단과, 이 1차 코일단과 제2 상호 인덕턴스(M2)로 결합되어 있는 2차 코일단을 포함하며, 차동-단일단 변환 출력단을 구성하는 제2 트랜스포머; 및상기 제2 트랜스포머의 2차 코일단에 병렬로 연결되는 제5 가변 커패시터를 포함하며, 상기 제1 트랜지스터는 NMOS 트랜지스터로서, 드레인 전극이 전원에 연결되고, 소스 전극이 상기 제4 트랜지스터의 드레인 전극과 상기 제1 트랜스포머의 1차 코일단의 일측과 상기 제3 트랜지스터의 게이트 전극에 연결되고, 게이트 전극이 상기 인덕터의 일측에 연결되고, 상기 제2 트랜지스터는 NMOS 트랜지스터로서, 드레인 전극이 전원에 연결되고, 소스 전극이 상기 제3 트랜지스터의 드레인 전극과 상기 제1 트랜스포머의 1차 코일단의 타측과 상기 제4 트랜지스터의 게이트 전극에 연결되고, 게이트 전극이 상기 인덕터의 타측에 연결되고,상기 제3 트랜지스터는 PMOS 트랜지스터로서, 소스 전극이 전원에 연결되고, 드레인 전극이 상기 제2 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 일측과 상기 제4 트랜지스터의 게이트 전극과 상기 한 쌍의 피드백 트랜지스터 중 제1 피드백 트랜지스터의 게이트 전극에 연결되고, 게이트 전극이 상기 제1 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 타측과 상기 제4 트랜지스터의 드레인 전극에 연결되고, 상기 제4 트랜지스터는 NMOS 트랜지스터로서, 소스 전극이 접지에 연결되고, 드레인 전극이 상기 제1 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 타측과 상기 제3 트랜지스터의 게이트 전극과 상기 한 쌍의 피드백 트랜지스터 중 제2 피드백 트랜지스터의 게이트 전극에 연결되고, 게이트 전극이 상기 제2 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 일측과 상기 제3 트랜지스터의 드레인 전극에 연결되고,상기 한 쌍의 피드백 트랜지스터는 NMOS 트랜지스터로서, 소스 전극이 접지에 연결되고, 드레인 전극이 상기 제1 트랜스포머의 2차 코일단과 상기 한 쌍의 버퍼 트랜지스터의 게이트 전극에 연결되고, 제1 피드백 트랜지스터의 게이트 전극이 상기 제1 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 일측과 상기 제4 트랜지스터의 드레인 전극에 연결되고, 제2 피드백 트랜지스터의 게이트 전극이 상기 제2 트랜지스터의 소스 전극과 상기 제1 트랜스포머의 1차 코일단의 타측과 상기 제3 트랜지스터의 드레인 전극에 연결되고, 상기 한 쌍의 버퍼 트랜지스터는 NMOS 트랜지스터로서, 소스 전극이 접지에 연결되고, 드레인 전극이 상기 제2 트랜스포머의 1차 코일단과 연결되고, 게이트 전극이 상기 한 쌍의 피드백 트랜지스터의 드레인 전극과 연결되고, 상기 제2 트랜스포머의 2차 코일단은 일측이 접지에 연결되고, 타측이 부하(Load)에 연결되어 있으며, 출력단을 형성하고,상기 제5 가변 커패시터의 제어 전압을 조절하는 방식으로 발진주파수를 제어하며,상기 제2 트랜스포머의 1차 코일단의 공통 노드에 전원이 연결되어 있고, 이를 통해 상기 한 쌍의 버퍼 트랜지스터에 전원이 공급되는 것을 특징으로 하는 고출력 신호 발생기
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청구항 1에 있어서, 상기 고출력 신호 발생기는 상기 인덕터에 병렬로 연결되는 제1 가변 커패시터를 더 포함하고, 상기 제1 가변 커패시터의 제어 전압을 조절하는 방식으로 발진주파수를 제어하는 것을 특징으로 하는 고출력 신호 발생기
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청구항 1에 있어서, 상기 고출력 신호 발생기는 상기 제1 트랜스포머의 1차 코일단에 병렬로 연결되는 제2 가변 커패시터를 더 포함하고, 상기 제2 가변 커패시터의 제어 전압을 조절하는 방식으로 발진주파수를 제어하는 것을 특징으로 하는 고출력 신호 발생기
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청구항 1에 있어서, 상기 고출력 신호 발생기는 상기 제1 트랜스포머의 2차 코일단에 병렬로 연결되는 제3 가변 커패시터를 더 포함하고, 상기 제3 가변 커패시터의 제어 전압을 조절하는 방식으로 발진주파수를 제어하는 것을 특징으로 하는 고출력 신호 발생기
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청구항 1에 있어서, 상기 고출력 신호 발생기는 상기 제2 트랜스포머의 1차 코일단에 병렬로 연결되는 제4 가변 커패시터를 더 포함하고, 상기 제4 가변 커패시터의 제어 전압을 조절하는 방식으로 발진주파수를 제어하는 것을 특징으로 하는 고출력 신호 발생기
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1 교육부 충북대학교산학협력단 일반연구자지원사업 초소형 저전력 선형 하이브리드 디지털 주파수 합성기 개발