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블록 다이어그램 제공 장치 및 방법(APPARATUS AND METHOD FOR PROVIDING BLOCK DIAGRAM)

  • 기술번호 : KST2016018240
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 일 실시예에 따른 블록 다이어그램 제공 장치는 상위 블록 다이어그램에 포함된 계층 블록의 내부에 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상위 블록 다이어그램을 수정하는 계층 블록 설정부 및 상위 블록 다이어그램을 표시하는 표시부를 포함한다.
Int. CL G06F 30/00 (2020.01.01)
CPC G06F 30/39(2013.01) G06F 30/39(2013.01)
출원번호/일자 1020150052023 (2015.04.13)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2016-0122013 (2016.10.21) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 취하
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김상필 대한민국 세종특별자

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.04.13 수리 (Accepted) 1-1-2015-0359725-12
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2016.10.14 수리 (Accepted) 1-1-2016-0998170-83
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
상위 블록 다이어그램에 포함된 계층 블록의 내부에 상기 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상기 상위 블록 다이어그램을 수정하는 계층 블록 설정부; 및 상기 상위 블록 다이어그램을 표시하는 표시부;를 포함하는 블록 다이어그램 제공 장치
2 2
제1 항에 있어서,상기 계층 블록 설정부는 상기 계층 블록의 크기에 따라 상기 대응 블록 다이어그램을 축소하여 상기 계층 블록 내부에 상기 대응 블록 다이어그램을 표시하도록 상기 상위 블록 다이어그램을 수정하는 것을 특징으로 하는 블록 다이어그램 제공 장치
3 3
제2 항에 있어서,상기 계층 블록 설정부는 상기 계층 블록의 외부 블록과 상기 계층 블록의 내부 블록이 서로 연결되도록 상기 상위 블록 다이어그램의 연결선을 수정하는 것을 특징으로 하는 블록 다이어그램 제공 장치
4 4
제3 항에 있어서,사용자로부터 연결선 선택 입력을 받는 입력부;를 더 포함하되,상기 표시부는 상기 연결선 선택 입력에 상응하는 연결선을 미리 지정된 형태로 표시하는 것을 특징으로 하는 블록 다이어그램 제공 장치
5 5
제2 항에 있어서,사용자로부터 블록 크기 설정 입력을 받는 입력부;를 더 포함하되,상기 계층 블록 설정부는 상기 계층 블록의 크기를 상기 블록 크기 설정 입력에 따라 변경하고, 상기 계층 블록의 크기에 따라 상기 대응 블록 다이어그램을 축소하여 상기 계층 블록 내부에 상기 대응 블록 다이어그램을 표시하도록 상기 상위 블록 다이어그램을 수정하는 것을 특징으로 하는 블록 다이어그램 제공 장치
6 6
블록 다이어그램 제공 장치가 블록 다이어그램을 제공하는 방법에 있어서,상위 블록 다이어그램에 포함된 계층 블록의 내부에 상기 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상기 상위 블록 다이어그램을 수정하는 단계; 및 상기 상위 블록 다이어그램을 표시하는 단계를 포함하는 블록 다이어그램 제공 방법
7 7
제6 항에 있어서,상기 상위 블록 다이어그램에 포함된 계층 블록의 내부에 상기 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상기 상위 블록 다이어그램을 수정하는 단계는, 상기 계층 블록의 크기에 따라 상기 대응 블록 다이어그램을 축소하여 상기 계층 블록 내부에 상기 대응 블록 다이어그램을 표시하도록 상기 상위 블록 다이어그램을 수정하는 단계인 것을 특징으로 하는 블록 다이어그램 제공 방법
8 8
제7 항에 있어서,상기 상위 블록 다이어그램에 포함된 계층 블록의 내부에 상기 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상기 상위 블록 다이어그램을 수정하는 단계는,상기 계층 블록의 외부 블록과 상기 계층 블록의 내부 블록이 서로 연결되도록 상기 상위 블록 다이어그램의 연결선을 수정하는 단계인 것을 특징으로 하는 블록 다이어그램 제공 방법
9 9
제8 항에 있어서,사용자로부터 연결선 선택 입력을 받는 단계; 및상기 연결선 선택 입력에 상응하는 연결선을 미리 지정된 형태로 표시하는 단계를 더 포함하는 블록 다이어그램 제공 방법
10 10
제7 항에 있어서,사용자로부터 블록 크기 설정 입력을 받는 단계;를 더 포함하되,상기 상위 블록 다이어그램에 포함된 계층 블록의 내부에 상기 계층 블록에 대응하는 대응 블록 다이어그램이 표시되도록 상기 상위 블록 다이어그램을 수정하는 단계는,상기 계층 블록의 크기를 상기 블록 크기 설정 입력에 따라 변경하고, 상기 계층 블록의 크기에 따라 상기 대응 블록 다이어그램을 축소하여 상기 계층 블록 내부에 상기 대응 블록 다이어그램을 표시하도록 상기 상위 블록 다이어그램을 수정하는 단계인 것을 특징으로 하는 블록 다이어그램 제공 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 한국전자통신연구원 ETRI연구개발지원사업 다중코어 기반 고성능 SoC의 SW 에뮬레이션 및 Rapid Prototyping 기술개발