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화학적 도핑을 이용한 수직형 피-엔 접합 트랜지스터 및 그 제조방법(Vertical P-N Junction Transistor using Chemical Doping and Method of manufacturing the same)

  • 기술번호 : KST2017001747
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 이황화몰리브덴을 기반으로 한 p-n 접합 트랜지스터 및 이의 제조방법이 개시된다. 게이트 구조물 상에 적층된 양상으로 n형 이황화몰리브덴층과 p형 이황화몰리브덴층이 형성되며, 게이트 구조물의 표면에 대해 수평 방향으로 접합면이 형성된다. 게이트층으로 전계가 인가되는 경우, 각각의 이황화몰리브덴층은 도전성 채널을 형성하며, 캐리어 이동의 양상은 바이폴라 타입으로 진행된다.
Int. CL
CPC H01L 29/1066(2013.01) H01L 29/1066(2013.01) H01L 29/1066(2013.01) H01L 29/1066(2013.01)
출원번호/일자 1020150110924 (2015.08.06)
출원인 광주과학기술원, 성균관대학교산학협력단
등록번호/일자
공개번호/일자 10-2017-0017259 (2017.02.15) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.08.06)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 광주과학기술원 대한민국 광주광역시 북구
2 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 이병훈 대한민국 광주광역시 북구
2 유원종 미국 서울특별시 송파구
3 류정진 대한민국 대구광역시 수성구
4 이대영 대한민국 경기도 수원시 장안구

대리인

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번호 이름 국적 주소
1 특허법인이상 대한민국 서울특별시 서초구 바우뫼로 ***(양재동, 우도빌딩 *층)

최종권리자

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번호 이름 국적 주소
1 광주과학기술원 광주광역시 북구
2 성균관대학교 산학협력단 경기도 수원시 장안구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.08.06 수리 (Accepted) 1-1-2015-0762793-59
2 보정요구서
Request for Amendment
2015.08.20 발송처리완료 (Completion of Transmission) 1-5-2015-0131816-82
3 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2015.09.17 수리 (Accepted) 1-1-2015-0904439-09
4 선행기술조사의뢰서
Request for Prior Art Search
2016.03.11 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2016.05.10 수리 (Accepted) 9-1-2016-0021135-01
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
7 의견제출통지서
Notification of reason for refusal
2017.04.19 발송처리완료 (Completion of Transmission) 9-5-2017-0280091-60
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.06.19 수리 (Accepted) 1-1-2017-0586569-23
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.06.19 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0586570-70
10 등록결정서
Decision to grant
2017.10.17 발송처리완료 (Completion of Transmission) 9-5-2017-0719247-60
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
게이트 구조물 상의 제1 영역에 형성된 하부 전극;상기 하부 전극 및 게이트 구조물 상에 형성된 p-n 접합 이황화몰리브덴층; 및상기 p-n 접합 이황화몰리브덴층 상에 형성되고, 상기 제1 영역에 대향하는 제2 영역에 형성된 상부 전극을 포함하는 p-n 접합 트랜지스터
2 2
제1항에 있어서, 상기 게이트 구조물은,게이트층; 및상기 게이트층 상부에 형성되고, 상기 p-n 접합 이황화몰리브덴층과 접하는 유전층을 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터
3 3
제2항에 있어서, 상기 p-n 접합 이황화몰리브덴층은,상기 유전층 및 상기 하부 전극 상에 형성되는 n형 이황화몰리브덴층; 및상기 n형 이황화몰리브덴층 상에 형성되는 p형 이황화몰리브덴층을 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터
4 4
제3항에 있어서, 상기 n형 이황화몰리브덴층은 벤질 비올로겐을 도판트로 사용하는 것을 특징으로 하는 p-n 접합 트랜지스터
5 5
제3항에 있어서, 상기 p형 이황화몰리브덴층은 AuCl3을 도판트로 사용하는 것을 특징으로 하는 p-n 접합 트랜지스터
6 6
제3항에 있어서, 상기 n형 이황화몰리브덴층은 상기 유전층 및 상기 하부 전극의 표면 프로파일을 따라 형성되는 것을 특징으로 하는 p-n 접합 트랜지스터
7 7
제1항에 있어서, 상기 p-n 접합 이황화몰리브덴층의 접합면은 상기 게이트 구조물의 표면과 평행한 것을 특징으로 하는 p-n 접합 트랜지스터
8 8
제3항에 있어서, 상기 게이트층에 인가되는 양의 전압에 따라 상기 n형 이황화몰리브덴층은 상기 유전층에 근접하여 전자들로 구성된 제1 도전성 채널을 가지고, 상기 p형 이황화몰리브덴층은 그 상부에 정공들로 구성된 제2 도전성 채널을 가지는 것을 특징으로 하는 p-n 접합 트랜지스터
9 9
제3항에 있어서, 상기 게이트층에 인가되는 음의 전압에 따라 상기 n형 이황화몰리브덴층은 상기 유전층에 근접하여 정공들로 구성된 제1 도전성 채널을 가지고, 상기 p형 이황화몰리브덴층은 그 상부에 전자들로 구성된 제2 도전성 채널을 가지는 것을 특징으로 하는 p-n 접합 트랜지스터
10 10
제2항에 있어서, 상기 p-n 접합 이황화몰리브덴층은,상기 유전층 및 상기 하부 전극 상에 형성되는 p형 이황화몰리브덴층; 및상기 p형 이황화몰리브덴층 상에 형성되는 n형 이황화몰리브덴층을 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터
11 11
제1 전사 기판 상의 이황화몰리브덴 플레이크의 일부를 제1 도전형 이황화몰리브덴층으로 개질하는 단계;상기 제1 도전형 이황화몰리브덴층이 형성된 상기 이황화몰리브덴 플레이크를 제2 전사 기판으로 전사하는 단계;가 전사된 제2 전사 기판 상에 접합된 상기 이황화몰리브덴 플레이크를 하부 전극이 형성된 게이트 구조물 상에 전사하는 단계; 및상기 게이트 구조물 상에 전사된 상기 이황화몰리브덴 플레이크의 도핑되지 않은 이황화몰리브덴층에 대한 도핑을 통해 제2 도전형 이황화몰리브덴층을 형성하는 단계를 포함하는 p-n 접합 트랜지스터의 제조방법
12 12
제11항에 있어서, 상기 제1 도전형 이황화몰리브덴층으로 개질하는 단계는,PVA층 및 PMMA층이 순차적으로 형성된 제1 전사 기판 상에 상기 이황화몰리브덴 플레이크를 전사하는 단계; 및상기 이황화몰리브덴 플레이크에 대한 도핑을 통해 상기 이황화몰리브덴 플레이크의 일부를 제1 도전형 이황화몰리브덴층으로 개질하고, 그 하부의 상기 도핑되지 않은 이황화몰리브덴층을 잔류시키는 단계를 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터의 제조방법
13 13
제12항에 있어서, 상기 이황화몰리브덴 플레이크를 제2 전사 기판으로 전사하는 단계는,상기 제1 도전형 이황화몰리브덴층이 형성된 상기 이황화몰리브덴 플레이크를 상기 제1 전사 기판으로부터 분리하는 단계; 및상기 분리된 이황화몰리브덴 플레이크를 제2 전사 기판에 접합하는 단계를 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터의 제조방법
14 14
제13항에 있어서, 상기 이황화몰리브덴 플레이크를 상기 제1 전사 기판으로부터 분리하는 단계는, 상기 제1 도전형 이황화몰리브덴층이 형성된 상기 제1 전사 기판을 탈염수에 침지하는 단계; 및상기 탈염수로의 침지를 통해 상기 PVA층은 용해되고, 상기 제1 전사 기판과 상기 PMMA층은 상호 분리되는 단계를 포함하는 것을 특징으로 하는 p-n 접합 트랜지스터의 제조방법
15 15
제13항에 있어서, 상기 분리된 이황화몰리브덴 플레이크를 상기 제2 전사 기판에 접합하는 단계는, 상기 제2 전사 기판에 PDMS층을 도입하고, 상기 이황화몰리브덴 플레이크가 형성된 상기 PMMA층을 상기 PDMS층에 접합하는 것을 특징으로 하는 p-n 접합 트랜지스터의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 (재)하이브리드인터페이스기반미래소재연구단 글로벌프론티어연구개발사업 인공 두뇌급 고성능 소자 구현을 위한 3D 집적 반도체소재 원천기술 개발