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동영상 디코더에 적용되는 메모리 기반의 루프 필터(LOOP FILTER BASED ON MEMORY APPLIED IN VIDEO DECODER)

  • 기술번호 : KST2017007747
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 동영상 디코더에 적용되는 메모리 기반의 루프 필터에 관한 것이다.본 발명은 루프 필터링(loop filtering) 연산에 필요한 루프 필터링 파라미터와 픽셀 데이터를 로드(load)하여 내부 메모리에 저장하는 로드 데이터 제어기, 상기 내부 메모리에 저장된 픽셀 데이터에 대하여 가로 경계 필터링(horizontal edge filtering)과 세로 경계 필터링(vertical edge filtering)을 수행하는 단일 코어 필터 및 상기 가로 경계 필터링과 상기 세로 경계 필터링이 수행된 출력 데이터의 출력을 제어하는 출력 데이터 제어기를 포함하여 구성된다.본 발명에 따르면, 하나의 슈퍼 블록의 데이터를 더블 버퍼링된 내부 메모리에 순차적으로 저장함으로써, 요구되는 내부 메모리의 용량을 줄일 수 있고, 가로 경계 필터링과 세로 경계 필터링 단계를 하나의 코어 필터에서 모두 처리함으로써, 하드웨어 리소스를 줄일 수 있고, 더블 버퍼링된 내부 메모리와 단일 코어 필터를 사용하여 루프 필터의 연산 단계를 세분화하여 파이프라인 구조를 갖도록 함으로써, VP9 디코더의 주변 장치의 시간 손실을 최소화할 수 있다.
Int. CL H04N 19/117 (2014.01.01) H04N 19/159 (2014.01.01) H04N 19/176 (2014.01.01) H04N 19/86 (2014.01.01) H04N 19/44 (2014.01.01)
CPC H04N 19/117(2013.01) H04N 19/117(2013.01) H04N 19/117(2013.01) H04N 19/117(2013.01) H04N 19/117(2013.01)
출원번호/일자 1020150154229 (2015.11.04)
출원인 한국전자기술연구원
등록번호/일자
공개번호/일자 10-2017-0052143 (2017.05.12) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 취하
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국전자기술연구원 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 김동순 대한민국 경기도 성남시 분당구
2 이태희 대한민국 경기도 성남시 분당구
3 장영종 대한민국 경기도 성남시 분당구

대리인

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번호 이름 국적 주소
1 특허법인(유한) 다래 대한민국 서울 강남구 테헤란로 ***, **층(역삼동, 한독타워)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2015.11.04 수리 (Accepted) 1-1-2015-1072037-44
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.08.24 수리 (Accepted) 4-1-2020-5189497-57
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번호 청구항
1 1
동영상 디코더에 적용되는 메모리 기반의 루프 필터에 있어서,루프 필터링(loop filtering) 연산에 필요한 루프 필터링 파라미터와 픽셀 데이터를 로드(load)하여 내부 메모리에 저장하는 로드 데이터 제어기;상기 내부 메모리에 저장된 픽셀 데이터에 대하여 가로 경계 필터링(horizontal edge filtering)과 세로 경계 필터링(vertical edge filtering)을 수행하는 단일 코어 필터; 및상기 가로 경계 필터링과 상기 세로 경계 필터링이 수행된 출력 데이터의 출력을 제어하는 출력 데이터 제어기를 포함하는, 동영상 디코더에 적용되는 메모리 기반의 루프 필터
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제1항에 있어서,상기 로드 데이터 제어기는 상기 픽셀 데이터를 상기 내부 메모리를 구성하는 제1 내부 메모리와 제2 내부 메모리에 가로 방향 4개, 세로 방향 1개의 예측 블록 단위로 더블 버퍼링하여 저장하는 것을 특징으로 하는, 동영상 디코더에 적용되는 메모리 기반의 루프 필터
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제2항에 있어서,상기 픽셀 데이터가 포함된 슈퍼 블록은 64*64 픽셀 크기를 갖고, 상기 예측 블록은 8*8 픽셀 크기를 갖고, 상기 슈퍼 블록은 상기 예측 블록 단위로 처리되는 것을 특징으로 하는, 동영상 디코더에 적용되는 메모리 기반의 루프 필터
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제1항에 있어서,상기 동영상 디코더는 4K급 VP9 디코더인 것을 특징으로 하는, 동영상 디코더에 적용되는 메모리 기반의 루프 필터
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 산업부 (주)넥셀 (산업부)시스템반도체상용화기술개발사업 (RCMS)스마트 디바이스에서 인터넷 동영상 재생을 위한 고화질(4K)급 비디오디코더(HEVC/VP9) SoC개발