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공유 번역 블록 캐시 기반의 멀티-코어 시뮬레이션 시스템 및 방법(MULTI-CORE SIMULATION SYSTEM AND METHOD BASED ON SHARED TRANSLATION BLOCK CACHE)

  • 기술번호 : KST2017011717
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 실시 예에 따른 복수의 코어 모델들에 대하여 시뮬레이션을 수행하는 멀티-코어 시뮬레이터를 포함하고, 상기 멀티-코어 시뮬레이터를 실행하는 호스트 프로세서를 포함하는 멀티-코어 시뮬레이션 시스템의 멀티-코어 시뮬레이션 방법은 상기 복수의 코어 모델들에 대하여 공통으로 사용되는 공유 번역 블록 캐시를 워킹 메모리에 할당하는 단계, 제 1 코어 모델에서 수행될 제 1 타겟 명령어를 읽는 단계, 상기 제 1 타겟 명령어에 대응하고, 상기 호스트 프로세서에서 사용되는 명령어 셋으로 구성되는 제 1 번역 블록을 생성하는 단계, 상기 제 1 번역 블록을 공유 번역 블록 캐시에 저장한 후, 상기 제 1 코어 모델에서 상기 제 1 번역 블록을 수행하는 단계, 제 2 코어 모델에서 수행될 제 2 타겟 명령어를 읽는 단계, 상기 제 2 타겟 명령어와 동일한 내용을 포함하는 번역 블록을 상기 공유 번역 블록 캐시에서 검색하는 단계, 그리고 상기 제 1 타겟 명령어가 제 2 타겟 명령어와 동일한 내용을 포함하는 경우, 상기 제 2 코어 모델에서 상기 제 1 번역 블록을 수행하는 단계를 포함한다.
Int. CL G06F 9/455 (2016.02.07) G06F 9/52 (2016.02.07) G06F 11/26 (2016.02.07) G06F 12/08 (2016.02.07)
CPC G06F 9/455(2013.01) G06F 9/455(2013.01) G06F 9/455(2013.01) G06F 9/455(2013.01)
출원번호/일자 1020160001008 (2016.01.05)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2017-0081952 (2017.07.13) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.11.13)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이재진 대한민국 대전시 유성구
2 변경진 대한민국 대전시 서구
3 엄낙웅 대한민국 대전시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.01.05 수리 (Accepted) 1-1-2016-0008613-10
2 [심사청구]심사청구서·우선심사신청서
2020.11.13 수리 (Accepted) 1-1-2020-1219206-85
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번호 청구항
1 1
복수의 코어 모델들에 대하여 시뮬레이션을 수행하는 멀티-코어 시뮬레이터를 포함하고, 상기 멀티-코어 시뮬레이터를 실행하는 호스트 프로세서를 포함하는 멀티-코어 시뮬레이션 시스템의 멀티-코어 시뮬레이션 방법에 있어서:상기 복수의 코어 모델들에 대하여 공통으로 사용되는 공유 번역 블록 캐시를 워킹 메모리에 할당하는 단계;제 1 코어 모델에서 수행될 제 1 타겟 명령어를 읽는 단계;상기 제 1 타겟 명령어에 대응하고, 상기 호스트 프로세서에서 사용되는 명령어 셋으로 구성되는 제 1 번역 블록을 생성하는 단계;상기 제 1 번역 블록을 공유 번역 블록 캐시에 저장한 후, 상기 제 1 코어 모델에서 상기 제 1 번역 블록을 수행하는 단계;제 2 코어 모델에서 수행될 제 2 타겟 명령어를 읽는 단계;상기 제 2 타겟 명령어와 동일한 내용을 포함하는 번역 블록을 상기 공유 번역 블록 캐시에서 검색하는 단계; 그리고상기 제 1 타겟 명령어가 제 2 타겟 명령어와 동일한 내용을 포함하는 경우, 상기 제 2 코어 모델에서 상기 제 1 번역 블록을 수행하는 단계를 포함하는 멀티-코어 시뮬레이션 방법
2 2
제 1 항에 있어서,제 3 코어 모델에서 수행될 제 3 타겟 명령어를 읽는 단계;상기 제 3 타겟 명령어와 동일한 내용을 포함하는 번역 블록을 상기 공유 번역 블록 캐시에서 검색하는 단계;상기 공유 번역 블록 캐시에 상기 제 3 타겟 명령어와 동일한 내용을 포함하는 번역 블록이 없는 경우, 상기 호스트 프로세서에서 사용되는 명령어 셋으로 구성되는 제 2 번역 블록을 생성하는 단계; 그리고상기 제 2 번역 블록을 공유 번역 블록 캐시에 저장한 후, 상기 제 3 코어 모델에서 상기 제 2 번역 블록을 수행하는 단계를 더 포함하는 멀티-코어 시뮬레이션 방법
3 3
제 1 항에 있어서,상기 제 1 및 제 2 타겟 명령어를 읽는 단계에서, 상기 멀티-코어 시뮬레이터는 상기 제 1 및 제 2 타겟 명령어 각각에 대응하는 특징값을 계산하는 멀티-코어 시뮬레이션 방법
4 4
제 3 항에 있어서,상기 멀티-코어 시뮬레이터는 상기 특징값에 기초하여 상기 공유 번역 블록 캐시에서 각 타겟 명령어에 대응하는 번역 블록을 검색하는 멀티-코어 시뮬레이션 방법
5 5
제 1 항에 있어서,상기 공유 번역 블록 캐시는 입력되는 순서에 따라 연결 리스트로 번역 블록들을 저장하는 멀티-코어 시뮬레이션 방법
6 6
제 1 항에 있어서,상기 공유 번역 블록 캐시는 각 타겟 명령어에 대응하는 특징값에 기초하여 번역 블록들을 이진 트리 구조로 저장하는 멀티-코어 시뮬레이션 방법
7 7
제 1 항에 있어서,상기 제 1 및 제 2 타겟 명령어는 바이너리 코드로 구성되는 멀티-코어 시뮬레이션 방법
8 8
제 1 항에 있어서,상기 제 1 타겟 명령어는 역어셈블 과정을 통하여 상기 호스트 프로세서에서 사용되는 명령어 셋으로 구성되는 제 1 번역 블록으로 번역되는 멀티-코어 시뮬레이션 방법
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제 1 항에 있어서,상기 제 1 및 제 2 타겟 명령어는, 상기 호스트 프로세서에 의해, 상기 제 1 및 제 2 코어 모델에서 수행될 C 코드를 컴파일하여 생성되는 멀티-코어 시뮬레이션 방법
10 10
복수의 코어 모델들을 시뮬레이션하는 멀티-코어 시뮬레이터를 실행하는 호스트 프로세서; 그리고상기 멀티-코어 시뮬레이터 및 상기 코어 모델들에서 수행되는 타겟 명령어들을 로드하고, 상기 코어 모델들에서 공통으로 사용되는 공유 번역 블록 캐시를 포함하는 워킹 메모리를 포함하되,상기 공유 번역 블록 캐시는 상기 타겟 명령어들을 번역하여 상기 호스트 프로세서에서 사용되는 명령어 셋으로 구성되는 번역 블록들을 저장하고,상기 멀티-코어 시뮬레이터는 상기 코어 모델들 중 어느 하나에서 제 1 타겟 명령어를 수행하는 경우 상기 공유 번역 블록 캐시에서 상기 제 1 타겟 명령어에 대응하는 제 1 번역 블록을 검색하고, 상기 제 1 번역 블록이 존재하는 경우 상기 제 1 타겟 명령어의 번역없이 상기 제 1 번역 블록을 실행하는 멀티-코어 시뮬레이션 시스템
11 11
제 10 항에 있어서,상기 공유 번역 블록 캐시에 상기 제 1 번역 블록이 존재하지 않는 경우, 상기 멀티-코어 시뮬레이터는 상기 제 1 타겟 명령어를 상기 제 1 번역 블록으로 번역하여 상기 공유 번역 블록 캐시에 저장하는 멀티-코어 시뮬레이션 시스템
12 12
제 10 항에 있어서,상기 멀티-코어 시뮬레이터는 상기 제 1 타겟 명령어로부터 특징값을 계산하고, 상기 특징값에 기초하여 상기 공유 번역 블록 캐시에서 상기 제 1 번역 블록을 검색하는 멀티-코어 시뮬레이션 시스템
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1 산업통상자원부 한국전자통신연구원 산업핵심기술개발사업 Multi-domain 자동차 전장 구조를 위한 ECU용 SoC 및 임베디드 SW 개발