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다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터(Thin-film transistor having dual gate electrode with multi semiconductor layer)

  • 기술번호 : KST2017013984
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터에 관한 것으로, 기판; 상기 기판 상에 위치한 바텀게이트 전극; 상기 바텀게이트 전극을 포함하여 기판 전면에 걸쳐 위치한 바텀게이트 절연층; 상기 게이트 절연층 상에 서로 이격되어 위치하는 소스/드레인 전극; 상기 소스/드레인 전극을 포함하는 게이트 절연층 전면에 걸쳐 위치한 반도체층; 상기 반도체층 상의 전면에 위치하는 탑게이트 절연층; 및 상기 탑게이트 절연층 상에 위치한 탑게이트 전극;을 포함하되, 상기 반도체층은 복수층으로 형성된 것을 특징으로 하는 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터를 제공한다.
Int. CL H01L 29/786 (2016.03.26) H01L 29/49 (2016.03.26) H01L 21/8234 (2016.03.26)
CPC H01L 29/78645(2013.01) H01L 29/78645(2013.01) H01L 29/78645(2013.01) H01L 29/78645(2013.01) H01L 29/78645(2013.01) H01L 29/78645(2013.01) H01L 29/78645(2013.01)
출원번호/일자 1020160019735 (2016.02.19)
출원인 동국대학교 산학협력단
등록번호/일자
공개번호/일자 10-2017-0097969 (2017.08.29) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.02.19)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 동국대학교 산학협력단 대한민국 서울특별시 중구

발명자

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번호 이름 국적 주소
1 노용영 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 강일신 대한민국 서울특별시 서초구 바우뫼로 ***, *층 혜산빌딩(양재동)(시공특허법률사무소)
2 백두진 대한민국 서울특별시 서초구 바우뫼로 ***, *층(양재동, 혜산빌딩)(시공특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 동국대학교 산학협력단 대한민국 서울특별시 중구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.02.19 수리 (Accepted) 1-1-2016-0167079-67
2 선행기술조사의뢰서
Request for Prior Art Search
2016.06.21 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2016.07.11 수리 (Accepted) 9-1-2016-0030451-24
4 의견제출통지서
Notification of reason for refusal
2017.03.22 발송처리완료 (Completion of Transmission) 9-5-2017-0210528-46
5 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2017.05.22 수리 (Accepted) 1-1-2017-0482532-39
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.06.22 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0601074-33
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.06.22 수리 (Accepted) 1-1-2017-0601090-64
8 등록결정서
Decision to grant
2017.10.30 발송처리완료 (Completion of Transmission) 9-5-2017-0749913-18
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.16 수리 (Accepted) 4-1-2019-5163486-33
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번호 청구항
1 1
기판;상기 기판 상에 위치한 바텀게이트 전극;상기 바텀게이트 전극을 포함하여 기판 전면에 걸쳐 위치한 바텀게이트 절연층;상기 바텀게이트 절연층 상에 서로 이격되어 위치하는 소스/드레인 전극;상기 소스/드레인 전극을 포함하는 게이트 절연층 전면에 걸쳐 위치한 반도체층;상기 반도체층 상의 전면에 위치하는 탑게이트 절연층; 및상기 탑게이트 절연층 상에 위치한 탑게이트 전극;을 포함하되,상기 반도체층은 복수층으로 형성된 것을 특징으로 하는 다층의 반도체층을 포함하되,상기 반도체층은 3개의 층 이상으로 형성되어 내부층과 외부층으로 구분되며, 상기 내부층으로는 InO, IZO, IGO, ZTO, ZnO, 옥시나이트라이드화합물 중 1이상 선택되며, 상기 외부층으로는 GZO, IGTO 중 1이상 선택되며,상기 내부층은 상기 외부층에 비해 상대적으로 이동도가 높은 물질이며,상기 외부층은 상기 내부층에 비해 상대적으로 밴드갭이 큰 물질인 것을 특징으로 하는 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터
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삭제
3 3
삭제
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제1항에 있어서,상기 반도체층은 3개의 층으로 이루어지는 것을 특징으로 하는 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터
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제1항에 있어서,상기 반도체층의 두께(h)는 1~20nm인 것을 특징으로 하는 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터
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제1항에 있어서,상기 바텀게이트 절연층 및 탑게이트 절연층은 유기 고분자로 폴리스타이렌(PS, polystyrene), 폴리메타아크릴레이트 (PMMA, polymethylmethacrylate), 페놀계 고분자, 아크릴계 고분자, 이미드계 고분자, 아릴에테르계 고분자, 아마이드계 고분자, 불소계 고분자, p-자이리렌계 고분자, 비닐알콜계 고분자, 파릴렌(parylene)으로 이루어진 군에서 1이상 선택하거나,산화물로 SiO2, Al2O3, HfO2, ZrO2, Y2O3 및 Ta2O5로 이루어진 군에서 1이상 선택하는 것을 특징으로 하는 다층의 반도체층을 포함하는 듀얼게이트 박막트랜지스터
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순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 동국대학교 글로벌프론티어사업 소프트전자회로 및 센서회로 개발