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하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 장치 및 방법(APPARATUS FOR MAINTAINING DATA CONSISTENCY BETWEEN HARDWARE ACCELERATOR AND HOST SYSTEM AND METHOD OF THE SAME)

  • 기술번호 : KST2017015228
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 메인 메모리의 데이터를 처리하는 하드웨어 가속기가 탑재된 범용 컴퓨팅 시스템에서의 호스트 시스템 캐시와 메인 메모리 사이의 일관성을 유지하기 위한 기술적 사상에 관한 것으로서, 일측에 따른 컴퓨터에 의해 적어도 일시적으로 구현되는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 장치에 있어서, 하드웨어 가속기가 접근해야 할 주소가 캐시에 존재하는지 여부를 판단하는 판단부, 및 상기 판단 결과, 상기 주소가 캐시에 존재하는 경우에 상기 주소에 상응하는 데이터를 선택적으로 라이트백(write-back)하도록 제어하는 처리부를 포함한다.
Int. CL G06F 12/08 (2016.04.23)
CPC G06F 12/0815(2013.01) G06F 12/0815(2013.01) G06F 12/0815(2013.01)
출원번호/일자 1020160033036 (2016.03.18)
출원인 연세대학교 산학협력단
등록번호/일자
공개번호/일자 10-2017-0108714 (2017.09.27) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.03.18)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 정의영 대한민국 경기도 성남시 분당구
2 서혁준 대한민국 서울특별시 서대문구
3 한상우 대한민국 서울특별시 양천구

대리인

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번호 이름 국적 주소
1 김연권 대한민국 서울특별시 송파구 법원로 ***, ****/****호(문정동, 문정대명벨리온)(시안특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.03.18 수리 (Accepted) 1-1-2016-0265277-77
2 선행기술조사의뢰서
Request for Prior Art Search
2017.01.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2017.02.07 발송처리완료 (Completion of Transmission) 9-6-2017-0019635-10
4 의견제출통지서
Notification of reason for refusal
2017.02.19 발송처리완료 (Completion of Transmission) 9-5-2017-0125358-19
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.04.04 수리 (Accepted) 1-1-2017-0330012-34
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.04.04 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0330036-29
7 의견제출통지서
Notification of reason for refusal
2017.08.29 발송처리완료 (Completion of Transmission) 9-5-2017-0601265-04
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.10.30 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-1073094-84
9 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.10.30 수리 (Accepted) 1-1-2017-1073056-59
10 등록결정서
Decision to grant
2018.03.16 발송처리완료 (Completion of Transmission) 9-5-2018-0184866-42
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
컴퓨터에 의해 적어도 일시적으로 구현되는:하드웨어 가속기 API(application programming interface)에 인자를 전달하는 사용자 프로그램;상기 인자에 대한 특징으로서, 참조 처리, 덮어쓰기 처리, 임시 처리, 및 복합 처리를 구분하여 라이트백(write-back) 함수 및 인밸리데이트(invalidate) 함수 중에서 적어도 하나를 호출하는 하드웨어 가속기;하드웨어 가속기가 접근해야 할 주소가 캐시에 존재하는지 여부를 판단하고, 상기 판단 결과에 따라 상기 주소에 상응하는 데이터를 선택적으로 라이트백(write-back)하도록 제어하는 일관성 유지 장치를 포함하고, 상기 일관성 유지 장치는상기 하드웨어 가속기가 접근해야 할 상기 주소가 캐시에 존재하는지 여부를 판단하는 판단부; 및상기 판단 결과, 상기 주소가 캐시에 존재하는 경우에 상기 주소에 상응하는 데이터를 선택적으로 라이트백(write-back)하도록 제어하되, 상기 캐시에 존재하는 주소의 특징에 기초하여 상기 라이트백(write-back)의 방식을 서로 다르게 처리하는 처리부를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지를 위한 시스템
2 2
삭제
3 3
제1항에 있어서,상기 주소의 특징은 상기 데이터에 대한 참조 처리, 덮어쓰기 처리, 임시 처리, 및 복합 처리 중에서 적어도 하나에 대응되는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지를 위한 시스템
4 4
컴퓨터에 의해 적어도 일시적으로 구현되는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법에 있어서,사용자 프로그램에서 하드웨어 가속기 API(application programming interface)에 인자를 전달하는 단계;상기 하드웨어 가속기에서 상기 인자에 대한 특징으로서, 참조 처리, 덮어쓰기 처리, 임시 처리, 및 복합 처리를 구분하여 라이트백(write-back) 함수 및 인밸리데이트(invalidate) 함수 중에서 적어도 하나를 호출하는 단계;상기 하드웨어 가속기가 접근해야 할 주소가 캐시에 존재하는지 여부를 판단하는 단계;상기 주소가 캐시에 존재하는 경우, 상기 호출된 라이트백(write-back) 함수 및 인밸리데이트(invalidate) 함수 중에서 적어도 하나에 따라 캐시에서 해당 주소를 라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리 중에서 적어도 하나를 수행하는 단계; 및라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리 중에서 적어도 하나의 처리가 완료되면, 상기 하드웨어 가속기가 구동되도록 제어하는 단계를 포함하고,상기 라이트백(write-back) 처리 및 상기 인밸리데이트(invalidate) 처리 중에서 적어도 하나를 수행하는 단계는,상기 캐시에 존재하는 주소의 특징에 기초하여 상기 라이트백(write-back)의 방식을 서로 다르게 처리하는 단계를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법
5 5
제4항에 있어서,상기 인자를 전달하는 단계는,상기 하드웨어 가속기에 전달할 인자들 중에서 상수 변수 및 포인터 주소의 값을 상기 하드웨어 가속기 API(application programming interface)에 전달하는 단계를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법
6 6
삭제
7 7
제4항에 있어서,상기 라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리 중에서 적어도 하나를 수행하는 단계는,상기 참조 처리를 위해, 상기 캐시에서 메인 메모리로 관련 데이터를 라이트백(write-back)하고, 상기 캐시의 데이터를 유지하도록 제어하는 단계를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법
8 8
제4항에 있어서,상기 라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리 중에서 적어도 하나를 수행하는 단계는,상기 덮어쓰기 처리를 위해, 상기 캐시의 데이터를 인밸리데이트(invalidate) 처리하는 단계를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법
9 9
제4항에 있어서,상기 라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리 중에서 적어도 하나를 수행하는 단계는,상기 복합 처리를 위해, 참조 처리 및 덮어쓰기 처리에 기초하는 라이트백(write-back) 처리 및 인밸리데이트(invalidate) 처리를 수행하는 단계를 포함하는 하드웨어 가속기와 호스트 시스템 사이의 데이터 일관성 유지 방법
10 10
삭제
11 11
삭제
12 12
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1 US10853247 US 미국 FAMILY
2 US20170270043 US 미국 FAMILY

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1 US2017270043 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 연세대학교 산학협력단 기본연구지원사업 DRAM-적층 이종 멀티프로세서를 위한 비대칭 DRAM 구조 및 그 합성 방법에 대한 연구
2 산업통상자원부 연세대학교 산학협력단 전자정보디바이스산업원천기술개발사업 스마트 센서 SoC용 초저전압 회로 및 IP 설계 기술 개발