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트랩층을 포함하는 부성 미분 저항 소자 및 그 제조 방법(NEGATIVE DIFFERENTIAL RESISTANCE INCLUDING TRAP LAYER AND ITS MANUFACTURING METHOD)

  • 기술번호 : KST2017015319
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 일 실시예에 따른 부성 미분 저항(negative differential resistance) 소자는 기판; 기판 상에 형성되고, 제 1 극성을 갖는 축퇴된 제 1 반도체층; 기판 상에 형성되고, 제 2 극성을 갖는 축퇴된 제 2 반도체층; 제 1 반도체층의 일측 단부에 결합된 제 1 전극; 제 2 반도체층의 일측 단부에 결합된 제 2 전극; 및 제 1 반도체층과 제 2 반도체층의 접촉 영역 사이에 위치한 트랩층을 포함하되, 트랩층은 산화물층이고, 부성 미분 저항 소자의 동작시 캐리어가 트랩층에 트랩되도록 한다.
Int. CL H01L 29/792 (2016.04.23) H01L 29/423 (2016.04.23) H01L 29/51 (2016.04.23) H01L 29/788 (2016.04.23) H01L 29/861 (2016.04.23)
CPC H01L 29/792(2013.01) H01L 29/792(2013.01) H01L 29/792(2013.01) H01L 29/792(2013.01) H01L 29/792(2013.01) H01L 29/792(2013.01)
출원번호/일자 1020160033635 (2016.03.21)
출원인 성균관대학교산학협력단
등록번호/일자
공개번호/일자 10-2017-0109457 (2017.09.29) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.03.21)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 박진홍 대한민국 경기도 화성
2 심재우 대한민국 경기도 부천시 원미구
3 이성주 대한민국 경기도 성남시 분당구

대리인

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번호 이름 국적 주소
1 특허법인엠에이피에스 대한민국 서울특별시 강남구 테헤란로*길 **, *층 (역삼동, 한동빌딩)

최종권리자

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번호 이름 국적 주소
1 성균관대학교산학협력단 경기도 수원시 장안구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.03.21 수리 (Accepted) 1-1-2016-0271776-34
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
3 의견제출통지서
Notification of reason for refusal
2017.06.28 발송처리완료 (Completion of Transmission) 9-5-2017-0451510-66
4 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.08.28 수리 (Accepted) 1-1-2017-0829395-64
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.08.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0829396-10
6 등록결정서
Decision to grant
2017.11.16 발송처리완료 (Completion of Transmission) 9-5-2017-0800404-11
7 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2018.09.04 수리 (Accepted) 1-1-2018-0879114-03
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
부성 미분 저항(negative differential resistance) 소자에 있어서,기판;상기 기판 상에 형성되고, 제 1 극성을 갖는 축퇴된 제 1 반도체층;상기 기판 상에 형성되고, 제 2 극성을 갖는 축퇴된 제 2 반도체층;상기 제 1 반도체층의 일측 단부에 결합된 제 1 전극;상기 제 2 반도체층의 일측 단부에 결합된 제 2 전극; 및상기 제 1 반도체층과 제 2 반도체층의 접촉 영역 사이에 위치한 트랩층을 포함하되,상기 트랩층은 산화물층이고, 상기 제 1 전극과 제 2 전극에 전압을 인가하여, 상기 제 1 반도체층과 제 2 반도체층의 접촉 영역 사이에 형성된 것이거나, 상기 제 1 반도체층의 상부에 적층한 금속층이 산화되어 형성된 것이고,상기 부성 미분 저항 소자의 동작시 캐리어가 상기 트랩층에 트랩되도록 하는 부성 미분 저항 소자
2 2
제 1항에 있어서,제 1 전극과 제 2 전극에 인가되는 전압의 증가에 따라 상기 트랩층에 트랩되는 캐리어가 증가하게 되고, 트랩된 캐리어의 증가에 따라 상기 전압과 반대 방향의 전기장이 형성되는 부성 미분 저항 소자
3 3
제 1항에 있어서,상기 제 1 반도체층은 p형 반도체층이고, 제 2 반도체층은 n형 반도체층이거나상기 제 1 반도체층은 n형 반도체층이고, 상기 제2 반도체층은 p형 반도체층인 것인 부성 미분 저항 소자
4 4
제 3항에 있어서,상기 p형 반도체층은 실리콘, 저마늄(Ge), 주기율표의 III-V 족 원소에 대한 반도체, 유기물 반도체, 비유기물인 산화물 반도체, 전이금속 칼코겐 화합물(transition metal dichalcogenide) 및 흑린(phosphorene) 중 적어도 하나로 이루어지고,상기 n형 반도체층은 저마늄(Ge), 주기율표의 III-V 족 원소에 대한 반도체, 유기물 반도체, 비유기물인 산화물 반도체, 전이금속 칼코겐 화합물(transition metal dichalcogenide) 및 이황화레늄(ReS2) 중 적어도 하나로 이루어지는 것인 부성 미분 저항 소자
5 5
제 4항에 있어서,상기 제 1 전극 및 제 2 전극은 티타늄(Ti), 알루미늄(Al), 에르븀(Er), 플레티늄(Pt), 금(Au) 및 팔라듐(Pd) 중 적어도 하나로 이루어지는 것인 부성 미분 저항 소자
6 6
제 1항에 있어서,상기 트랩층은 상기 제 1 전극과 제 2 전극에 인가된 전압에 의하여 발생된 줄(joule)열에 의하여 형성된 산화물층인 부성 미분 저항 소자
7 7
삭제
8 8
제 1항에 있어서,상기 금속층은 티타늄(Ti) 및 알루미늄(Al) 중 적어도 하나로 이루어지는 것인 부성 미분 저항 소자
9 9
제 1항에 있어서,상기 기판은 이산화규소(SiO2), 산화알루미늄(Al2O3), 산화하프늄(HfO2) 중 적어도 하나로 구성된 절연층이 증착된 실리콘(Si) 기판, 저마늄(Ge) 기판, 유리(glass) 기판 및 PET(polyethylene terephthalate) 기판 중 적어도 하나로 이루어지는 것인 부성 미분 저항 소자
10 10
부성 미분 저항(negative differential resistance) 소자의 제조 방법에 있어서,기판 상에 제 1 극성을 갖는 축퇴된 제 1 반도체층을 형성하는 단계;상기 기판 및 제 1 반도체층 상에 제 2 극성을 갖는 축퇴된 제 2 반도체층을 형성하는 단계;상기 제 1 반도체층의 일측 단부 및 제 2 반도체층의 일측 단부에 각각 제 1 전극 및 제 2 전극을 형성하는 단계; 및상기 제 1 전극과 제 2 전극에 전압을 인가하여, 상기 제 1 반도체층과 제 2 반도체층의 접촉 영역 사이에 트랩층을 형성하는 단계를 포함하는 부성 미분 저항 소자의 제조 방법
11 11
제 10 항에 있어서,상기 제 1 반도체층을 형성하는 단계는상기 기판 상에 제 1 극성을 갖는 제 1 반도체층을 증착하는 단계 및상기 제 1 반도체층을 축퇴시키는 단계를 포함하고,상기 제 2 반도체층을 형성하는 단계는상기 기판 상에 제 2 극성을 갖는 제 2 반도체층을 증착하는 단계 및상기 제 2 반도체층을 축퇴시키는 단계를 포함하는 부성 미분 저항 소자의 제조 방법
12 12
제 10 항에 있어서,상기 트랩층은 상기 제 1 전극과 제 2 전극에 인가된 전압에 의하여 발생된 줄(joule)열에 의하여 형성된 산화물층인 것인 부성 미분 저항 소자의 제조 방법
13 13
부성 미분 저항(negative differential resistance) 소자의 제조 방법에 있어서,기판 상에 제 1 극성을 갖는 축퇴된 제 1 반도체층을 형성하는 단계;상기 제 1 반도체층의 일 영역에 트랩층을 형성하는 단계; 상기 기판 및 제 1 반도체층의 트랩층 상에 제 2 극성을 갖는 축퇴된 제 2 반도체층을 형성하는 단계; 및상기 제 1 반도체층의 일측 단부 및 제 2 반도체층의 일측 단부에 각각 제 1 전극 및 제 2 전극을 형성하는 단계를 포함하되,상기 트랩층을 형성하는 단계는상기 제 1 반도체층의 상부에 금속층을 증착하는 단계 및상기 금속층을 산화시키는 단계를 포함하는 부성 미분 저항 소자의 제조 방법
14 14
제 13 항에 있어서,상기 제 1 반도체층을 형성하는 단계는상기 기판 상에 제 1 극성을 갖는 제 1 반도체층을 증착하는 단계 및상기 제 1 반도체층을 축퇴시키는 단계를 포함하고,상기 제 2 반도체층을 형성하는 단계는상기 기판 상에 제 2 극성을 갖는 제 2 반도체층을 증착하는 단계 및상기 제 2 반도체층을 축퇴시키는 단계를 포함하는 부성 미분 저항 소자의 제조 방법
15 15
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1 미래창조과학부 성균관대학교(자연과학캠퍼스) 중견연구자지원사업(핵심개인연구)1/3 사물인터넷 소자용 그래핀/전이금속칼코겐 화합물 기반 저전력 반도체소자 원천기술개발
2 미래창조과학부 성균관대학교(자연과학캠퍼스) 창의소재디스커버리사업 선기획연구과제 다중 에너지 준위 유무기 초분자구조체 소재를 활용한 소재/소재 통합형 동시설계 기반 다치로직 소자기술
3 미래창조과학부 성균관대학교(자연과학캠퍼스) 나노소재기술개발사업(선행공정·플랫폼기술연구개발사업) 1/3 M3D 집적 초절전 아키텍처 구현을 위한 저온공정 및 원자스위치 소자 개발