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LDO(Low Drop Out) 레귤레이터의 출력 전압에 발생된 스파크를 상쇄시키기 위해 기준 전류를 증가 또는 감소시키는 메인 회로부;상기 출력 전압 및 기설정된 기준 전압의 제1 비교 결과에 따라 제1 증폭기가 제1 트랜지스터를 턴 온 하고, 상기 제1 트랜지스터의 제1 전류를 상기 메인 회로부로 제공하여 상기 기준 전류를 증가 시키는 제1 동적 전류 소스부; 및상기 출력 전압 및 상기 기준 전압의 제2 비교 결과에 따라 제2 증폭기가 제2 트랜지스터를 턴 온 하고, 상기 제2 트랜지스터는 상기 메인 회로부로부터 제2 전류를 공급 받아 상기 기준 전류를 감소시키는 제2 동적 전류 소스부를 포함하는 LDO 레귤레이터
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제1항에 있어서,상기 제1 동적 전류 소스부는 상기 출력 전압이 상기 기준 전압보다 제1 임계치 이상인 경우에, 상기 제1 증폭기가 상기 제1 트랜지스터를 턴 온 하고, 상기 제1 트랜지스터의 상기 제1 전류를 상기 메인 회로부로 제공하여 상기 기준 전류를 증가 시키는 LDO 레귤레이터
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제1항에 있어서,상기 제2 동적 전류 소스부는 상기 출력 전압이 상기 기준 전압보다 제2 임계치 이하인 경우에, 상기 제2 증폭기가 상기 제2 트랜지스터를 턴 온 하고, 상기 제2 트랜지스터는 상기 메인 회로부로부터 상기 제2 전류를 공급 받아 상기 기준 전류를 감소시키는 LDO 레귤레이터
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제1항에 있어서,상기 제1 동적 전류 소스부는 상기 제1 증폭기를 포함하고, 상기 제1 증폭기는 비반전 단자에 상기 기준 전압이 입력되고, 반전 단자에 상기 출력 전압이 입력되는 LDO 레귤레이터
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제4항에 있어서,상기 제1 증폭기는 직렬로 연결된 상기 기준 전압 및 오프셋 전압이 상기 비반전 단자에 입력되는 LDO 레귤레이터
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제1항에 있어서,상기 제2 동적 전류 소스부는 상기 제2 증폭기를 포함하고, 상기 제2 증폭기는 비반전 단자에 상기 출력 전압이 입력되고, 반전 단자에 상기 기준 전압이 입력되는 LDO 레귤레이터
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제6항에 있어서,상기 제2 증폭기는 직렬로 연결된 상기 출력 전압 및 오프셋 전압이 상기 비반전 단자에 입력되는 LDO 레귤레이터
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제6항에 있어서,상기 제2 동적 전류 소스부는 상기 제2 증폭기의 출력단에 연결되는 전류 미러 회로를 포함하고, 상기 제2 트랜지스터는 상기 전류 미러 회로 내의 제3 트랜지스터를 턴 온하고, 상기 제3 트랜지스터는 상기 메인 회로부로부터 제2 전류를 공급 받아 상기 기준 전류를 감소시키는 LDO 레귤레이터
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LDO 레귤레이터의 동작을 제어하는 동적 전류원에 있어서,상기 LDO 레귤레이터의 출력 전압 및 소정의 기준 전압의 차이에 따라 턴 온 되는 증폭기; 및상기 증폭기의 출력 전압에 따라 턴 온 되어 출력 전류를 제공하는 트랜지스터를 포함하고,상기 증폭기는 비반전 단자의 입력 전압을 입력 받는 제1 트랜지스터와 반전 단자의 입력 전압을 입력 받는 제2 트랜지스터를 포함하고, 상기 제1 트랜지스터 및 상기 제2 트랜지스터는 소정의 외형비(aspect ratio)를 갖는 것을 특징으로 하는 동적 전류원
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제9항에 있어서,상기 증폭기는 상기 소정의 외형비에 기초하여 크기 결정된 오프셋 전압을 상기 비반전 단자에 직렬로 연결하는 동적 전류원
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제9항에 있어서,상기 제1 트랜지스터의 드레인 단자 및 상기 제2 트랜지스터의 드레인 단자 각각은 적어도 두 개의 트랜지스터를 포함하는 전류 미러 회로의 출력 단자 각각에 연결되는 동적 전류원
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제11항에 있어서,상기 제1 트랜지스터의 드레인 단자는 제3 PMOS 트랜지스터의 드레인 단자와 연결되고, 상기 제2 트랜지스터의 드레인 단자는 제4 PMOS 트랜지스터의 드레인 단자와 연결되고, 상기 제3 PMOS 트랜지스터 및 상기 제4 PMOS 트랜지스터는 상기 전류 미러 회로에 포함되는 동적 전류원
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제11항에 있어서,상기 증폭기는 상기 제2 트랜지스터의 드레인 단자와 연결되는 출력 단자를 포함하는 동적 전류원
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제9항에 있어서,상기 제1 트랜지스터 및 상기 제2 트랜지스터는 1 : 3 또는 3: 1로부터 소정 범위 이내의 외형비를 갖는 것을 특징으로 하는 동적 전류원
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