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입력신호 및 제1 중간신호 중 하나를 선택하여 전달하는 제1 선택부;상기 제1 선택부가 전달하는 신호를 기 설정된 주기폭 동안 적분하여 상기 제1 중간신호를 출력하는 제1 적분기;상기 제1 적분기의 출력에 직렬로 연결되어 상기 제1 중간신호 및 제2 중간신호 중 하나를 선택하여 전달하는 제2 선택부; 상기 제2 선택부가 전달하는 신호를 상기 기 설정된 주기폭 동안 적분하여 상기 제2 중간신호를 출력하는 제2 적분기; 및상기 제2 중간신호를 기 설정된 기준 레벨과 비교하여 1 비트 디지털 신호를 출력하는 비교기를 포함하는 델타 시그마 변조기
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제 1항에 있어서,상기 제1 선택부는, 상기 제1 선택부의 입력 및 출력 사이의 커패시턴스를 상기 제1 선택부가 상기 입력신호를 입력받는 동안 기 설정된 배수만큼 증가시키는 제1 잡음 제거부를 포함하는 것을 특징으로 하는 델타 시그마 변조기
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3
제 1항에 있어서,상기 제2 선택부는, 상기 제2 선택부의 입력 및 출력 사이의 커패시턴스를 상기 제2 선택부가 상기 제1 중간신호를 입력받는 동안 기 설정된 배수만큼 증가시키는 제2 잡음 제거부를 포함하는 것을 특징으로 하는 델타 시그마 변조기
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4
제 1항에 있어서, 상기 1비트 디지털 신호를 상기 기 설정된 주기폭만큼 지연하여 제1 지연신호를 출력하는 제1 지연부; 및상기 제1 지연신호를 상기 기 설정된 주기폭만큼 더 지연하여 제2 지연신호를 출력하는 제2 지연부를 더 포함하는 것을 특징으로 하는 델타 시그마 변조기
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5
제 4항에 있어서,상기 제1 선택부는 제1 주기에 상기 입력신호 및 상기 제2 지연신호 중 적어도 하나를 입력받고 제2 주기에 상기 제1 주기에 입력받은 신호를 제1 적분기로 전달하며, 제3 주기에 상기 제1 중간신호 및 상기 제1 지연신호 중 적어도 하나를 입력받고 제4 주기에 상기 제3 주기에 입력받은 신호를 제1 적분기로 전달하는 것을 특징으로 하는 델타 시그마 변조기
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6
제 5항에 있어서,상기 제1 내지 제4 주기의 주기폭은 상기 기 설정된 주기폭인 것을 특징으로 하는 델타 시그마 변조기
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7
제 5항에 있어서,상기 제1 선택부는 상기 입력신호 및 상기 제1 중간신호를 상기 제1 적분기의 포지티브 입력으로 전달하고, 상기 제1 및 제2 지연신호를 상기 제1 적분기의 네거티브 입력으로 전달하는 것을 특징으로 하는 델타 시그마 변조기
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8
제 4항에 있어서,상기 제2 선택부는 제1 주기에 상기 제1 중간신호 및 상기 제1 지연신호 중 적어도 하나를 입력받고 제2 주기에 상기 제1 주기에 입력받은 신호를 제2 적분기로 전달하며, 제3 주기에 상기 제2 중간신호 및 상기 1비트 디지털 신호 중 적어도 하나를 입력받고 제4 주기에 상기 제3 주기에 입력받은 신호를 제2 적분기로 전달하는 것을 특징으로 하는 델타 시그마 변조기
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9
제 8항에 있어서,상기 제1 내지 제4 주기의 주기폭은 상기 기 설정된 주기폭인 것을 특징으로 하는 델타 시그마 변조기
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10
제 8항에 있어서,상기 제2 선택부는 상기 제1 중간신호 및 상기 제2 중간신호를 상기 제2 적분기의 포지티브 입력으로 전달하고, 상기 제1 지연신호 및 상기 1비트 디지털 신호를 상기 제2 적분기의 네거티브 입력으로 전달하는 것을 특징으로 하는 델타 시그마 변조기
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11
제 7항에 있어서,상기 제1 적분기의 출력은 제1 주기 및 제4 주기에 상기 제1 적분기의 포지티브 입력으로 제1 피드백 커패시터를 통하여 피드백되고 제3 주기 및 제4 주기에 상기 제1 적분기의 네거티브 입력으로 제2 피드백 커패시터를 통하여 피드백되며, 상기 제1 및 제2 피드백 커패시터의 용량은 동일한 것을 특징으로 하는 델타 시그마 변조기
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12
제 10항에 있어서,상기 제2 적분기의 출력은 제1 주기 및 제4 주기에 상기 제2 적분기의 포지티브 입력으로 제3 피드백 커패시터를 통하여 피드백되고 제3 주기 및 제4 주기에 상기 제2 적분기의 네거티브 입력으로 제4 피드백 커패시터를 통하여 피드백되며, 제3 및 제4 피드백 커패시터의 용량은 동일한 것을 특징으로 하는 델타 시그마 변조기
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