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가상 낸드플래시 구현 방법 및 이를 기록한 컴퓨터 프로그램(Method And Computer Program of Implementing Virtual NAND Flash)

  • 기술번호 : KST2018005342
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 가상 낸드플래시 구현 방법 및 이를 기록한 컴퓨터 프로그램을 개시한다.본 발명의 일 실시예에 의하면, P/E 사이클(Program/Erase cycle)의 증가에 따라 비트 오류가 발생하는 가상 낸드플래시 구현 방법에 있어서, 실제 낸드플래시의 P/E 사이클에 따른 비트 오류율(bit error rate)을 측정한 측정 데이터를 수집하는 과정; 및 상기 측정 데이터를 기반으로, 상기 가상 낸드플래시에 비트 오류를 삽입하는 과정을 포함하는 가상 낸드플래시 구현 방법을 제공한다.
Int. CL G06F 11/22 (2017.01.01) G06F 11/25 (2006.01.01)
CPC G06F 11/2205(2013.01) G06F 11/2205(2013.01)
출원번호/일자 1020160133682 (2016.10.14)
출원인 한국외국어대학교 연구산학협력단
등록번호/일자
공개번호/일자 10-2018-0041473 (2018.04.24) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.10.14)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국외국어대학교 연구산학협력단 대한민국 경기도 용인시 처인구

발명자

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번호 이름 국적 주소
1 임승호 대한민국 경기도 성남시 중원구
2 김기진 대한민국 경상남도 창원시 의창구

대리인

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번호 이름 국적 주소
1 이철희 대한민국 서울특별시 강남구 도곡로**길 **(역삼동) 베리타스빌딩, *-*층(베리타스국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한국외국어대학교 연구산학협력단 경기도 용인시 처인구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.10.14 수리 (Accepted) 1-1-2016-0998390-10
2 선행기술조사의뢰서
Request for Prior Art Search
2017.12.08 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2018.02.06 수리 (Accepted) 9-1-2018-0005872-25
4 의견제출통지서
Notification of reason for refusal
2018.02.27 발송처리완료 (Completion of Transmission) 9-5-2018-0139854-50
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.03.07 수리 (Accepted) 1-1-2018-0230846-17
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.03.07 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0230970-60
7 의견제출통지서
Notification of reason for refusal
2018.05.30 발송처리완료 (Completion of Transmission) 9-5-2018-0363938-30
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.07.09 수리 (Accepted) 1-1-2018-0670623-30
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.07.09 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0670624-86
10 등록결정서
Decision to grant
2018.09.18 발송처리완료 (Completion of Transmission) 9-5-2018-0640328-75
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번호 청구항
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P/E 사이클의 증가에 따라 비트 오류가 발생하는 가상 낸드플래시 구현 방법에 있어서,실제 낸드플래시의 P/E 사이클에 따른 비트 오류율을 측정한 측정 데이터를 수집하는 과정; 상기 측정 데이터에서 샘플을 추출하여 P/E 사이클 당 비트 오류율에 대한 확률 모델을 구축하는 과정;상기 확률 모델을 참조하여, 상기 가상 낸드플래시의 페이지에서 쓰기(Program) 작업이 수행되는 경우, 해당 P/E 사이클에 따른 비트 오류율을 기반으로 상기 가상 낸드플래시에 비트 오류를 삽입하는 과정; 상기 가상 낸드플래시의 P/E 사이클에 따른 비트 오류율을 측정하고, 상기 측정 데이터와 유사성을 비교하는 과정; 및상기 유사성이 일정 수준 이하인 경우, 상기 측정 데이터에서 추가로 샘플을 추출하여 상기 확률 모델을 재구축하는 과정을 포함하는 가상 낸드플래시 구현 방법
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제 7항에 있어서,상기 확률 모델을 구축하는 과정은,각 샘플 사이에서의 비트 오류 발생은 선형보간법을 이용해 비트 오류율을 산정하는 것을 특징으로 하는 가상 낸드플래시 구현 방법
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제 7항에 있어서,상기 확률 모델을 재구축하는 과정은,상기 유사성이 일정 수준 이하인 P/E 사이클 구간에 대해 상기 측정 데이터에서 추가로 샘플을 추출하는 것을 특징으로 하는 가상 낸드플래시 구현 방법
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프로세서에 의해 실행 가능한 컴퓨터 프로그램 명령어들을 포함하는 컴퓨터 판독 가능한 기록매체에 기록된 시나리오 생성을 위한 컴퓨터 프로그램으로서, 컴퓨팅 장치의 프로세서에 의해 실행되는 경우에 컴퓨팅 장치로 하여금,실제 낸드플래시의 P/E 사이클에 따른 비트 오류율을 측정한 측정 데이터를 수집하는 과정; 상기 측정 데이터에서 샘플을 추출하여 P/E 사이클 당 비트 오류율에 대한 확률 모델을 구축하는 과정;상기 확률 모델을 참조하여, 가상 낸드플래시의 페이지에서 쓰기 작업이 수행되는 경우, 해당 P/E 사이클에 따른 비트 오류율을 기반으로 상기 가상 낸드플래시에 비트 오류를 삽입하는 과정; 상기 가상 낸드플래시의 P/E 사이클에 따른 비트 오류율을 측정하고, 상기 낸드플래시의 P/E 사이클에 따른 비트 오류율과의 유사성을 비교하는 과정; 및상기 유사성이 일정 수준 이하인 경우, 상기 측정 데이터에서 추가로 샘플을 추출하여 상기 확률 모델을 재구축하는 과정을 수행하도록 하는 명령어들을 포함하는 컴퓨터 프로그램
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순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 한국외국어대학교 선도연구센터지원사업(CRC) 글로벌 다형 지식 연구 센터
2 미래창조과학부 한국외국어대학교 이공분야기초연구사업 신진연구지원사업 NVMe 인터페이스 기반의 초고속 IO 스토리지 시스템 개발