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저전력 이중 에러 정정―삼중 에러 검출(DEB―TED) 디코더(LOW-POWER DOUBLE ERROR CORRECTING-TRIPLE ERROR DETECTING (DEB-TED) DECODER)

  • 기술번호 : KST2018006391
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 에러 검출 및 정정 디코딩 장치는, 단일 비트 에러들의 경우에 전력 소비 및 레이턴시를 감소시키고 다중-비트 에러들의 경우에 강력한 에러 정정을 제공하기 위해, 데이터 입력이 단일 비트 에러를 포함하는지 또는 다중-비트 에러를 포함하는지에 따라 SEC-DED(single error correction-double error detection) 또는 DEC-TED(double error correction-triple error detection)를 수행한다.
Int. CL H03M 13/00 (2017.01.01) G06F 11/10 (2006.01.01) H03M 13/15 (2015.01.01)
CPC H03M 13/616(2013.01) H03M 13/616(2013.01) H03M 13/616(2013.01) H03M 13/616(2013.01) H03M 13/616(2013.01) H03M 13/616(2013.01)
출원번호/일자 1020187010280 (2016.08.25)
출원인 퀄컴 인코포레이티드, 연세대학교 산학협력단
등록번호/일자
공개번호/일자 10-2018-0053700 (2018.05.23) 문서열기
공고번호/일자
국제출원번호/일자 PCT/US2016/048604 (2016.08.25)
국제공개번호/일자 WO2017048474 (2017.03.23)
우선권정보 미국  |   14/852,988   |   2015.09.14
법적상태 공개
심사진행상태 수리
심판사항
구분 국제출원
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 28

출원인

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번호 이름 국적 주소
1 퀄컴 인코포레이티드 미국 미국 *****-**** 캘리포니아주 샌 디에고 모어하우스 드라이브 *
2 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 정, 승욱 대한민국 서울 서대문구
2 최, 사라 대한민국 서울 서대문구
3 송, 병규 대한민국 서울 서대문구
4 나, 태희 대한민국 서울 서대문구
5 김, 지수 대한민국 서울 서대문구
6 김, 정필 미국 *****-**** 캘리
7 김, 성률 미국 *****-**** 캘리
8 김, 태현 미국 ***** 캘리포니
9 강, 승혁 미국 *****-**** 캘리

대리인

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번호 이름 국적 주소
1 특허법인 남앤남 대한민국 서울특별시 중구 서소문로 ** (서소문동, 정안빌딩 *층)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허법 제203조에 따른 서면
[Patent Application] Document according to the Article 203 of Patent Act
2018.04.11 수리 (Accepted) 1-1-2018-0361594-34
2 수리안내서
Notice of Acceptance
2018.04.18 발송처리완료 (Completion of Transmission) 1-5-2018-0060356-41
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번호 청구항
1 1
에러 검출 및 정정 장치로서,입력 데이터에서 단일 에러들을 로케이팅(locate)하도록 구성된 단일 에러 로케이션 디코더;상기 입력 데이터에서 이중 에러들을 로케이팅하도록 구성된 이중 에러 로케이션 디코더; 특정 데이터 입력이 단일 에러를 갖거나 또는 이중 에러를 갖는 것으로 예측되는지를 결정하고, 상기 에러 예측에 기반하여 상기 특정 데이터 입력에 대해 에러 로케이션을 수행하기 위해 상기 단일 에러 로케이션 디코더 및 상기 이중 에러 로케이션 디코더 중 하나만을 선택하고, 그리고 선택되지 않은 에러 로케이션 디코더를 비활성화하도록 구성된 제어기; 및정정된 출력 데이터를 생성하기 위해 상기 단일 에러 로케이션 디코더 및 상기 이중 에러 로케이션 디코더에 커플링된 에러 정정기(error corrector)를 포함하는,에러 검출 및 정정 장치
2 2
제 1 항에 있어서, 상기 장치는, 상기 입력 데이터를 수신하고, 상기 입력 데이터에 기반하여 제 1 벡터 신호 출력 및 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 생성하도록 구성된 신드롬 생성기(syndrome generator)를 더 포함하고, 상기 제어기는 추가로 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 수신하고, 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들에 기반하여 단일 에러 정정 출력 및 이중 에러 정정 출력을 생성하도록 구성되고, 상기 단일 에러 로케이션 디코더는 상기 단일 에러 정정 출력을 수신하고, 단일 에러 로케이션 디코더 출력을 생성하도록 구성되고; 그리고상기 이중 에러 로케이션 디코더는 상기 이중 에러 정정 출력을 수신하고, 이중 에러 로케이션 디코더 출력을 출력하도록 구성되는,에러 검출 및 정정 장치
3 3
제 2 항에 있어서, 상기 신드롬 생성기는 패리티-체크 행렬 디코더(parity-check matrix decoder)를 포함하는, 에러 검출 및 정정 장치
4 4
제 3 항에 있어서, 상기 패리티-체크 행렬 디코더는 XOR-트리 기반의 패리티-체크 행렬 디코더(XOR-tree based parity-check matrix decoder)를 포함하는, 에러 검출 및 정정 장치
5 5
제 2 항에 있어서, 상기 신드롬 생성기로부터 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력을 수신하도록 구성된 이중 에러 검출기를 더 포함하는, 에러 검출 및 정정 장치
6 6
제 5 항에 있어서, 상기 이중 에러 검출기는 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들 중 2 개 또는 그 초과에 기반하여 이중 에러 검출 출력을 생성하도록 구성되는, 에러 검출 및 정정 장치
7 7
제 6 항에 있어서, 상기 이중 에러 검출기로부터 상기 이중 에러 검출 출력 및 상기 신드롬 생성기로부터 상기 제 1 벡터 신호 출력을 수신하고, 상기 이중 에러 검출 출력 및 상기 제 1 벡터 신호 출력에 기반하여 에러 플래그(error flag)를 생성하도록 구성된 플래그 생성기를 더 포함하는, 에러 검출 및 정정 장치
8 8
제 6 항에 있어서, 상기 장치는 멀티플렉서를 더 포함하고, 상기 멀티플렉서는:상기 단일 에러 로케이션 디코더 출력에 커플링된 제 1 입력; 및 상기 이중 에러 로케이션 디코더 출력에 커플링된 제 2 입력을 포함하는, 에러 검출 및 정정 장치
9 9
제 8 항에 있어서, 상기 멀티플렉서는 추가로:상기 이중 에러 검출 출력을 수신하도록 구성된 제어 입력; 및상기 제어 입력에 기반하여 상기 단일 에러 로케이션 디코더 출력 또는 상기 이중 에러 로케이션 디코더 출력 중 어느 하나를 출력하도록 구성된 출력을 포함하는, 에러 검출 및 정정 장치
10 10
제 9 항에 있어서, 상기 장치는 에러 정정기를 더 포함하고, 상기 에러 정정기는:상기 입력 데이터를 수신하도록 구성된 입력;상기 멀티플렉서의 출력에 커플링된 에러 로케이션 디코더 입력; 및상기 입력 데이터 및 상기 에러 로케이션 디코더 입력에 기반하여, 정정된 출력 데이터를 출력하도록 구성된 출력을 포함하는,에러 검출 및 정정 장치
11 11
제 2 항에 있어서,제어 입력 및 제어 출력을 갖는 타이밍 제어기;상기 단일 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍 제어기의 제어 출력에 커플링된 토글(toggle) 입력, 및 제 1 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 1 플립-플롭(flip-flop); 및상기 이중 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍 제어기의 제어 출력에 커플링된 토글 입력, 및 제 2 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 2 플립-플롭을 더 포함하는, 에러 검출 및 정정 장치
12 12
제 11 항에 있어서, 상기 타이밍 제어기는 지연 유닛을 포함하는, 에러 검출 및 정정 장치
13 13
제 12 항에 있어서, 상기 지연 유닛은 하나 또는 그 초과의 로직 게이트들을 포함하는, 에러 검출 및 정정 장치
14 14
제 13 항에 있어서, 상기 지연 유닛은 추가로 하나 또는 그 초과의 버퍼들을 포함하는, 에러 검출 및 정정 장치
15 15
제 11 항에 있어서, 상기 제 1 플립-플롭은 제 1 포지티브 에지 트리거 플립-플롭(positive edge triggered flip-flop)을 포함하고, 상기 제 2 플립-플롭은 제 2 포지티브 에지 트리거 플립-플롭을 포함하는, 에러 검출 및 정정 장치
16 16
에러 검출 및 정정 장치로서,입력 데이터에서 단일 에러들을 로케이팅하기 위한 단일 에러 로케이션 디코딩을 위한 수단;상기 입력 데이터에서 이중 에러들을 로케이팅하기 위한 이중 에러 로케이션 디코딩을 위한 수단;특정 데이터 입력이 단일 에러를 갖거나 또는 이중 에러를 갖는 것으로 예측되는지를 결정하기 위한 수단;상기 에러 예측에 기반하여 상기 특정 데이터 입력에 대한 에러 로케이션을 수행하기 위해, 상기 단일 에러 로케이션 디코더 및 상기 이중 에러 로케이션 디코더 중 하나만을 선택하기 위한 수단; 선택되지 않은 에러 로케이션 디코더를 비활성화하기 위한 수단; 및상기 단일 에러 로케이션 디코딩을 위한 수단에 의해 로케이팅된 상기 단일 에러들 및 상기 이중 에러 로케이션 디코딩 수단에 의해 로케이팅된 상기 이중 에러들에 기반하여, 정정된 출력 데이터를 생성하기 위해 에러들을 정정하기 위한 수단을 포함하는, 에러 검출 및 정정 장치
17 17
제 16 항에 있어서, 신드롬을 생성하기 위한 수단 ― 상기 신드롬을 생성하기 위한 수단은 상기 입력 데이터를 수신하고, 상기 입력 데이터에 기반하여 제 1 벡터 신호 출력 및 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 출력하도록 구성됨 ― ; 및단일 에러 정정 출력 및 이중 에러 정정 출력을 생성하기 위한 수단 ― 상기 단일 에러 정정 출력 및 상기 이중 에러 정정 출력을 생성하기 위한 수단은 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 수신하고, 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들에 기반하여 단일 에러 정정 출력 및 이중 에러 정정 출력을 생성하도록 구성됨 ― 을 더 포함하고, 상기 단일 에러 로케이션 디코딩을 위한 수단은 상기 단일 에러 정정 출력을 수신하고, 단일 에러 로케이션 디코더 출력을 출력하도록 구성되고; 그리고상기 이중 에러 로케이션 디코딩을 위한 수단은 상기 이중 에러 정정 출력을 수신하고, 이중 에러 로케이션 디코더 출력을 출력하도록 구성되는, 에러 검출 및 정정 장치
18 18
제 17 항에 있어서, 상기 신드롬을 생성하기 위한 수단은 패리티-체크 행렬 디코더를 포함하는, 에러 검출 및 정정 장치
19 19
제 17 항에 있어서, 이중 에러 검출 출력을 생성하기 위해 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들에 기반하여 이중 에러들을 검출하기 위한 수단을 더 포함하는, 에러 검출 및 정정 장치
20 20
제 19 항에 있어서, 상기 이중 에러 검출 출력 및 상기 제 1 벡터 신호 출력에 기반하여 에러 플래그를 생성하기 위한 수단을 더 포함하는, 에러 검출 및 정정 장치
21 21
제 20 항에 있어서, 상기 장치는 멀티플렉싱하기 위한 수단을 더 포함하고, 상기 멀티플렉싱하기 위한 수단은:상기 단일 에러 로케이션 디코더 출력에 커플링된 제 1 입력;상기 이중 에러 로케이션 디코더 출력에 커플링된 제 2 입력;상기 이중 에러 검출 출력을 수신하도록 구성된 제어 입력; 및상기 제어 입력에 기반하여 상기 단일 에러 로케이션 디코더 출력 또는 상기 이중 에러 로케이션 디코더 출력 중 어느 하나를 출력하도록 구성된 출력을 포함하는, 에러 검출 및 정정 장치
22 22
제 21 항에 있어서, 상기 장치는 에러들을 정정하기 위한 수단을 더 포함하고, 상기 에러들을 정정하기 위한 수단은:상기 입력 데이터를 수신하도록 구성된 데이터 입력;상기 멀티플렉싱하기 위한 수단의 출력에 커플링된 에러 로케이션 디코더 입력; 및상기 데이터 입력 및 상기 에러 로케이션 디코더 입력에 기반하여, 정정된 데이터를 출력하도록 구성된 출력을 포함하는, 에러 검출 및 정정 장치
23 23
제 17 항에 있어서, 타이밍을 제어하기 위한 수단 - 상기 타이밍을 제어하기 위한 수단은 제어 입력 및 제어 출력을 가짐 - ;상기 단일 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍을 제어하기 위한 수단의 제어 출력에 커플링된 토글 입력, 및 제 1 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 1 플립-플롭; 및상기 이중 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍을 제어하기 위한 수단의 제어 출력에 커플링된 토글 입력, 및 제 2 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 2 플립-플롭을 더 포함하는, 에러 검출 및 정정 장치
24 24
제 23 항에 있어서, 상기 제 1 전달되는 신드롬 출력은 상기 단일 에러 로케이션 디코딩을 위한 수단으로 전달되고, 상기 제 2 전달되는 신드롬 출력은 상기 이중 에러 로케이션 디코딩을 위한 수단으로 전달되는, 에러 검출 및 정정 장치
25 25
메모리로서,메모리 셀; 및상기 메모리 셀로부터 입력 데이터를 수신하고, 정정된 출력 데이터를 상기 메모리 셀로 송신하도록 커플링된 에러 검출 및 정정 장치를 포함하고, 상기 에러 검출 및 정정 장치는:입력 데이터에서 단일 에러들을 로케이팅하도록 구성된 단일 에러 로케이션 디코더;상기 입력 데이터에서 이중 에러들을 로케이팅하도록 구성된 이중 에러 로케이션 디코더; 특정 데이터 입력이 단일 에러를 갖거나 또는 이중 에러를 갖는 것으로 예측되는지를 결정하고, 상기 에러 예측에 기반하여 상기 특정 데이터 입력에 대해 에러 로케이션을 수행하기 위해 상기 단일 에러 로케이션 디코더 및 상기 이중 에러 로케이션 디코더 중 하나만을 선택하고, 그리고 선택되지 않은 에러 로케이션 디코더를 비활성화하도록 구성된 제어기; 및정정된 출력 데이터를 생성하기 위해 상기 단일 에러 로케이션 디코더 및 상기 이중 에러 로케이션 디코더에 커플링된 에러 정정기를 포함하는, 메모리
26 26
제 25 항에 있어서, 상기 에러 검출 및 정정 장치는:상기 입력 데이터를 수신하고, 상기 입력 데이터에 기반하여 제 1 벡터 신호 출력 및 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 생성하도록 구성된 신드롬 생성기를 더 포함하고,상기 제어기는 추가로 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들을 수신하고, 상기 제 1 벡터 신호 출력 및 상기 하나 또는 그 초과의 부가적인 벡터 신호 출력들에 기반하여 단일 에러 정정 출력 및 이중 에러 정정 출력을 생성하도록 구성되고, 상기 단일 에러 로케이션 디코더는 상기 단일 에러 정정 출력을 수신하고, 단일 에러 로케이션 디코더 출력을 생성하도록 구성되고; 그리고상기 이중 에러 로케이션 디코더는 상기 이중 에러 정정 출력을 수신하고, 이중 에러 로케이션 디코더 출력을 출력하도록 구성되는, 메모리
27 27
제 26 항에 있어서, 상기 에러 검출 및 정정 장치는 추가로:제어 입력 및 제어 출력을 갖는 타이밍 제어기;상기 단일 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍 제어기의 제어 출력에 커플링된 토글 입력, 및 제 1 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 1 플립-플롭; 및상기 이중 에러 정정 출력을 수신하도록 커플링된 입력, 상기 타이밍 제어기의 제어 출력에 커플링된 토글 입력, 및 제 2 전달되는 신드롬 출력을 출력하도록 구성된 출력을 포함하는 제 2 플립-플롭을 포함하는, 메모리
28 28
에러 디코딩의 방법으로서,특정 데이터 입력이 단일 에러를 갖거나 또는 이중 에러를 갖는 것으로 예측되는지를 결정하는 단계;상기 결정하는 단계에 기반하여 상기 특정 데이터 입력에 대해 에러 로케이션을 수행하기 위해, 입력 데이터에서 단일 에러들을 로케이팅하도록 구성된 단일 에러 로케이션 디코더 및 상기 입력 데이터에서 이중 에러들을 로케이팅하도록 구성된 이중 에러 로케이션 디코더 중 하나만을 선택하는 단계; 및선택되지 않은 에러 로케이션 디코더를 비활성화하는 단계를 포함하는,에러 디코딩의 방법
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9 US2017077963 US 미국 DOCDBFAMILY
10 US2018019767 US 미국 DOCDBFAMILY
11 US9800271 US 미국 DOCDBFAMILY
12 WO2017048474 WO 세계지적재산권기구(WIPO) DOCDBFAMILY
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